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Power Integrations發(fā)布超薄表面貼裝型封裝電源IC
- ???????用于高能效電源轉(zhuǎn)換的高壓集成電路業(yè)界的領(lǐng)導(dǎo)者Power Integrations公司今日宣布其行業(yè)領(lǐng)先的TOPSwitch-JX電源轉(zhuǎn)換IC系列新增了創(chuàng)新的eSOP?超薄功率封裝形式。這款全新的超薄表面貼裝型封裝非常適合最大功率在65 W以下、不使用散熱片的緊湊敞開(kāi)式設(shè)計(jì)，如超薄LCD電視輔助電源、機(jī)頂盒、PC待機(jī)和DVD播放器等產(chǎn)品的電源。
- 關(guān)鍵字： Power Integrations TOPSwitch-JX eSOP PCB
基于FPGA的超聲診斷儀動(dòng)態(tài)濾波器的設(shè)計(jì)
- 采用FPGA的模擬動(dòng)態(tài)濾波器，在結(jié)構(gòu)上簡(jiǎn)易，性能上穩(wěn)定，測(cè)試和設(shè)計(jì)都十分的方便。FPGA的使用，能根據(jù)具體要求很方便的改變控制信號(hào)，同時(shí)實(shí)現(xiàn)超聲診斷儀中多個(gè)模塊并行工作，也為以后的更多模擬部分?jǐn)?shù)字化提供了基礎(chǔ)。
- 關(guān)鍵字： FPGA 超聲診斷儀 動(dòng)態(tài) 濾波器
Bulgin新型PCB安裝保險(xiǎn)絲座面世
- 作為Arcolectric、Bulgin 和 Sifam 國(guó)際電子制造品牌的擁有者，Elektron Technology日前推出了兩款全新的垂直型印刷電路板板級(jí)安裝(PCB-mounting)保險(xiǎn)絲座FX0442和FX0443，這兩款新設(shè)計(jì)屬于該公司旗下產(chǎn)品門(mén)類(lèi)豐富的Bulgin保險(xiǎn)絲座系列。 FX0442和FX0443這兩款保險(xiǎn)絲座能夠容納尺寸為5x20mm的保險(xiǎn)絲，額定工作值為10A、250V ac，最大功率損耗是2.5W。它們專(zhuān)為各種批量應(yīng)用設(shè)計(jì)和制造，在這些應(yīng)用中PCB安裝提供了一種將
- 關(guān)鍵字： Bulgin PCB 保險(xiǎn)絲座
基于FPGA+ DSP的實(shí)時(shí)圖像處理系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)
- 基于FPGA+ DSP的實(shí)時(shí)圖像處理系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn),摘 要: 針對(duì)圖像處理系統(tǒng)計(jì)算量大、實(shí)時(shí)性高和體積小的要求， 研制了一種以DSP為主處理器FPGA 為輔處理器的高性能實(shí)時(shí)圖像處理系統(tǒng)。利用這兩種芯片的各自特點(diǎn)， 將算法分成兩部分分別交由FPGA 和DSP處理， 大大提高
- 關(guān)鍵字： FPGA，DSP
基于FPGA的8085A CPU結(jié)構(gòu)分析與實(shí)現(xiàn)
- 1 引 言
微型計(jì)算機(jī)原理幾乎是所有理工科類(lèi)大學(xué)生的必修課目之一， 其重要性不言而喻。然而大多數(shù)教學(xué)側(cè)重于應(yīng)用方面， 對(duì)計(jì)算機(jī)的結(jié)構(gòu)及工作原理涉之不深， 因?yàn)闊o(wú)法做一個(gè)CPU 來(lái)演示。這樣學(xué)生不能真正了解 - 關(guān)鍵字： 8085A FPGA CPU 結(jié)構(gòu)分析
基于邏輯分析內(nèi)核的FPGA電路內(nèi)調(diào)試技術(shù)
- 隨著FPGA融入越來(lái)越多的能力，對(duì)有效調(diào)試工具的需求將變得至關(guān)重要。對(duì)內(nèi)部可視能力的事前周密計(jì)劃將能使研制組采用正確的調(diào)試戰(zhàn)略，以更快完成他們的設(shè)計(jì)任務(wù)。
“我知道我的設(shè)計(jì)中存在一個(gè)問(wèn)題，但我沒(méi)有很 - 關(guān)鍵字： FPGA 邏輯分析 電路 調(diào)試技術(shù)
Cadence為復(fù)雜的FPGA/ASIC設(shè)計(jì)提高驗(yàn)證效率
- 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司,今天宣布在幫助ASIC與FPGA設(shè)計(jì)者們提高驗(yàn)證效率方面取得最新重大進(jìn)展。加上對(duì)最新Accellera Universal Verification Methodology (UVM) 1.0業(yè)界標(biāo)準(zhǔn)的全面支持，600多種新功能擴(kuò)展了指標(biāo)驅(qū)動(dòng)型驗(yàn)證(MDV)的范圍，幫助工程師實(shí)現(xiàn)更快、更全面的驗(yàn)證閉合與硅實(shí)現(xiàn)。
- 關(guān)鍵字： Cadence FPGA
高階累積量調(diào)制識(shí)別改進(jìn)算法的FPGA實(shí)現(xiàn)
- 摘要：基于高階累積量的數(shù)字調(diào)制信號(hào)識(shí)別算法在低信噪比環(huán)境下識(shí)別率較低。針對(duì)這一問(wèn)題，提出了高階累積量的改進(jìn)算法，通過(guò)調(diào)整特征參數(shù)的判別順序先識(shí)別出MASK信號(hào)的方式，取得了較好的效果。討論了該算法的FPGA設(shè)
- 關(guān)鍵字： FPGA 高階累積量 調(diào)制識(shí)別 改進(jìn)算法
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