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基于FPGA和DSP的微振動(dòng)傳感器信號(hào)采集系統(tǒng)設(shè)計(jì)
- 摘要：為實(shí)現(xiàn)對(duì)雙M—Z型光纖微振動(dòng)傳感器的振動(dòng)信號(hào)進(jìn)行實(shí)時(shí)檢測(cè)和處理，提出一種基于FPGA和DSP的數(shù)據(jù)采集和實(shí)時(shí)處理系統(tǒng)。通過(guò)描述系統(tǒng)的硬件設(shè)計(jì)原理和寄存器配置，以及軟件框架和流程，介紹了系統(tǒng)的設(shè)計(jì)和實(shí)
- 關(guān)鍵字： FPGA DSP 振動(dòng)傳感器 信號(hào)采集
利用CPLD實(shí)現(xiàn)FPGA的快速加載
- 基于SRAM的FPGA由于其可編程、可升級(jí)的特性，被廣泛應(yīng)用于現(xiàn)代通信系統(tǒng)中。由于其易失性，每次上電后都需要重新對(duì)FPGA進(jìn)行加載。隨著通信系統(tǒng)復(fù)雜度的提高，F(xiàn)PGA配置文件越來(lái)越大，加載時(shí)間越來(lái)越長(zhǎng)，嚴(yán)重影響系統(tǒng)的啟動(dòng)時(shí)同。為了提高FPGA的加載效率，在此提出一種通過(guò)CPLD進(jìn)行FPGA串行加載的方案。通過(guò)驗(yàn)證，該方法既能能提高FPGA加載效率，又能節(jié)省CPU和FPGA的GIPO管腳，降低系統(tǒng)啟動(dòng)時(shí)間，非常適用于現(xiàn)代復(fù)雜通信系統(tǒng)。
- 關(guān)鍵字： CPLD FPGA
面向異步視頻的嵌入式圖像處理系統(tǒng)設(shè)計(jì)
- 面向異步視頻的嵌入式圖像處理系統(tǒng)設(shè)計(jì),摘要：在此設(shè)計(jì)出一種基于DSP+FPGA技術(shù)的面向異步視頻的嵌入式圖像處理系統(tǒng)，以一種靈活的架構(gòu)避免了幀間不同步方法對(duì)雙口RAM顯存的需求，既能夠保證圖像輸出質(zhì)量，又有利于提升圖像處理的性能指標(biāo)。系統(tǒng)以FPGA為核心
- 關(guān)鍵字： 異步視頻 圖像處理 嵌入式系統(tǒng) FPGA 幀存切換
圣邦推出內(nèi)置高精度參考源低功耗比較器SGM8706
- 在很多比較器應(yīng)用中，需要一個(gè)穩(wěn)定、精準(zhǔn)的參考電壓作為精準(zhǔn)參考。一般在設(shè)計(jì)應(yīng)用中使用固定電阻分壓形式或利用TL431產(chǎn)生一個(gè)參考電壓來(lái)實(shí)現(xiàn)，而這兩種常見(jiàn)方式都有一定的局限性。采用電阻分壓形式，當(dāng)產(chǎn)品利用電池供電，一旦電池電壓下降，參考電壓也隨之下降，使得參考電壓不穩(wěn)定或者失去了作為精準(zhǔn)參考的意義;利用專用的參考電壓源方式，會(huì)增加PCB 面積及靜態(tài)工作電流 。
- 關(guān)鍵字： 圣邦 比較器SGM8706 SGM8706 PCB
基于SoPC的狀態(tài)監(jiān)測(cè)裝置的嵌入式軟硬件協(xié)同設(shè)計(jì)
- 基于SoPC的狀態(tài)監(jiān)測(cè)裝置的嵌入式軟硬件協(xié)同設(shè)計(jì),摘要：首先介紹了軟硬件協(xié)同設(shè)計(jì)方法的發(fā)展過(guò)程和狀態(tài)監(jiān)測(cè)裝置開(kāi)發(fā)的背景資料，然后利用該方法設(shè)計(jì)了一款新型的高性能狀態(tài)監(jiān)測(cè)裝置，并分別從硬件和軟件2個(gè)角度對(duì)設(shè)計(jì)方法進(jìn)行了深入說(shuō)明。該裝置已成功集成于水電機(jī)組
- 關(guān)鍵字： 軟硬件協(xié)同 SoPC 狀態(tài)監(jiān)測(cè) Linux FPGA PLC
Microsemi公司開(kāi)發(fā)的RTAX-DSP FPGA已獲準(zhǔn)用于航空領(lǐng)域
- 據(jù)報(bào)道，Microsemi公司SoC產(chǎn)品集團(tuán)(原Actel公司)開(kāi)發(fā)的RTAX-DSP現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)器件已獲得合格制造商清單(QML)V類和Q類資格認(rèn)證，這意味著該FPGA器件獲準(zhǔn)用于衛(wèi)星、載人飛船和其他空間應(yīng)用。 公司官方表示，Microsemi的抗輻射QML-V FPGA在不同程度上能夠承受空間自然輻射影響，并對(duì)每個(gè)特定晶片都進(jìn)行2,000小時(shí)的壽命測(cè)試，對(duì)每個(gè)特定組件都進(jìn)行破壞性物理分析。 RTAX-DSP FPGA將復(fù)雜數(shù)字信號(hào)處理(DSP)功能集成到單一設(shè)備，滿足高
- 關(guān)鍵字： Microsemi FPGA
短波擴(kuò)頻猝發(fā)通信系統(tǒng)的DSP+FPGA實(shí)現(xiàn)方案
- 引言短波通信是一種能進(jìn)行遠(yuǎn)距離傳輸，而對(duì)電臺(tái)的要求相對(duì)較低的通信系統(tǒng)。短波具有的遠(yuǎn)距離通信能力和電臺(tái)具有的較高機(jī)動(dòng)性等特點(diǎn)，使其在軍事通信領(lǐng)域中具有重要的應(yīng)用價(jià)值。然而，短波信道頻帶窄，傳播特性不穩(wěn)定
- 關(guān)鍵字： FPGA DSP 短波擴(kuò)頻 通信系統(tǒng)
基于FPGA的IIR數(shù)字濾波器的快捷設(shè)計(jì)
- 0 引言IIR數(shù)字濾波器在很多領(lǐng)域中都有著廣闊的應(yīng)用。與FIR數(shù)字濾波器相比，IIR數(shù)字濾波器可以用較低的階數(shù)獲得較高的選擇性，而且所用存儲(chǔ)單元少，經(jīng)濟(jì)效率高。一個(gè)N階IIR數(shù)字濾波器的系統(tǒng)函數(shù)為： 其線性常系數(shù)差分
- 關(guān)鍵字： FPGA IIR 數(shù)字濾波器
解析FPGA設(shè)計(jì)流程及其布線資源
- FPGA/CPLD的設(shè)計(jì)流程 1、電路設(shè)計(jì)與輸入 電路設(shè)計(jì)與輸入是指通過(guò)某些規(guī)范的描述方式，將工程師電路構(gòu)思輸入給EDA工具。常用的設(shè)計(jì)方法有硬件描述語(yǔ)言（HDL）和原理圖設(shè)計(jì)輸入方法等。原理圖設(shè)計(jì)輸入法在早期應(yīng)用得比
- 關(guān)鍵字： FPGA 設(shè)計(jì)流程 布線 資源
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