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使用LabVIEW FPGA模塊設(shè)計(jì)IP核

對于利用LabVIEW FPGA實(shí)現(xiàn)RIO目標(biāo)平臺上的定制硬件的工程師與開發(fā)人員，他們可以很容易地利用所推薦的組件設(shè)計(jì)構(gòu)建適合其應(yīng)用的、可復(fù)用且可擴(kuò)展的代碼模塊?；谝呀?jīng)驗(yàn)證的設(shè)計(jì)進(jìn)行代碼模塊開發(fā)，將使現(xiàn)有IP在未來應(yīng)
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基于FPGA的ISA總線／MMи總線數(shù)據(jù)轉(zhuǎn)換電路設(shè)計(jì)

摘要：某型導(dǎo)彈測試設(shè)備控制總線為通用的ISA總線，而通信接口總線為非標(biāo)準(zhǔn)的MMи總線。在此以FPGA為核心設(shè)計(jì)了一種ISA總線／MMи總線轉(zhuǎn)換電路，該電路可以完成2種制式的數(shù)據(jù)和控制指令轉(zhuǎn)換。給出了轉(zhuǎn)換電路原理框圖、
關(guān)鍵字： FPGA ISA 總線數(shù)據(jù)轉(zhuǎn)換

采用VHDL和發(fā)接復(fù)用器的SDH系統(tǒng)設(shè)計(jì)及FPGA仿真

采用VHDL和發(fā)接復(fù)用器的SDH系統(tǒng)設(shè)計(jì)及FPGA仿真,針對目前國內(nèi)SDH系統(tǒng)中還沒有一個專門的E1分接復(fù)用芯征，本文介紹一種用高級硬件描述語言VHDL及狀態(tài)轉(zhuǎn)移圖完成該發(fā)接復(fù)用器的設(shè)計(jì)的新型設(shè)計(jì)方法及其FPGA實(shí)現(xiàn)。并給出了用Xilinx FoundaTIon tools EDA軟件設(shè)計(jì)的電路
關(guān)鍵字：設(shè)計(jì) FPGA 仿真系統(tǒng) SDH VHDL 復(fù)用器采用

基于FPGA+DSP的HDLC(高級數(shù)據(jù)鏈路控制)功能實(shí)現(xiàn)

基于FPGA+DSP的HDLC(高級數(shù)據(jù)鏈路控制)功能實(shí)現(xiàn),引言　　HDLC的ASIC芯片使用簡易，功能針對性強(qiáng)，性能可靠，適合應(yīng)用于特定用途的大批量產(chǎn)品中。但由于HDLC標(biāo)準(zhǔn)的文本較多，ASIC芯片出于專用性的目的難以通用于不同版本，缺乏應(yīng)用靈活性。有的芯片公司還有自己的標(biāo)
關(guān)鍵字：鏈路控制功能實(shí)現(xiàn) 數(shù)據(jù) 高級 FPGA DSP HDLC 基于

采用混合信號FPGA的功率管理解決方案

采用混合信號FPGA的功率管理解決方案,　概述　　Actel Fusionreg; 混合信號FPGA能夠?qū)崿F(xiàn)功率管理，包括上電順序、運(yùn)行時間功率監(jiān)控，以及關(guān)機(jī)控制。此外，愛特公司提供的混合信號功率管理工具(Mixed-Signal Power Manager, MPM)參考設(shè)計(jì)，更可在如AFS0
關(guān)鍵字：管理解決方案功率 FPGA 混合信號采用

采用FPGA和VHDL語言的多按鍵狀態(tài)識別系統(tǒng)

采用FPGA和VHDL語言的多按鍵狀態(tài)識別系統(tǒng),這里提出一種利用FPGA的I/0端口數(shù)多和可編程的特點(diǎn)，采用VHDL語言的多按鍵狀態(tài)識別系統(tǒng)，實(shí)現(xiàn)識別60個按鍵自由操作，并簡化MCU的控制信號。　　2 系統(tǒng)設(shè)計(jì)方案　　FPGA是一種可編程邏輯器件，它具有良好性能、極高的
關(guān)鍵字：狀態(tài) 識別系統(tǒng) 按鍵語言 FPGA VHDL 采用

FPGA教學(xué):應(yīng)用與研究并重

問：您對“第三屆開源硬件及嵌入式大賽”的哪些作品印象較深？答：一個就是浙大的“基于FPGA的M2M異構(gòu)虛擬化系統(tǒng)”設(shè)計(jì)，一個，還有太原理工大學(xué)?的AVS編碼FPGA實(shí)現(xiàn)。問：這次比賽是否公平公正？答：這個評選方式不是特別學(xué)術(shù)性的，有點(diǎn)是大家喜好的程度的海選。問：就是理論性的東西評選的分值相對占的低了一些？答：從最后的結(jié)果來看是這樣的。問：是否應(yīng)該專家的分?jǐn)?shù)權(quán)重還要更高一點(diǎn)？答：總的來說我覺得名次不是最重要的，
關(guān)鍵字： FPGA Xilinx 教育

集成UART核心的FPGA異步串行實(shí)現(xiàn)

串行外設(shè)都會用到RS232-C異步串行接口，傳統(tǒng)上采用專用的集成電路即UART實(shí)現(xiàn)，如TI、EXAR、EPIC的550、452等系列，但是我們一般不需要使用完整的UART的功能，而且對于多串口的設(shè)備或需要加密通訊的場合使用UART也不是
關(guān)鍵字： UART FPGA 集成核心

基于FPGA和DSP的高速圖像處理系統(tǒng)

摘要：為了提高圖像處理系統(tǒng)的高性能和低功耗，提出了一種基于FPGA和DSP協(xié)同作業(yè)的高速圖像處理嵌入式系統(tǒng)，其中DSP為主處理器，負(fù)責(zé)圖像處理，而FPGA為協(xié)處理器，負(fù)責(zé)系統(tǒng)的所有數(shù)字邏輯。整個系統(tǒng)中FPGA和DSP的工作
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基于FPGA和51單片機(jī)信號發(fā)生器設(shè)計(jì)與實(shí)現(xiàn)

摘要：為了降低傳統(tǒng)函數(shù)信號發(fā)生器成本，改善函數(shù)信號發(fā)生器低頻穩(wěn)定性，本文結(jié)合FPGA和51單片機(jī)設(shè)計(jì)并實(shí)現(xiàn)了產(chǎn)生以0．596Hz頻率精度各種函數(shù)信號。函數(shù)信號頻率、波形、幅度由51單片機(jī)控制，并用LCD顯示函數(shù)信號相關(guān)
關(guān)鍵字：設(shè)計(jì) 實(shí)現(xiàn) 信號發(fā)生器單片機(jī) FPGA 基于

利用FPGA實(shí)現(xiàn)高性能的罪犯抓捕系統(tǒng)

由于高科技工具成為抓捕罪犯的武器中越來越關(guān)鍵的部分，因此執(zhí)法機(jī)構(gòu)和安全專業(yè)人員不斷尋求更快更方便的數(shù)據(jù)收集和解讀方式就不足為奇了。針對這一領(lǐng)域的應(yīng)用越來越復(fù)雜，必須適應(yīng)不斷演變的要求，并把成本控制在機(jī)
關(guān)鍵字： FPGA 性能系統(tǒng)

基于FPGA與DSP導(dǎo)引頭信號處理中FPGA設(shè)計(jì)

電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
關(guān)鍵字： DSP 信號處理 FPGA 導(dǎo)引頭

賽靈思開源硬件與嵌入式大賽創(chuàng)意紛呈

由中國電子學(xué)會主辦，美國賽靈思公司和北京工業(yè)大學(xué)共同承辦的“FPGA助力中國智造，擁抱嵌入式計(jì)算新時代 — 第三屆OpenHW開源硬件與嵌入式大賽”總決賽于在北京工業(yè)大學(xué)隆重舉行。來自中國大陸、臺灣和新加坡的26支進(jìn)入決賽的精英團(tuán)隊(duì)會聚中國北京，各展其能，現(xiàn)場進(jìn)行演示及答辯，為在場的專家和評委們奉上了一場創(chuàng)新與創(chuàng)意的盛宴。
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第五屆SoCIP年會完美落幕

　　日前，第五屆SoCIP年會在北京召開。SoCIP會議已發(fā)展成為中國領(lǐng)先的SoC/ASIC設(shè)計(jì)會議之一。全天會議包括技術(shù)研討會和參展商展示，把全世界最新的SoC/ASIC設(shè)計(jì)技術(shù)帶到中國。與會者通過與一些不同公司的專家們直接交流，從而獲得最新的SoC/ASIC技術(shù)發(fā)展的第一手資料。今年的參展商包括S2C、SpringSoft、tensilica、Algotochip、CAST等等。　　S2C是展會的主辦者。S2C是領(lǐng)先的快速SoC原型解決方案提供商，其總部位于美國加利福尼亞州圣何塞市并且在上海、北京
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基于ARM的快速原型化平臺的實(shí)現(xiàn)

摘要：本文首先闡述了嵌入式系統(tǒng)的特點(diǎn)以及可測性、靈活性和模塊化的設(shè)計(jì)方法,接著介紹了ARM核的快速原型化平 ...
關(guān)鍵字：快速原型化 FPGA 隨機(jī)方向傳輸

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fpga介紹

FPGA是英文Field－Programmable Gate Array的縮寫，即現(xiàn)場可編程門陣列，它是在PAL、GAL、EPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路（ASIC）領(lǐng)域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。 FPGA采用了邏輯單元陣列LCA（Logic Cell Array）這樣一個新概念，內(nèi)部包括可 [ 查看詳細(xì) ]