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      EEPW首頁 >> 主題列表 >> fpga-pwm

      FPGA相關(guān)技術(shù)助力高端存儲(chǔ)器接口設(shè)計(jì)

      • 高性能系統(tǒng)設(shè)計(jì)師在滿足關(guān)鍵時(shí)序余量的同時(shí)要力爭(zhēng)獲得更高性能,而存儲(chǔ)器>存儲(chǔ)器接口設(shè)計(jì)則是一項(xiàng)艱巨挑戰(zhàn)。雙倍數(shù)據(jù)速率SDRAM和4倍數(shù)據(jù)速率SDRAM都采用源同步接口來把數(shù)據(jù)和時(shí)鐘(或選通脈沖)由發(fā)射器
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      級(jí)聯(lián)信號(hào)處理器的FPGA實(shí)現(xiàn)

      • 摘要:現(xiàn)代通信系統(tǒng)中,數(shù)字化已成為發(fā)展的必然趨勢(shì),數(shù)字信號(hào)處理則是數(shù)字系統(tǒng)中的重要環(huán)節(jié)。在數(shù)字信號(hào)處理方面提出一種級(jí)聯(lián)信號(hào)處理器的FPGA實(shí)現(xiàn)方案,用以取代昂貴的專用數(shù)字處理芯片。首先對(duì)級(jí)聯(lián)信號(hào)處理器做了
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      DMPPT與PFM/PWM混合調(diào)制電路特征與應(yīng)用

      • 摘要:文章介紹了分布式太陽能最大功率跟蹤系統(tǒng)(DMPPT)的特征及在太陽能路燈系統(tǒng)中的應(yīng)用,介紹了新型高效率升壓/降壓DC-DC轉(zhuǎn)換器及帶內(nèi)部開關(guān)的高效降壓型DC/DC轉(zhuǎn)換器,對(duì)PFM/PWM混合調(diào)制電路技術(shù)特征與應(yīng)用進(jìn)行了詳
      • 關(guān)鍵字: 特征  應(yīng)用  電路  調(diào)制  PFM/PWM  混合  DMPPT  

      新一代視頻編碼器分析介紹

      • 先進(jìn)的視頻編碼(AVC)正在慢慢地超越數(shù)字視頻的主要標(biāo)準(zhǔn)。也稱之為H.264和MPEG-4part10,其AVC編碼在1Mbit/s~2...
      • 關(guān)鍵字: 視頻編碼器  AVC編碼  FPGA  

      基于FPGA的多通道校準(zhǔn)算法的同步實(shí)現(xiàn)

      •   數(shù)字信號(hào)處理模塊是接收機(jī)系統(tǒng)的核心部分,系統(tǒng)要求數(shù)字信號(hào)處理模塊能實(shí)時(shí)處理ADC變換后的數(shù)字信號(hào),并用軟件的方法來實(shí)現(xiàn)大量的無線電功能,這些功能包括:多通道校準(zhǔn)、編解碼、調(diào)制解調(diào)、濾波、同步、盲均衡、
      • 關(guān)鍵字: FPGA  多通道  校準(zhǔn)  算法    

      基于DSP和FPGA技術(shù)的低信噪比雷達(dá)信號(hào)檢測(cè)

      • 摘要:提出一種基于DSP和FPGA技術(shù)的低信噪比情況下雷達(dá)信號(hào)檢測(cè)技術(shù)的工作原理與硬件實(shí)現(xiàn)方法,采用數(shù)字化的處理方法處理信息,取代傳統(tǒng)使用的模擬檢測(cè)技術(shù),并對(duì)實(shí)現(xiàn)的檢測(cè)方法和關(guān)鍵算法做了詳細(xì)介紹。
        關(guān)鍵詞:高
      • 關(guān)鍵字: FPGA  DSP  低信噪比  雷達(dá)信號(hào)    

      升壓ZVT-PWM轉(zhuǎn)換器在單項(xiàng)功率因數(shù)校正中的應(yīng)用

      • 本文介紹了一種軟開關(guān)單相升壓功率因數(shù)校正電路―升壓ZVT-PWM轉(zhuǎn)換器,分析了該電路的工作原理。仿真和實(shí)驗(yàn)結(jié)果同時(shí)表明,在單相功率因數(shù)校正中采用升壓ZVT-PWM轉(zhuǎn)換器,可以提高功率因數(shù),減少開關(guān)損耗并降低電磁干擾 。
      • 關(guān)鍵字: ZVT-PWM  升壓  功率因數(shù)校正  轉(zhuǎn)換器    

      基于FPGA IP核的FFT實(shí)現(xiàn)

      • 對(duì)于FFT而言,很多領(lǐng)域都提出了其高速實(shí)時(shí)運(yùn)算的要求。利用FFT IP核實(shí)現(xiàn)FFT算法,并在cycloneⅡ系列的EP2C70F896C8器件上設(shè)計(jì)出處理速度為69.58 MHz的24位512點(diǎn)復(fù)數(shù)FFT處理器需29.3 μs,該方法具有效率高、速度快、周期短、靈活性強(qiáng)等特點(diǎn)。仿真結(jié)果表明此方法具有良好性能。
      • 關(guān)鍵字: FPGA  FFT  IP核    

      使用低側(cè)PWM IC的降壓轉(zhuǎn)換器

      • 最常見的開關(guān)電源結(jié)構(gòu)是降壓轉(zhuǎn)換器,它能高效地將高電壓轉(zhuǎn)換為低電壓。圖1給出了一個(gè)典型的降壓轉(zhuǎn)換器,其中N溝道MOSFET Q1需要一個(gè)浮柵驅(qū)動(dòng)信號(hào)。浮柵驅(qū)動(dòng)是PWM(脈寬調(diào)制)控制器IC的一部分。根據(jù)控制器的設(shè)計(jì),Q1
      • 關(guān)鍵字: 轉(zhuǎn)換器  IC  PWM  使用  轉(zhuǎn)換器  

      基于FPGA的多通道校準(zhǔn)算法同步實(shí)現(xiàn)

      • 本文主要研究了多通道校準(zhǔn)算法在FPGA上的同步實(shí)現(xiàn)問題。介紹FPGA時(shí)鐘同步設(shè)計(jì)的基本原理以及用Xilinx公司的FPGA芯片Xc2v8000ff1152-5實(shí)現(xiàn)了多通道校準(zhǔn)的同步算法,極大提高了系統(tǒng)穩(wěn)定性。
      • 關(guān)鍵字: ADC  FPGA  多通道校準(zhǔn)  同步實(shí)現(xiàn)  200907  

      基于FPGA的UART設(shè)計(jì)實(shí)現(xiàn)及驗(yàn)證

      • 通用異步收發(fā)器(Universal Asynchronous Receiver Transmitter,UART)是數(shù)字通信領(lǐng)域流行和廣泛使用的一種接口設(shè)備,主要用來控制符合RS 232-C協(xié)議的計(jì)算機(jī)與串行設(shè)備間的通信。普通串行外設(shè)和計(jì)算機(jī)間的通信,一般使
      • 關(guān)鍵字: FPGA  UART  設(shè)計(jì)實(shí)現(xiàn)    

      FPGA的光纖通道接口控制芯片設(shè)計(jì)

      • 摘 要 為了滿足存儲(chǔ)網(wǎng)絡(luò)和下一代航空電子系統(tǒng)對(duì)光纖通道網(wǎng)絡(luò)的需求,提出了一種新的光纖通道網(wǎng)絡(luò)接口控制芯片的設(shè)計(jì)方案。用 Verilog實(shí)現(xiàn)了接口控制芯片的RTL設(shè)計(jì)并完成了功能仿真和驗(yàn)證,通過嵌入式PowerPC完成了接
      • 關(guān)鍵字: 芯片  設(shè)計(jì)  控制  接口  光纖  通道  FPGA  

      可編程技術(shù)勢(shì)在必行,一觸即發(fā)

      • 設(shè)計(jì)師們最有發(fā)言權(quán),他們認(rèn)為二十一世紀(jì)最具決定性的集成電路技術(shù)就是現(xiàn)場(chǎng)可編程門陣列(FPGA),而傳統(tǒng)門陣列和結(jié)...
      • 關(guān)鍵字: 可編程技術(shù)  FPGA  ASSP  Virtex-6  Spartan-6  

      FPGA或?qū)⒊蔀殡娮酉到y(tǒng)制造商救命利器

      • 根據(jù)賽靈思的分析,2007年可編程邏輯芯片市場(chǎng)約為36億美元,2012年將快速增長(zhǎng)到140億美元。推動(dòng)這一巨幅增長(zhǎng)的...
      • 關(guān)鍵字: FPGA  ASIC  ASSP  

      ISE設(shè)計(jì)套件11.1版本簡(jiǎn)介

      • ISE設(shè)計(jì)套件11.1版本(ISEDesignSuite11.1)在為嵌入式、DSP和邏輯設(shè)計(jì)人員提供FPGA設(shè)計(jì)工具和IP產(chǎn)品方面確...
      • 關(guān)鍵字: ISE設(shè)計(jì)套件11.1  DSP  FPGA  
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      fpga-pwm介紹

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