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Altera Quartus II軟件v13.1編譯時間縮短70%
- Altera公司 (NASDAQ: ALTR)今天宣布發(fā)布Quartus? II軟件13.1版，通過大幅度優(yōu)化算法以及增強(qiáng)并行處理，與前一版本相比，編譯時間平均縮短了30%，最大達(dá)到70%，進(jìn)一步擴(kuò)展了在軟件效能方面的業(yè)界領(lǐng)先優(yōu)勢。軟件還包括最新的快速重新編譯特性，適用于客戶對Altera Stratix? V FPGA設(shè)計進(jìn)行少量源代碼改動的情形。采用快速重新編譯特性，客戶可以重新使用以前的編譯結(jié)果，從而保持性能，不需要前端設(shè)計劃分，進(jìn)一步將編譯時間縮短了50%。
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基于FPGA的基帶64×64數(shù)據(jù)分配矩陣設(shè)計方案
- 本文采用FPGA作為實現(xiàn)控制邏輯的核心部件，提出了基于FPGA的基帶64×64 數(shù)據(jù)分配矩陣設(shè)計方案，并介紹了上位機(jī) ...
- 關(guān)鍵字： FPGA 數(shù)據(jù)分配 矩陣設(shè)計
基于FPGA的TDICCD8091 驅(qū)動時序電路設(shè)計
- 0引言時間延時積分電荷耦合器件(TimeDelayandIntegra-tionChargeCoupledDevices,TDICCD)易于實現(xiàn)實...
- 關(guān)鍵字： FPGA TDICCD8091 驅(qū)動時序
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