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零基礎(chǔ)學(xué)FPGA （二十四）必會！ 從靜態(tài)時序分析到SDRAM時序收斂（上篇）
- 下面我們進(jìn)入正題，今天我們講時序 一、從靜態(tài)時序分析說起 我理解的靜態(tài)時序分析，就是我們在不加激勵的情況下，通過對電路進(jìn)行時序的延遲計算，預(yù)計電路的工作流程，對電路提出我們需要的一些約束條件，比如我們需要從A寄存器到B寄存器的延遲不能大于10ns，如果我們不添加時序約束，綜合工具可能會有好幾條路徑，按照它自己的要求來布局布線，那么從A寄存器到B寄存器的時間就有可能是20ns或者15ns之類的路徑，而我們需要的是不能大于10ns，因此，我們需要添加時序約束，再根據(jù)特定的時序模型，使我們的系統(tǒng)
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小梅哥和你一起深入學(xué)習(xí)FPGA之PS2鍵盤驅(qū)動
- 在我們的電子系統(tǒng)中，當(dāng)需要用到大量的按鍵輸入時，普通的獨立按鍵和矩陣鍵盤已經(jīng)無法滿足我們的輸入需求，這個時候，我們需要使用一種功能更加強大的鍵盤，來幫助我們輸入更多的信息。在pc機(jī)上，我們經(jīng)常使用104鍵的鍵盤，這種鍵盤與pc機(jī)的接口，可分為USB接口和PS2接口，我們FPGA要實現(xiàn)USB接口比較困難，因為USB的接口線路，不是標(biāo)準(zhǔn)的TTL電平，而PS2接口，則使用標(biāo)準(zhǔn)的TTL電平，那么我們今天就使用FPGA來解碼驅(qū)動一個采用PS2接口的pc機(jī)鍵盤，用這個鍵盤來擴(kuò)展我們FPGA的輸入系統(tǒng)，以使我們能夠
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最新生物芯片掃描儀位置檢測系統(tǒng)設(shè)計，含硬件、軟件、仿真結(jié)果
- 引言 生物芯片是20世紀(jì)末隨“人類基因組計劃”的研究和發(fā)展而產(chǎn)生的一項高新技術(shù)，是人們高效地大規(guī)模獲取生物信息的有效手段。目前大部分生物芯片采用熒光染料標(biāo)記待測樣品分子。生物芯片掃描儀用激光激發(fā)熒光染料，通過對激發(fā)點的成像，檢測一個點;結(jié)合生物芯片X-Y二維精密掃描臺上移動，實現(xiàn)對整片的掃描。X-Y二維掃描臺的位置檢測精度直接影響著掃描分辨率——生物芯片掃描儀性能的關(guān)鍵參數(shù)?；趥鹘y(tǒng)的數(shù)字電路的生物芯片掃描儀中X-Y二維掃描臺的位置檢測電路存在計數(shù)
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英特爾的下一步：整合處理器核心與FPGA
- 自今年六月一號，英特爾宣布并購Altera后，雙方對于并購訊息就未再透露更多的訊息。不過，針對此點，Altera亞太區(qū)副總裁暨董事總經(jīng)理莊秉翰引述英特爾所發(fā)布的公開訊息，也約略點出了英特爾并購Altera后的未來發(fā)展方向。 莊秉翰談到，眾所皆知，摩爾定律是由英特爾創(chuàng)辦人所創(chuàng)，截至目前為止，英特爾仍然認(rèn)為摩爾定律仍然適用于半導(dǎo)體產(chǎn)業(yè)，同樣的，Altera也有相同的看法。 此外，英特爾也認(rèn)為，并購Altera再整合自身旗下的IP等技術(shù)方案，可以創(chuàng)造出新一代的產(chǎn)品陣容，以滿足資料中心與物聯(lián)網(wǎng)的客戶群。
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零基礎(chǔ)學(xué)FPGA （二十二） SDR SDRAM（理論篇）
- 其實說實話這一個月來也沒怎么看新知識，大體梳理了一下以前學(xué)過的知識，回顧了一下SOPC的學(xué)習(xí)。對于SOPC的學(xué)習(xí)我打算暫時先放一放，因為前面還有一個要寫的沒有完成，也是一直以來無法寫起的一個題目，就是今天我們要寫的SDRAM的操作。等寫完這個，我們再回到SOPC，帶領(lǐng)大家調(diào)USB2.0! 由于SDRAM本身就是一個比較復(fù)雜的東西，之前小墨在學(xué)這方面東西的時候感覺很是吃力，于是那時候便暫時放下了，知道年后這段時間，小墨又重新拾起這個知識點，想要一口氣把它調(diào)通了，再往下看其他的東西。學(xué)SDRAM，理
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Altera FPGA為RICOH SP 3600DN系列新打印機(jī)提供支持
- Altera公司今天宣布，總部位于東京，專注于提供圖像設(shè)備和制片打印解決方案、文檔管理系統(tǒng)以及IT服務(wù)的全球技術(shù)公司Ricoh集團(tuán)選擇了Altera Cyclone® IV FPGA來支持其最新推出的打印機(jī)產(chǎn)品線——RICOH SP 3600DN系列。Altera的Cyclone IV FPGA為RICOH SP 3600系列打印機(jī)的圖像處理功能提供支持，實現(xiàn)了1200 dpi圖像質(zhì)量、串行打印速度和高速打印速度等新特性。此外，Cyclone IV FPGA還幫助Ric
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兩種基于FPGA的軟件濾波方法
- 基于FPGA的軟件濾波算法設(shè)計及實現(xiàn) 隨著數(shù)字電子技術(shù)的發(fā)展，數(shù)字電路已由早期的分立元件逐漸發(fā)展成集成電路，對電路設(shè)計的要求越來越高。尤其是可編程邏輯器件的出現(xiàn)，使得以硬件為載體、以計算機(jī)軟件為開發(fā)環(huán)境的現(xiàn)代數(shù)字系統(tǒng)的設(shè)計方法日趨成熟?？删幊踢壿嬈骷O(shè)計靈活、功能強大、可在線修改、效率高等優(yōu)點深受廣大電子設(shè)計人員青睞。目前，大多數(shù)現(xiàn)場可編程邏輯陣列( FPGA)芯片是電壓敏感型芯片，基于可重構(gòu)CMOS-SRAM單元結(jié)構(gòu)，數(shù)據(jù)具有易失性，工作在低電壓狀態(tài)，易受干擾，尤其在工控、軍用場合，外界電磁環(huán)
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如何用賽靈思FPGA實現(xiàn)4G無線球形檢測器
- MIMO無線系統(tǒng)最佳硬判決檢測方式是最大似然(ML)檢測器。ML檢測因為比特誤碼率 (BER)性能出眾，非常受歡迎。不過，直接實施的復(fù)雜性會隨著天線和調(diào)制方案的增加呈指數(shù)級增強，使ASIC或FPGA僅能用于使用少數(shù)天線的低密度調(diào)制方案。 WiMAX對寬帶互聯(lián)網(wǎng)接入如同手機(jī)對語音通信一樣意義非凡。它可以取代DSL和有線服務(wù)，隨時隨地提供互聯(lián)網(wǎng)接入。只需要打開計算機(jī)，連接到最近的WiMAX天線，就可以暢游全世界的網(wǎng)絡(luò)了。 寬帶互聯(lián)網(wǎng)接入遇到的最大挑戰(zhàn)之一就是移動性，而這正是最新的WiMAX標(biāo)準(zhǔn)
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美高森美推出汽車等級SoC FPGA和FPGA器件
- 致力于在電源、安全、可靠和性能方面提供差異化半導(dǎo)體技術(shù)方案的領(lǐng)先供應(yīng)商美高森美公司(Microsemi Corporation) 宣布提供全新汽車等級現(xiàn)場可編程門陣列(FPGA)和系統(tǒng)級芯片(SoC) FPGA器件?；陂W存的下一代低功率 FPGA和ARM® Cortex®-M3使能SoC FPGA器件已經(jīng)獲得AEC-Q100等級2認(rèn)證，這是概述電子元器件標(biāo)準(zhǔn)以期確保最終系統(tǒng)可滿足汽車可靠性水平要求的行業(yè)標(biāo)準(zhǔn)規(guī)范。新的汽車等級合格 SmartFusion®2和 IGLOO&re
- 關(guān)鍵字： 美高森美 FPGA
FPGA+CPU：并行處理大行其道
- 深亞微米時代，傳統(tǒng)材料、結(jié)構(gòu)乃至工藝都在趨于極限狀態(tài)，摩爾定律也已有些捉襟見肘。而步入深亞納米時代，晶體管的尺寸就將接近單個原子，無法再往下縮減。傳統(tǒng)ASIC和ASSP設(shè)計不可避免地遭遇了諸如設(shè)計流程復(fù)雜、生產(chǎn)良率降低、設(shè)計周期過長，研發(fā)制造費用劇增等難題，從某種程度上大大放緩了摩爾定律的延續(xù)。 顯而易見的是，在巨額的流片成本面前，很多中小規(guī)模公司不得不改變策略，更多的轉(zhuǎn)向FPGA的開發(fā)和設(shè)計。反觀FPGA市場，即便是5年前，其相對于ASIC的市場增速還是相當(dāng)遲緩的，但在近些年，尤其是邁進(jìn)90n
- 關(guān)鍵字： FPGA CPU
Altera將舉辦技術(shù)大會分享最新解決方案
- Altera宣布將主辦2015年Altera技術(shù)大會(Altera Technology Day，ATD)活動，這是橫跨亞太地區(qū)八個地點的一系列以技術(shù)為導(dǎo)向的研討會，包括臺灣、印度、新加坡、馬來西亞、韓國與中國，時間將從2015年8月6日至9月23日。 Altera技術(shù)及市場專家將會分享在電子系統(tǒng)設(shè)計上的最新趨勢， Terasic、MathWorks與Tektronix等合作夥伴也將展示在電子設(shè)計與產(chǎn)品上使用Altera的FPGA、SoC、IP與電源解決方案，以提供加速產(chǎn)品上市的價值。關(guān)于研討會
- 關(guān)鍵字： Altera FPGA
設(shè)計成本低、可重復(fù)使用的配電架構(gòu)
- 最近，航天子系統(tǒng)采用的先進(jìn)半導(dǎo)體最底限是需有多個低電壓、具高電流軌條件，例如核心電壓小于1伏特(V)/30安培(A)的現(xiàn)場可編程門陣列(FPGA)。此外，各個負(fù)載也須具有獨特的排序、暫瞬、線路與負(fù)載調(diào)節(jié)的要求，這樣會讓配電網(wǎng)絡(luò)的設(shè)計變得更復(fù)雜。 目前航天總線提供28和100伏特不穩(wěn)定的電源軌，可用于為最新的航天級半導(dǎo)體生成隔離的、有效率的穩(wěn)壓電源。為滿足未來航天子系統(tǒng)的需求，開發(fā)一個低成本、可擴(kuò)展的配電架構(gòu)，且可重復(fù)的設(shè)計是尋求從28或100伏特兩種輸入中，可有效地生成多個較小的電軌，并同時限制
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