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IIR數(shù)字濾波器設(shè)計(jì)-在FPGA上實(shí)現(xiàn)任意階IIR數(shù)字濾波器
- IIR數(shù)字濾波器設(shè)計(jì)-在FPGA上實(shí)現(xiàn)任意階IIR數(shù)字濾波器摘要：本文介紹了一種采用級(jí)聯(lián)結(jié)構(gòu)在FPGA上實(shí)現(xiàn)任意階I...
- 關(guān)鍵字： IIR數(shù)字濾波器 fpga
Round-Robin輪詢調(diào)度機(jī)制在多隊(duì)列處理中的應(yīng)用
- 本文主要介紹了虛擬化路由器的結(jié)構(gòu)以及其中的關(guān)鍵調(diào)度機(jī)制的算法和實(shí)現(xiàn)，通過(guò)多級(jí)的調(diào)度處理，實(shí)現(xiàn)了支持多個(gè)可靈活配置，線速轉(zhuǎn)發(fā)的路由實(shí)例的虛擬化路由器。本文所提到虛擬化路由器實(shí)際設(shè)計(jì)名稱為“IsoRouter”，它基于NetFPGA板卡，本文所介紹的調(diào)度機(jī)制不針對(duì)具體某一型號(hào)的FPGA，它可以在任何一款FPGA上實(shí)現(xiàn)。
- 關(guān)鍵字： 路由器 FPGA
FPGA基礎(chǔ)之時(shí)序設(shè)計(jì)
- FPGA設(shè)計(jì)一個(gè)很重要的設(shè)計(jì)是時(shí)序設(shè)計(jì)，而時(shí)序設(shè)計(jì)的實(shí)質(zhì)就是滿足每一個(gè)觸發(fā)器的建立(Setup)/保持(Hold)時(shí)間的要求。建立時(shí)間(Setup Time)：是指在觸發(fā)器的時(shí)鐘信號(hào)上升沿到來(lái)以前，數(shù)據(jù)穩(wěn)定不變的時(shí)間，如果建立時(shí)間
- 關(guān)鍵字： FPGA 基礎(chǔ) 時(shí)序設(shè)計(jì)
三模冗余乘法器的設(shè)計(jì)與實(shí)現(xiàn)
- 現(xiàn)場(chǎng)可編程門陣列(Field Programmable Gate Array，F(xiàn)PGA)可通過(guò)用戶軟件編程來(lái)配置生成硬件電路，極大提高了電子系統(tǒng)設(shè)計(jì)中的靈活性和通用性，因而被廣泛應(yīng)用于航天、通信、醫(yī)療和工控等重要領(lǐng)域。但在空間環(huán)境中，基于SRAM的FPGA容易受SEU(Single Event Upset)和SETs(Single Event Transients)的影響，從而導(dǎo)致系統(tǒng)故障。DMR(Dual Modular Redundancy)和TMR(Triple Modular Redundancy
- 關(guān)鍵字： 乘法器 FPGA
基于FPGA的網(wǎng)絡(luò)圖像采集處理系統(tǒng)設(shè)計(jì)
- 摘要：介紹一種基于FPGA的網(wǎng)絡(luò)圖像采集處理系統(tǒng)設(shè)計(jì)，該系統(tǒng)采用單片F(xiàn)PGA，實(shí)現(xiàn)了圖像的采集、壓縮和網(wǎng)絡(luò)傳輸功能，具有體積小，集成度高，算法升級(jí)靈活方便的特點(diǎn)。詳述了模塊的圖像采集邏輯、RAM控制邏輯、壓縮算法
- 關(guān)鍵字： FPGA 網(wǎng)絡(luò) 圖像采集 處理系統(tǒng)
基于FPGA的存儲(chǔ)測(cè)試系統(tǒng)
- 針對(duì)某些特殊的測(cè)試試驗(yàn)要求測(cè)試系統(tǒng)高性能、微體積、低功耗，在存儲(chǔ)測(cè)試?yán)碚摶A(chǔ)上，進(jìn)行了動(dòng)態(tài)存儲(chǔ)測(cè)試系...
- 關(guān)鍵字： FPGA 存儲(chǔ)測(cè)試 采樣頻率
基于FPGA的PS/2鼠標(biāo)接口設(shè)計(jì)方法及其應(yīng)用
- 引言當(dāng)前嵌入式系統(tǒng)技術(shù)已得到了廣泛應(yīng)用，但傳統(tǒng)嵌入式系統(tǒng)的人機(jī)接口多采用小鍵盤操作的文本菜單方式...
- 關(guān)鍵字： FPGA 鼠標(biāo)接口 嵌入式系統(tǒng)
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