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            基于FPGA嵌入式系統(tǒng)的雷達信號模擬器設(shè)計

            • 摘 要: 結(jié)合FPGA嵌入式系統(tǒng)具有硬件電路高并行度和軟件編程控制簡單的特點,設(shè)計了一套基于FPGA嵌入式系統(tǒng)的雷達信號模擬器,能夠完成雷達中頻和視頻信號、雜波和干擾信號的模擬,實現(xiàn)雷達系統(tǒng)在不具備實際接收前端
            • 關(guān)鍵字: FPGA  嵌入式系統(tǒng)  雷達  信號模擬器    

            基于FPGA在彈上信息處理機中的應用

            • 引言信息處理機(圖1)用于完成導彈上多路遙測信息的采集、處理、組包發(fā)送。主要功能包括高速1553B總線的數(shù)據(jù)收發(fā) 、422接口設(shè)備的數(shù)據(jù)加載與檢測、多路數(shù)據(jù)融合和數(shù)據(jù)接收、處理、組包發(fā)送的功能。其中,總線數(shù)據(jù)和其
            • 關(guān)鍵字: FPGA  信息處理  中的應用    

            基于Spartan-3 FPGA的視頻采集系統(tǒng)設(shè)計

            • 引言視頻采集的主流實現(xiàn)方案有兩種:一是基于ASIC,該方案一般采用意法、AMD等公司的專用視頻處理芯片;二是基于DSP,主要采用TI、ADI等公司的DSP信號處理器。它們作為輔處理器,可在主CPU控制下進行視頻信號的采集壓
            • 關(guān)鍵字: Spartan  FPGA  視頻采集  系統(tǒng)設(shè)計    

            利用C和匯編語言混合編程實現(xiàn)DSP軟件設(shè)計

            • 眾所周知,匯編語言具有更高的性能優(yōu)勢,而用C語言編碼則能更容易和快速地實現(xiàn)。DSP處理器功能的不斷增強以及編譯器優(yōu)化技術(shù)的提高,使得傳統(tǒng)的用匯編語言編寫DSP應用程序的做法逐漸被淘汰?,F(xiàn)在的DSP應用程序幾乎都
            • 關(guān)鍵字: DSP  匯編語言  混合編程  軟件設(shè)計    

            基于DSP/BIOS的多信號并行處理軟件架構(gòu)設(shè)計

            • 基于DSP/BIOS的多信號并行處理軟件架構(gòu)設(shè)計,摘要 利用DSP芯片設(shè)計出能夠支持多類信號多路并行處理的軟件,可減少外圍專用算法芯片的使用,降低設(shè)計成本、縮小印制板尺寸、縮短開發(fā)周期。文中介紹了一種利用DSP/BIOS操作系統(tǒng)進行快速開發(fā)設(shè)計的軟件架構(gòu),不僅滿
            • 關(guān)鍵字: 軟件  架構(gòu)  設(shè)計  處理  并行  DSP  BIOS  信號  基于  

            NI基于FPGA的控制系統(tǒng)為智能電網(wǎng)電力電子系統(tǒng)帶來革新

            高速DSP系統(tǒng)的電路板級電磁兼容性分析與設(shè)計

            • 高速DSP系統(tǒng)的電路板級電磁兼容性分析與設(shè)計,隨著高速DSP技術(shù)的廣泛應用,相應的高速DSP的PCB設(shè)計就顯得十分重要。由于DSP是一個相當復雜、種類繁多并有許多分系統(tǒng)的數(shù)、?;旌舷到y(tǒng),所以來自外部的電磁輻射以及內(nèi)部元器件之間、分系統(tǒng)之間和各傳輸通道間的串擾
            • 關(guān)鍵字: 分析  設(shè)計  電磁兼容  電路板  DSP  系統(tǒng)  高速  

            基于FPGA的IRIG-B編碼器的設(shè)計

            • 我國靶場測量、工業(yè)控制、電力系統(tǒng)測量與保護、計算、通信、氣象等測試設(shè)備均采用國際標準IRIG-B格式的時間碼(簡稱B碼)作為時間同步標準。B碼是一種串行的時間格式,分為直流碼(DC碼)和交流碼(AC碼)兩種,其格式和碼
            • 關(guān)鍵字: IRIG-B  FPGA  編碼器    

            大容量無線傳輸技術(shù)中DSP的啟動方法

            • 大容量無線傳輸技術(shù)中DSP的啟動方法,1 引言

              在極低譜密度,高頻譜利用率的大容量

              如果DSP 的程序小于1K 字節(jié),那么上述ROM 啟動機制已經(jīng)可以完成程序的加載。然而事實上大部分DSP 的程序會大于1K 字節(jié),這時就需要創(chuàng)建一個特定啟動程序來完成更多
            • 關(guān)鍵字: 啟動  方法  DSP  技術(shù)  無線  傳輸  大容量  

            基于FPGA的可復用通信接口設(shè)計

            • 摘要:集成電路設(shè)計越來越向系統(tǒng)級的方向發(fā)展,解決模塊間的接口問題顯得尤為重要。 SPI 串行總線是一種常用的標準接口,其使用簡單方便而且占用系統(tǒng)資源少,應用相當廣泛。 本文將介紹一種新的通用的SPI 總線的FPGA
            • 關(guān)鍵字: FPGA  可復用  接口設(shè)計  通信    

            基于FPGA的數(shù)字中頻接收和恢復系統(tǒng)設(shè)計

            • 摘要 介紹一種數(shù)字中頻恢復系統(tǒng),該系統(tǒng)分為光纖接收單元、FPGA核心單元和QDUC單元。光纖接收單元采用高速串行器/解串器TLK1501,完成高速串行數(shù)據(jù)的串行轉(zhuǎn)換。FPGA核心單元對數(shù)據(jù)進行解碼、檢驗、配置TLK1501和AD9
            • 關(guān)鍵字: FPGA  數(shù)字中頻  恢復系統(tǒng)    

            IBERT在FPGA中的應用

            • 摘要 IBERT即集成式比特誤碼率測試儀,是Xilinx專門用于具有高速串行接口的FPGA芯片的調(diào)試和交互式配置工具。文中介紹了IBTERT基本功能、實現(xiàn)原理,并結(jié)合實例闡述用IBTERT調(diào)試FPGA時的具體方法和調(diào)試步驟。
              關(guān)鍵詞
            • 關(guān)鍵字: IBERT  FPGA  中的應用    

            基于FPGA的數(shù)據(jù)嵌入式圖像采集系統(tǒng)

            • 摘要 介紹了以FPGA為核心的邏輯控制模塊的數(shù)據(jù)采集系統(tǒng)的設(shè)計可以滿足實時性要求,設(shè)計中采用自頂向下的設(shè)計方法,根據(jù)不同的功能將整個系統(tǒng)劃分為若干模塊進行設(shè)計,并介紹了每個模塊的功能和實現(xiàn)方法。在設(shè)計中采用
            • 關(guān)鍵字: FPGA  數(shù)據(jù)  嵌入式  圖像采集系統(tǒng)    

            FPGA和ASIC的電源管理方案

            • 目前的電子產(chǎn)品市場競爭非常激烈,廠商都希望能在最短時間內(nèi)將新產(chǎn)品推出市場,以致子系統(tǒng)的設(shè)計周期越縮越...
            • 關(guān)鍵字: FPGA  ASIC  電源管理  

            基于FPGA的通信接口模塊設(shè)計與實現(xiàn)

            • 摘要 針對前端射頻及信號處理部分與中心機需要進行遠程通信的需要,設(shè)計了一款由FPGA實現(xiàn)的通信接口模塊。該模塊實現(xiàn)了射頻及信號處理部分與中心機的通信,包括中心機發(fā)給前端受控模塊的控制命令;前端受控模塊發(fā)送給
            • 關(guān)鍵字: 設(shè)計  實現(xiàn)  模塊  接口  FPGA  通信  基于  
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