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FPGA/CPLD常用的四種設(shè)計(jì)方法
- FPGA/CPLD常用的四種設(shè)計(jì)方法,FPGA/CPLD的設(shè)計(jì)思想與技巧是一個(gè)非常大的話題，本文僅介紹一些常用的設(shè)計(jì)思想與技巧，包括乒乓球操作、串并轉(zhuǎn)換、流水線操作和數(shù)據(jù)接口的同步方法。希望本文能引起工程師們的注意，如果能有意識(shí)地利用這些原則指導(dǎo)日
- 關(guān)鍵字： 方法 設(shè)計(jì) 常用 FPGA/CPLD
中頻軟件無(wú)線電系統(tǒng)的FPGA實(shí)現(xiàn)方案
- 一、 引言 現(xiàn)代通信技術(shù)、微電子技術(shù)和計(jì)算機(jī)技術(shù)的飛速發(fā)展，促進(jìn)了無(wú)線通信技術(shù)從數(shù)字化走向軟件化。軟件無(wú)線電的出現(xiàn)掀起了無(wú)線通信技術(shù)的又一次革命，它已經(jīng)成為目前通信領(lǐng)域中最為重要的研究方向之一
- 關(guān)鍵字： FPGA 軟件無(wú)線電 系統(tǒng) 實(shí)現(xiàn)方案
基于FPGA+DSP架構(gòu)的高速通信接口設(shè)計(jì)與實(shí)現(xiàn)
- 開(kāi)關(guān)電源已普遍運(yùn)用在當(dāng)前的各類電子設(shè)備上,其單位功率密度也在不斷地提高.高功率密度的定義從1991年的25w/...
- 關(guān)鍵字： FPGA DSP架構(gòu) 高速通信
基于FPGA的乒乓球游戲的設(shè)計(jì)與實(shí)現(xiàn)
- 0引言FPGA(FieldProgrammableGateArray)，現(xiàn)場(chǎng)可編程門陣列。它是繼PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的成果。它作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路，既解決了定制電路的不足，又克服了原有可
- 關(guān)鍵字： FPGA
Altera首次演示FPGA與100Gbps光模塊的互操作性
- Altera公司(NASDAQ:ALTR)今天宣布，使用28-nm Stratix? V GT FPGA成功演示了與100-Gbps光模塊的互操作性，從而支持實(shí)現(xiàn)下一代100-Gbps網(wǎng)絡(luò)。這是業(yè)界第一次演示FPGA與100-Gbps光模塊的互操作性，表明了Altera?致力于幫助系統(tǒng)工程師和生產(chǎn)商開(kāi)發(fā)高密度、低功耗光網(wǎng)絡(luò)。在發(fā)布今天的新聞之前，Altera還于2011年9月宣布，Gennum和Altera為下一代100Gb/s網(wǎng)絡(luò)演示了4x25Gb/s IC。這些解決方案相結(jié)合，增強(qiáng)
- 關(guān)鍵字： Altera FPGA
基于FPGA的LVDS接口應(yīng)用
- 摘要 介紹了LVDS技術(shù)的原理，對(duì)LVDS接口在高速數(shù)據(jù)傳輸系統(tǒng)中的應(yīng)用做了簡(jiǎn)要的分析，著重介紹了基于FPGA的LVDS_TX模塊的應(yīng)用，并通過(guò)其在DAC系統(tǒng)中的應(yīng)用實(shí)驗(yàn)進(jìn)一步說(shuō)明了LVDS接口的優(yōu)點(diǎn)。
關(guān)鍵詞 LVDS；FPGA；高速 - 關(guān)鍵字： FPGA LVDS 接口應(yīng)用
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