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FPGA和CPLD內部自復位電路設計方案

本文描述了復位的定義，分類及不同復位設計的影響，并討論了針對FPGA和CPLD的內部自復位方案。1、定義復位信號是一個脈沖信號，它會使設計的電路進入設
關鍵字： FPGA

CRC循環(huán)冗余校驗的原理與算法及FPGA實現(xiàn)

CRC基本原理在串行數(shù)據(jù)流的最有效的檢錯方案是CRC(Cyclic Redundancy check)循環(huán)冗余檢驗，CRC循環(huán)冗余校驗最根本的原理就是將原始數(shù)據(jù)除以某個固定的
關鍵字： CRC 循環(huán)冗余 FPGA

DSP硬件設計需要知道的注意事項知多少？

數(shù)字信號處理芯片(DSP) 具有高性能的CPU(時鐘性能超過100MHZ)和高速先進外圍設備，通過CMOS處理技術，DSP芯片的功耗越來越低。這些巨大的進步增加了D
關鍵字：硬件設計 FlaSh DSP

十年FPGA開發(fā)經驗工程師談設計技巧

從大學時代第一次接觸FPGA至今已有10多年的時間，至今記得當初第一次在EDA實驗平臺上完成數(shù)字秒表、搶答器、密碼鎖等實驗時那個興奮勁。當時由于沒有接
關鍵字：控制 FPGA

如何基于EMIF接口的DSP控制系統(tǒng)設計？

摘要：提出一種DSP 通過EMIF 接口控制復雜系統(tǒng)的方案。通過將DSP 芯片連接多片F(xiàn)PGA，并利用FPGA 與各種外部芯片連接，使得DSP 通過EMIF 接口就能控制
關鍵字： EMIF接口 FPGA DSP

適用于 FPGA、GPU 和 ASIC 系統(tǒng)的電源管理

在 FPGA、GPU 或 ASIC 控制的系統(tǒng)板上，僅有為數(shù)不多的幾種電源管理相關的設計挑戰(zhàn)，但是由于需要反復調試，所以這類挑戰(zhàn)可能使系統(tǒng)的推出時間嚴重滯后
關鍵字： FPGA GPU ASIC 電源管理

FPGA開發(fā)之IP核：軟核、硬核以及固核概念

IP(Intelligent Property)核是具有知識產權核的集成電路芯核總稱，是經過反復驗證過的、具有特定功能的宏模塊，與芯片制造工藝無關，可以移植到不同的
關鍵字： FPGA IP核固核概念

如何基于蜜罐技術的FPGA實現(xiàn)技術？

1. 項目背景蜜罐技術由來已久，蜜罐(Honeypot)是一種在互聯(lián)網(wǎng)上運行的計算機系統(tǒng)。它是專門為吸引并誘騙那些試圖非法闖入他人計算機系統(tǒng)的人(如電腦黑
關鍵字：蜜罐技術 FPGA 實現(xiàn)技術

如何基于FPGA的短波通信接收機？

短波通信又稱高頻通信，是利用HF波段(3-30MHz)電磁波進行的無線電通信。短波通信主要靠天波傳播，可經電離層一次或數(shù)次反射，最遠可傳至上萬里，如按氣
關鍵字： FPGA 短波通信接收機

十年FPGA開發(fā)經驗工程師教你的絕密設計技巧

從大學時代第一次接觸FPGA至今已有10多年的時間，至今記得當初第一次在EDA實驗平臺上完成數(shù)字秒表、搶答器、密碼鎖等實驗時那個興奮勁。當時由于沒有接
關鍵字： CPLD 電子工程師 FPGA

如何為基于FPGA的嵌入式系統(tǒng)進行安全升級？

如何防止器件ldquo;磚頭化rdquo;，只發(fā)出警告就夠了嗎?ldquo;系統(tǒng)正在更新，請勿關閉電源。rdquo;我們都看到過這個警告，它通常在電子器件要在閃存
關鍵字：嵌入式 FPGA

引起的較高時鐘頻率仿真失敗原因

通常如果你的設計在較低時鐘頻率時通過了仿真，但是在較高時鐘頻率時卻失敗了，你的第一個問題應該是你的設計在某個較高時鐘頻率時是否達到了時序約束
關鍵字： FPGA 時鐘頻率賽靈思

如何設計基于FPGA的虛擬現(xiàn)實定位系統(tǒng)？

虛擬現(xiàn)實技術是目前計算機信息科學中的前沿學科，文中設計了一種以FPGA 為核心的數(shù)據(jù)采集處理系統(tǒng).利用HMC5883L和ADXL345對虛擬場景中物體的方位和朝
關鍵字： FPGA 虛擬現(xiàn)實定位系統(tǒng)

經驗總結：電路設計的8個誤區(qū)

關于電路設計8個誤區(qū)的經驗總結
關鍵字： PCB FPGA CPU

怎么采用FPGA原型系統(tǒng)加速物聯(lián)網(wǎng)設計？

當我們談論物聯(lián)網(wǎng) (IoT) 的時候，不夸張地說，它可以將我們所使用的智能設備互相連接，彼此分享大量的數(shù)據(jù)，從而使我們的生活更高效。這不僅僅是消費者
關鍵字： FPGA 物聯(lián)網(wǎng)

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