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FPGA在語音存儲(chǔ)與回放系統(tǒng)中的應(yīng)用

　　1 引言　　隨著數(shù)字信號(hào)處理器、超大規(guī)模集成電路的高速發(fā)展，語音記錄技術(shù)已從模擬錄音階段過渡到數(shù)字錄音階段。在數(shù)字化錄音技術(shù)中，壓縮后的語音數(shù)據(jù)有些存儲(chǔ)在硬盤中，有些存儲(chǔ)在帶有掉電保護(hù)功能的RAM或FLASH存儲(chǔ)器中。筆者介紹的語音存儲(chǔ)與回放系統(tǒng)，未使用專用的語音處理芯片，不需要擴(kuò)展接口電路，只利用FPGA作為核心控制器，就能完成語音信號(hào)的數(shù)字化處理，即實(shí)現(xiàn)語音的存儲(chǔ)與回放。　　2 系統(tǒng)總體結(jié)構(gòu) 　　數(shù)字化語音存儲(chǔ)與回放系統(tǒng)的基本工作原理是將模擬語音信號(hào)通過模數(shù)轉(zhuǎn)換器(A/D)轉(zhuǎn)換成數(shù)字信號(hào)
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基于DVD-ROM應(yīng)用的內(nèi)容加擾系統(tǒng)的VLSI設(shè)計(jì)

　　摘　要：本文介紹了一種基于DVD-ROM應(yīng)用的內(nèi)容干擾系統(tǒng)(CSS)的設(shè)計(jì)和實(shí)現(xiàn)。該系統(tǒng)可有效防止對(duì)DVD盤片的非法拷貝。文中通過對(duì)其工作原理和實(shí)際應(yīng)用的分析，給出其最終實(shí)現(xiàn)方案，并用Verilog HDL完整整個(gè)系統(tǒng)的設(shè)計(jì)。功能仿真和FPGA驗(yàn)證表明，設(shè)計(jì)成功。　　關(guān)鍵詞：內(nèi)容加擾系統(tǒng);DVD;Verilog HDL;FPGA驗(yàn)證　　引言　　DVD-ROM的視頻和音頻數(shù)據(jù)是經(jīng)過加密編碼的，加擾的源是標(biāo)題密鑰(Tittle Key)，同時(shí)標(biāo)題密鑰被光盤密鑰(光盤密鑰)加密，主機(jī)在播放影碟
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定點(diǎn)DSP C55X實(shí)現(xiàn)浮點(diǎn)相關(guān)運(yùn)算

　　引言　　DSP結(jié)構(gòu)可以分為定點(diǎn)和浮點(diǎn)型兩種。其中，定點(diǎn)型DSP可以實(shí)現(xiàn)整數(shù)、小數(shù)和特定的指數(shù)運(yùn)算，它具有運(yùn)算速度快、占用資源少、成本低等特點(diǎn);靈活地使用定點(diǎn)型DSP進(jìn)行浮點(diǎn)運(yùn)算能夠提高運(yùn)算的效率。目前對(duì)定點(diǎn)DSP結(jié)構(gòu)支持下的浮點(diǎn)需求也在不斷增長(zhǎng)，主要原因是：實(shí)現(xiàn)算法的代碼往往是采用C/C++編寫，如果其中有標(biāo)準(zhǔn)型的浮點(diǎn)數(shù)據(jù)處理，又必須采用定點(diǎn)DSP器件，那么就需要將浮點(diǎn)算法轉(zhuǎn)換成定點(diǎn)格式進(jìn)行運(yùn)算。同時(shí)，定點(diǎn)DSP結(jié)構(gòu)下的浮點(diǎn)運(yùn)算有很強(qiáng)的可行性，因?yàn)镃語言和匯編語言分別具有可移植性強(qiáng)和運(yùn)算效率高的
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使用FPGA測(cè)試的一些有效方法

引言　　隨著芯片設(shè)計(jì)技術(shù)越來越成熟，越來越多的產(chǎn)品選擇使用SoC（System on Chip）的技術(shù)實(shí)現(xiàn)。然而，每一次流片不一定都能達(dá)到預(yù)期的效果。根據(jù)Synopsys公司統(tǒng)計(jì)，有超過60％的公司需要重新流片（respin）。在這個(gè)過程中浪費(fèi)了大量的金錢，一次修正平均的花費(fèi)就超過100萬美元。如果一旦錯(cuò)過了商品推出的最佳時(shí)機(jī)，那么錯(cuò)過市場(chǎng)機(jī)會(huì)的代價(jià)則以數(shù)千萬美元計(jì)，甚至更高。據(jù)統(tǒng)計(jì)，在需要respin的芯片中有43％是在前端的設(shè)計(jì)和實(shí)現(xiàn)的時(shí)候產(chǎn)生的邏輯功能錯(cuò)誤。如何避免或減小如此高的風(fēng)險(xiǎn)是每一
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基于FPGA系統(tǒng)易測(cè)試性的研究

引言現(xiàn)代科技對(duì)系統(tǒng)的可靠性提出了更高的要求，而FPGA技術(shù)在電子系統(tǒng)中應(yīng)用已經(jīng)非常廣泛，因此FPGA易測(cè)試性就變得很重要。要獲得的FPGA內(nèi)部信號(hào)十分有限、FPGA封裝和印刷電路板(PCB)電氣噪聲，這一切使得設(shè)計(jì)調(diào)試和檢驗(yàn)變成設(shè)計(jì)中最困難的一個(gè)流程。另一方面，當(dāng)前幾乎所有的像CPU、DSP、ASIC等高速芯片的總線，除了提供高速并行總線接口外，正迅速向高速串行接口的方向發(fā)展，F(xiàn)PGA也不例外。每一條物理鏈路的速度從600 Mbps到10 Gbps，高速I／O的測(cè)試和驗(yàn)證更成為傳統(tǒng)專注于FPG
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基于FPGA的USB2.0虛擬邏輯分析儀的設(shè)計(jì)與實(shí)現(xiàn)

引言　　傳統(tǒng)的邏輯分析儀體積龐大、價(jià)格昂貴、通道數(shù)目有限，并且在數(shù)據(jù)采集、傳輸、存儲(chǔ)、顯示等方面存在諸多限制，在很大程度上影響了其在實(shí)際中的應(yīng)用。選用高性能的FPGA芯片進(jìn)行數(shù)據(jù)處理，充分利用PC的強(qiáng)大處理功能，配合LabView圖形化語言開發(fā)的虛擬邏輯分析儀，其數(shù)據(jù)處理和傳輸速率大大提高，適用性極大增強(qiáng)，其顯示、操作界面和低廉的成本較之傳統(tǒng)的邏輯分析儀具有極大的優(yōu)勢(shì)和發(fā)展前景。　　工作原理　　本設(shè)計(jì)選用Altera公司的Cyclone系列FPGA器件EP1C3進(jìn)行數(shù)據(jù)采集和處理，外接SRAM
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采用FPGA實(shí)現(xiàn)廣播視頻基礎(chǔ)系統(tǒng)設(shè)計(jì)

HDTV視頻內(nèi)容創(chuàng)作的繁榮以及在帶寬受限的廣播信道環(huán)境中傳送這些視頻內(nèi)容的方法，不斷催生新的視頻壓縮標(biāo)準(zhǔn)和相關(guān)視頻圖像處理設(shè)備。
關(guān)鍵字：基礎(chǔ) 系統(tǒng) 設(shè)計(jì) 視頻廣播 FPGA 實(shí)現(xiàn) 采用

TMS320C6000系列DSP的軟件優(yōu)化技術(shù)

　　1 DSP系統(tǒng)的軟件優(yōu)化流程　　DSP系統(tǒng)的軟件優(yōu)化流程如圖l所示。整個(gè)工作流程分為3個(gè)階段：　　第l階段，直接根據(jù)需要用高級(jí)C語言實(shí)現(xiàn)DSP功能，測(cè)試代碼的正確性。然后，移植到C6X平臺(tái)，利用C6X開發(fā)環(huán)境Profile測(cè)試程序的運(yùn)行時(shí)間。若不滿足要求，則進(jìn)入下一階段。　　第2階段，利用C6X提供的優(yōu)化方式和其他各種優(yōu)化技巧，如使用不同的編譯器選項(xiàng)使能軟件流水，循環(huán)展開，字存取代替半字存取等，優(yōu)化C語言代碼。如果還不能滿足要求，則進(jìn)入第3階段。　　第3階段，將C語言代碼中耗時(shí)最長(zhǎng)的部
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基于FPGA的步進(jìn)電機(jī)控制器設(shè)計(jì)

　　步進(jìn)電機(jī)是一種將電脈沖信號(hào)轉(zhuǎn)換成相應(yīng)的角位移的特殊電機(jī)，每改變一次通電狀態(tài)，步進(jìn)電機(jī)的轉(zhuǎn)子就轉(zhuǎn)動(dòng)一步。目前大多數(shù)步進(jìn)電機(jī)控制器需要主控制器發(fā)送時(shí)鐘信號(hào)，并且要至少一個(gè)I/O口來輔助控制和監(jiān)控步進(jìn)電機(jī)的運(yùn)行情況。在單片機(jī)或DSP的應(yīng)用系統(tǒng)中，經(jīng)常配合CPLD或者FPGA來實(shí)現(xiàn)特定的功能。本文介紹通過FPGA實(shí)現(xiàn)的步進(jìn)電機(jī)控制器。該控制器可以作為單片機(jī)或DSP的一個(gè)直接數(shù)字控制的外設(shè)，只需向控制器的控制寄存器和分頻寄存器寫入數(shù)據(jù)，即町實(shí)現(xiàn)對(duì)步進(jìn)電機(jī)的控制。　　1 步進(jìn)電機(jī)的控制原理　　步進(jìn)電機(jī)是數(shù)
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一種CAN息線光纖傳輸接口設(shè)計(jì)

　　摘要在分析CAN總線雙絞線和光纖傳輸特點(diǎn)的基礎(chǔ)上，提出一種基于光纖收發(fā)一體模塊及CAN總線控制器SJAl000的光纖傳輸接口設(shè)計(jì)方案;詳細(xì)介紹光纖收發(fā)器的選取及傳輸接口的實(shí)現(xiàn);根據(jù)光纖收發(fā)一體模塊對(duì)信號(hào)源時(shí)鐘提取的要求以及CAN總線的非破壞性總線仲裁的特點(diǎn)，設(shè)計(jì)了一種CAN總線信號(hào)編解碼方法，井用FPGA加以實(shí)現(xiàn);通過實(shí)際的通信實(shí)驗(yàn)驗(yàn)證了設(shè)計(jì)方案的正確性，并根據(jù)實(shí)驗(yàn)數(shù)據(jù)對(duì)CAN總線在兩種介質(zhì)下的傳輸性能作了比較。　　關(guān)鍵詞 CAN總線光纖傳輸接口 FPGA 　　引言　　作為一種成熟的
關(guān)鍵字： CAN總線光纖傳輸接口 FPGA

FPGA如何同DDR3存儲(chǔ)器進(jìn)行接口?

　　大家好，我叫Paul Evans，是Stratix III產(chǎn)品營(yíng)銷經(jīng)理。到目前為止，我已經(jīng)從事了6年的雙倍數(shù)據(jù)速率存儲(chǔ)器工作，今天和大家一起討論一下DDR3。DDR3的主要難題之一是它引入了數(shù)據(jù)交錯(cuò)，如屏幕上所示。　　為了更好地進(jìn)行演示，我們將使用這里所示的Stratix III DDR3存儲(chǔ)器電路板。它上面有幾個(gè)高速雙倍數(shù)據(jù)速率存儲(chǔ)器，例如DDR2 UDIMM插槽、RLD RAM、QDR，當(dāng)然，還有DDR3 UDIMM插槽。因此，我們所要做的就是通過Quartus軟件來下載一個(gè)簡(jiǎn)單設(shè)計(jì)，F(xiàn)PGA
關(guān)鍵字： FPGA DDR3 存儲(chǔ)器

多路交流異步采樣及DSP軟件校準(zhǔn)技術(shù)

　　摘要：本文介紹了一種在DSP平臺(tái)下對(duì)多路交流信號(hào)采樣時(shí)采用的一種異步采樣方法。　　關(guān)鍵詞：交流采樣;校準(zhǔn);DSP 　　引言　　在對(duì)電力線路的電壓和電流進(jìn)行測(cè)量時(shí)，為使測(cè)量值具有較高的精度，一般都采用交流采樣技術(shù)。目前，比較常用的交流采樣方法是：在交流信號(hào)的一個(gè)周期內(nèi)，等間隔采樣N點(diǎn)數(shù)據(jù)，然后利用傅立葉變換，計(jì)算出基波及一些諧波的有效值，為衡量供電質(zhì)量通常還要求計(jì)算出各信號(hào)的相位。但由于同一測(cè)量裝置要同時(shí)對(duì)很多路電壓和電流量進(jìn)行采樣，而采樣所用的A/D的輸入又有限，不可能對(duì)電壓和電流量同時(shí)
關(guān)鍵字：交流采樣校準(zhǔn) DSP 200803

基于以太網(wǎng)的嵌入式視覺傳感器*

　　隨著計(jì)算機(jī)科學(xué)和自動(dòng)控制技術(shù)的發(fā)展，視覺系統(tǒng)被廣泛用于工業(yè)檢測(cè)、生物醫(yī)學(xué)、軍事偵察等領(lǐng)域。嵌入式視覺系統(tǒng)，是將圖像的采集、處理與通信功能集成于單一相機(jī)內(nèi)，從而提供了具有多功能、模塊化、高可靠性、易于實(shí)現(xiàn)的機(jī)器視覺解決方案。同時(shí)，視覺傳感器需要通過網(wǎng)絡(luò)化設(shè)計(jì)完成控制信息、圖
關(guān)鍵字： CMOS圖像傳感器 DSP 以太網(wǎng) 圖像采集 200803

針對(duì)低成本視頻和DSP 系統(tǒng)開發(fā) Xilinx再推兩款XtremeDSP 開發(fā)平臺(tái)

XtremeDSP DSP入門套件 XtremeDSP視頻入門套件 3月12日，北京－全球可編程邏輯解決方案領(lǐng)導(dǎo)廠商賽靈思公司（ Xilinx, Inc. (NASDAQ: XLNX) ）今天宣布推出兩款XtremeDSP開發(fā)平臺(tái)：XtremeDSP視頻入門套件以及XtremeDSP DSP入門套件，分別用于低成本視頻開發(fā)和基于Spartan-3A DSP FPGA的DSP系統(tǒng)開發(fā)。這兩個(gè)開發(fā)平臺(tái)都基于Spartan?-3A DSP FPGA。 XtremeDSP視頻入門套件是為需要低
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定點(diǎn)DSP C55X實(shí)現(xiàn)浮點(diǎn)相關(guān)運(yùn)算

　　引言　　DSP結(jié)構(gòu)可以分為定點(diǎn)和浮點(diǎn)型兩種。其中，定點(diǎn)型DSP可以實(shí)現(xiàn)整數(shù)、小數(shù)和特定的指數(shù)運(yùn)算，它具有運(yùn)算速度快、占用資源少、成本低等特點(diǎn);靈活地使用定點(diǎn)型DSP進(jìn)行浮點(diǎn)運(yùn)算能夠提高運(yùn)算的效率。目前對(duì)定點(diǎn)DSP結(jié)構(gòu)支持下的浮點(diǎn)需求也在不斷增長(zhǎng)，主要原因是：實(shí)現(xiàn)算法的代碼往往是采用C/C++編寫，如果其中有標(biāo)準(zhǔn)型的浮點(diǎn)數(shù)據(jù)處理，又必須采用定點(diǎn)DSP器件，那么就需要將浮點(diǎn)算法轉(zhuǎn)換成定點(diǎn)格式進(jìn)行運(yùn)算。同時(shí)，定點(diǎn)DSP結(jié)構(gòu)下的浮點(diǎn)運(yùn)算有很強(qiáng)的可行性，因?yàn)镃語言和匯編語言分別具有可移植性強(qiáng)和運(yùn)算效率高的
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