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基于DSP的LED大屏幕顯示系統(tǒng)
- 基于DSP的LED大屏幕顯示系統(tǒng),目前采用的LED大屏幕顯示系統(tǒng)的控制電路，大多由單個(gè)或多個(gè)CPU及復(fù)雜的外圍電路組成，這種電路設(shè)計(jì)，單片機(jī)編程比較復(fù)雜，整個(gè)電路的調(diào)試比較麻煩，可靠性和實(shí)時(shí)性很難得到保證。針對這種情況，提出一種SD卡存儲顯示
- 關(guān)鍵字： 顯示系統(tǒng) 大屏幕 LED DSP 基于
基于FPGA的SoC和嵌入式系統(tǒng)的遠(yuǎn)程監(jiān)控系統(tǒng)
- 本系統(tǒng)立足于利用Intemet實(shí)現(xiàn)核環(huán)境信息的遠(yuǎn)程采集。在實(shí)現(xiàn)上，采用了基于SOPC技術(shù)的嵌入式解決方案，通過...
- 關(guān)鍵字： 遠(yuǎn)程監(jiān)控 SoC 嵌入式 FPGA
基于DSP的寬帶信息終端設(shè)計(jì)與實(shí)現(xiàn)
- 基于DSP的寬帶信息終端設(shè)計(jì)與實(shí)現(xiàn), 摘要：本文研究并實(shí)現(xiàn)了一種基于DSP的寬帶信息終端，該系統(tǒng)采用ADI公司Blackfin系列ADSP-BF561處理器作為系統(tǒng)核心。文章介紹了系統(tǒng)設(shè)計(jì)和軟件設(shè)計(jì)，并給出了經(jīng)市場驗(yàn)證的實(shí)踐結(jié)論?！ ? 引言 隨著家電、通信、
- 關(guān)鍵字： DSP
FPGA/EPLD的自上而下設(shè)計(jì)方法
- FPGA/EPLD的自上而下設(shè)計(jì)方法,FPGA/EPLD的自上而下(Top-Down)設(shè)計(jì)方法： 傳統(tǒng)的設(shè)計(jì)手段是采用原理圖輸入的方式進(jìn)行的，如圖1所示。通過調(diào)用FPGA/EPLD廠商所提供的相應(yīng)物理元件庫，在電路原理圖中繪制所設(shè)計(jì)的系統(tǒng)，然后通過網(wǎng)表轉(zhuǎn)換產(chǎn)生某一特
- 關(guān)鍵字： 方法 設(shè)計(jì) 自上而下 FPGA/EPLD
基于FPGA與SRAM的大容量數(shù)據(jù)存儲的設(shè)計(jì)
- 基于FPGA與SRAM的大容量數(shù)據(jù)存儲的設(shè)計(jì), 1 前言 針對FPGA中內(nèi)部BlockRAM有限的缺點(diǎn)，提出了將FPGA與外部SRAM相結(jié)合來改進(jìn)設(shè)計(jì)的方法，并給出了部分VHDL程序?！ ? 硬件設(shè)計(jì) 這里將主要討論以Xilinx公司的FPGA(XC2S600E-6fg456)和ISSI公司的SRAM(IS61
- 關(guān)鍵字： 存儲 設(shè)計(jì) 數(shù)據(jù) 大容量 FPGA SRAM 基于
DSP與LabWindows／CVI的電力故障監(jiān)測錄波器設(shè)計(jì)
- 摘要：針對現(xiàn)有電網(wǎng)實(shí)時(shí)監(jiān)測錄波系統(tǒng)的缺陷，設(shè)計(jì)出一種結(jié)合DSP與Labwindows／CVI軟件的故障錄波器。分析了FFT精確快速分析諧波的能力及其在DSP上的實(shí)現(xiàn)方法。介紹了硬件結(jié)構(gòu)原理，給出硬件設(shè)計(jì)框圖和LabWindows／CV
- 關(guān)鍵字： LabWindows DSP CVI 電力故障
Altera展示25-Gbps收發(fā)器，樹立滿足業(yè)界帶寬需求關(guān)鍵里程碑
- Altera公司(NASDAQ: ALTR)今天宣布，公司率先在可編程邏輯中成功演示25-Gbps收發(fā)器性能，在收發(fā)器技術(shù)上樹立了關(guān)鍵里程碑。Altera在28-nm收發(fā)器測試芯片上實(shí)現(xiàn)了這一具有里程碑意義的技術(shù)，該芯片是Altera用于在28-nm FPGA上成功實(shí)現(xiàn)28-Gbps收發(fā)器的原型開發(fā)平臺。實(shí)現(xiàn)25-Gbps里程碑，使目前已有FPGA解決方案的性能提高兩倍多，并在功能上優(yōu)于競爭ASSP產(chǎn)品。您可以在Altera網(wǎng)站上觀看28-nm收發(fā)器測試芯片的視頻演示。 Altera 28-nm
- 關(guān)鍵字： Altera 收發(fā)器 FPGA
出租車計(jì)費(fèi)器的EOA設(shè)計(jì)與實(shí)現(xiàn)
- 摘要：以現(xiàn)場可編程邏輯器件(FPGA)為設(shè)計(jì)載體，以硬件描述語言(VHDL)為主要表達(dá)方式，以QuartusⅡ開發(fā)軟件和GW48EDA開發(fā)系統(tǒng)為設(shè)計(jì)工具，給出了一種出租車計(jì)費(fèi)器的工作原理和軟硬件實(shí)現(xiàn)方法。同時(shí)對該出租車計(jì)費(fèi)器進(jìn)
- 關(guān)鍵字： FPGA
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