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中興通訊IP傳輸網(wǎng)絡(luò)平臺采用Virtex-6 FPGA
- 全球可編程平臺領(lǐng)導(dǎo)廠商賽靈思公司 (Xilinx, Inc. )11月14日宣布，全球電信設(shè)備和網(wǎng)絡(luò)解決方案上市提供商—中興通訊，在其基于分組的多業(yè)務(wù)承載平臺中，采用賽靈思的高性能 Virtex-6 FPGA，實(shí)現(xiàn)了 100G 以太網(wǎng)業(yè)務(wù)的部署。
- 關(guān)鍵字： 賽靈思 以太網(wǎng) Virtex-6 FPGA
基于DSP控制的數(shù)字移相器 變壓變頻器模塊的設(shè)計
- 移相器簡介兩個同頻信號，特別是工頻信號之間的移相，在電力行業(yè)的繼電保護(hù)領(lǐng)域中是一個模擬、分析事故的重...
- 關(guān)鍵字： DSP 數(shù)字移相器 變壓變頻器
APCI控機(jī)的變壓器保護(hù)裝置
- 1裝置的配置及硬件特點(diǎn)葛洲壩大江電廠主接線如圖I所示。變壓器主保護(hù)的硬件平臺采用的是北京康拓...
- 關(guān)鍵字： APCI控機(jī) DSP 變壓器
新型數(shù)據(jù)格式轉(zhuǎn)換的FPGA實(shí)現(xiàn)
- 新型數(shù)據(jù)格式轉(zhuǎn)換的FPGA實(shí)現(xiàn),引言 浮點(diǎn)運(yùn)算作為數(shù)字信號處理中最常見的運(yùn)算之一，各大EDA軟件都帶有免費(fèi)的浮點(diǎn)運(yùn)算IP核。通過對IP核的生成和例化來實(shí)現(xiàn)浮點(diǎn)運(yùn)算，把FPGA設(shè)計者從繁重的代碼編寫中解脫了出來，同時可以對IP核進(jìn)行功能剪裁以避免
- 關(guān)鍵字： FPGA 實(shí)現(xiàn) 轉(zhuǎn)換 格式 數(shù)據(jù) 新型
Xilinx助力有線電視運(yùn)營商打造面向未來的前端系統(tǒng)
- 全球可編程平臺領(lǐng)導(dǎo)廠商賽靈思公司 (Xilinx, Inc. )在 2011 年 SCTE 有線電視技術(shù)博覽會 (SCTE Cable-Tec Expo 2011)上演示了有線電視行業(yè)第一個用單個 RF 端口支持多達(dá) 160 個正交幅度調(diào)制 (QAM )信道的方案，該方案是在基于賽靈思 28nm 7 系列 FPGA上實(shí)現(xiàn)的。該技術(shù)對多系統(tǒng)運(yùn)營商 (MSO) 通過現(xiàn)有有線電視前端系統(tǒng)提供更豐富的三重播放業(yè)務(wù)至關(guān)重要，同時也展示了基于 FPGA 的前端設(shè)備可以提供關(guān)鍵的器件和信號密度，滿足競爭激烈的數(shù)據(jù)和內(nèi)容
- 關(guān)鍵字： Xilinx FPGA RF
Altera發(fā)布業(yè)界第一個面向FPGA的OpenCL計劃
- Altera公司(NASDAQ: ALTR)今天發(fā)布FPGA和SoC FPGA的開放計算語言(OpenCL?)標(biāo)準(zhǔn)開發(fā)計劃。OpenCL標(biāo)準(zhǔn)是基于C語言的開放標(biāo)準(zhǔn)，適用于并行編程。Altera的OpenCL計劃結(jié)合了FPGA的并行能力以及OpenCL標(biāo)準(zhǔn)，實(shí)現(xiàn)強(qiáng)大的系統(tǒng)加速功能。與使用Verilog或者VHDL等底層硬件描述語言(HDL)的傳統(tǒng)FPGA開發(fā)方法相比，這一混合系統(tǒng)(CPU + FPGA，使用OpenCL標(biāo)準(zhǔn))還具有明顯的產(chǎn)品及時面市優(yōu)勢。通過其OpenCL計劃，Altera與
- 關(guān)鍵字： Altera FPGA
基于51單片機(jī)和FPGA 的人機(jī)交互系統(tǒng)的設(shè)計
- 摘要： 在儀器儀表電路中，人機(jī)交互界面是必不可少的環(huán)節(jié)。為了解決單純采用單片機(jī)制作的系統(tǒng)功耗高、速度慢、 ...
- 關(guān)鍵字： 51單片機(jī) FPGA 人機(jī)交互系統(tǒng)
Altera發(fā)布業(yè)界第一個面向FPGA的OpenCL計劃
- Altera公司今天發(fā)布FPGA和SoC FPGA的開放計算語言(OpenCL?)標(biāo)準(zhǔn)開發(fā)計劃。OpenCL標(biāo)準(zhǔn)是基于C語言的開放標(biāo)準(zhǔn)，適用于并行編程。Altera的OpenCL計劃結(jié)合了FPGA的并行能力以及OpenCL標(biāo)準(zhǔn)，實(shí)現(xiàn)強(qiáng)大的系統(tǒng)加速功能。與使用Verilog或者VHDL等底層硬件描述語言(HDL)的傳統(tǒng)FPGA開發(fā)方法相比，這一混合系統(tǒng)(CPU + FPGA，使用OpenCL標(biāo)準(zhǔn))還具有明顯的產(chǎn)品及時面市優(yōu)勢。
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