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CEVA發(fā)布針對6Gbps固態(tài)硬盤應(yīng)用的SATA3.0 IP
- 全球領(lǐng)先的硅產(chǎn)品知識產(chǎn)權(quán) (SIP) 平臺解決方案和數(shù)字信號處理器(DSP)內(nèi)核授權(quán)廠商CEVA公司宣布提供CEVA-SATA3.0設(shè)備控制器IP。基于與固態(tài)硬盤 (SSD) 客戶廣泛的合作經(jīng)驗,CEVA公司已經(jīng)提升其SATA設(shè)備控制器IP性能,提供 6Gbps 線路速率 (line rate) 以實現(xiàn)更快的數(shù)據(jù)傳輸,使得吞吐量較上代產(chǎn)品提高一倍。該IP已經(jīng)授權(quán)予一家領(lǐng)先的閃存半導體制造商,用于其未來的固態(tài)硬盤設(shè)計中。 CEVA-SATA3.0 IP 采用最新的原生指令排序 (Native Co
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DSP內(nèi)嵌PLL中的CMOS壓控環(huán)形振蕩器設(shè)計
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- DSP內(nèi)嵌PLL中的CMOS壓控環(huán)形振蕩器設(shè)計,本文設(shè)計了一種應(yīng)用于DSP內(nèi)嵌鎖相環(huán)的低功耗、高線性CM0S壓控環(huán)形振蕩器。電路采用四級延遲單元能方便的獲得正交輸出時鐘,每級采用RS觸發(fā)結(jié)構(gòu)來產(chǎn)生差分輸出信號,在有效降低靜態(tài)功耗的同時.具有較好的抗噪聲能力。在延遲單元的設(shè)計時。綜合考慮了電壓控制的頻率范圍以及調(diào)節(jié)線性度,選擇了合適的翻轉(zhuǎn)點。 仿真結(jié)果表明.電路叮實現(xiàn)2MHz至90MHz的頻率調(diào)節(jié)范圍,在中心頻率附近具有很高的調(diào)節(jié)線性度,可完全滿足DSP芯片時鐘系統(tǒng)的要求。
- 關(guān)鍵字: 振蕩器 設(shè)計 環(huán)形 CMOS 內(nèi)嵌 PLL DSP
TMS320C6713B DSP的外部FLASH引導
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dsp 介紹
DSP數(shù)字信號處理(Digital Signal Processing,簡稱DSP)是一門涉及許多學科而又廣泛應(yīng)用于許多領(lǐng)域的新興學科。20世紀60年代以來,隨著計算機和信息技術(shù)的飛速發(fā)展,數(shù)字信號處理技術(shù)應(yīng)運而生并得到迅速的發(fā)展。數(shù)字信號處理是一種通過使用數(shù)學技巧執(zhí)行轉(zhuǎn)換或提取信息,來處理現(xiàn)實信號的方法,這些信號由數(shù)字序列表示。在過去的二十多年時間里,數(shù)字信號處理已經(jīng)在通信等領(lǐng)域得到極為廣泛 [ 查看詳細 ]
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