dds-11a型實(shí)驗(yàn)室電導(dǎo)率 文章 進(jìn)入dds-11a型實(shí)驗(yàn)室電導(dǎo)率技術(shù)社區(qū)
一種新的實(shí)現(xiàn)DDS的AVR信號(hào)發(fā)生器
- 這是一個(gè)AVR DDS信號(hào)發(fā)生器V2.0新的實(shí)施，已經(jīng)在scienceprog.com出版。 很明顯，對于原原理圖和固件完全歸功于 ...
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基于DDS的寬帶頻率合成器的設(shè)計(jì)方案
- 摘要：提出了基于DDS的寬帶頻率合成器的設(shè)計(jì)方案，給出了主要的硬件選擇，對頻率合成器的原理進(jìn)行了詳細(xì)的闡述，并且對該頻率合成器的雜波抑制和相位噪聲進(jìn)行了分析，最后對樣機(jī)的性能進(jìn)行了測試，結(jié)果表明該寬帶
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一種DDS的優(yōu)化設(shè)計(jì)
- 在高可靠應(yīng)用領(lǐng)域，如果設(shè)計(jì)得當(dāng)，將不會(huì)存在類似于MCU的復(fù)位不可靠和PC可能跑飛等問題。CPLD/FPGA的高可靠性還表現(xiàn)在，幾乎可將整個(gè)系統(tǒng)下載于同一芯片中，實(shí)現(xiàn)所謂片上系統(tǒng)，從而大大縮小了體積，易于管理和屏蔽。
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基于FPGA的DDS+DPLL跳頻信號(hào)源設(shè)計(jì)
- 摘要：針對跳頻通信系統(tǒng)有固有噪聲的特點(diǎn)，結(jié)合DDS+DPLL高分辨率、高頻率捷變速度的優(yōu)點(diǎn)，并采用Altera公司的Quartus-Ⅱ_10．1軟件進(jìn)行設(shè)計(jì)綜合，提出了一種新型的跳頻信號(hào)源。結(jié)果表明，該設(shè)計(jì)中DPLL時(shí)鐘可達(dá)到12
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ISA總線實(shí)現(xiàn)多路同步DDS信號(hào)源設(shè)計(jì)
- ISA總線實(shí)現(xiàn)多路同步DDS信號(hào)源設(shè)計(jì), 直接數(shù)字式頻率合成器以其極高的頻率分辨率、極短的頻率轉(zhuǎn)換時(shí)間、相位精確可調(diào)、設(shè)備結(jié)構(gòu)簡單、易集成、體積小及成本低等優(yōu)點(diǎn)，在高分辨雷達(dá)系統(tǒng)、寬帶擴(kuò)頻通信系統(tǒng)以及現(xiàn)代測控系統(tǒng)中得到廣泛的應(yīng)用。為了便于信息
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基于DDS的勵(lì)磁恒流源設(shè)計(jì)
- 摘要 針對某型磁性材料性能測試儀激勵(lì)恒流源的具體要求，采用了基于直接數(shù)字頻率合成技術(shù)的信號(hào)發(fā)生器設(shè)計(jì)方法，重點(diǎn)研究了由FPGA設(shè)計(jì)DDS信號(hào)發(fā)生器的系統(tǒng)設(shè)計(jì)原理、硬件構(gòu)成，以及在Quartus開發(fā)環(huán)境下。采用硬件描述
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一種新的實(shí)現(xiàn)DDS的AVR信號(hào)發(fā)生器(原理圖和PCB圖)
- 一種新的實(shí)現(xiàn)DDS的AVR信號(hào)發(fā)生器(原理圖和PCB圖),這是一個(gè)AVR DDS信號(hào)發(fā)生器V2.0新的實(shí)施，已經(jīng)在scienceprog.com出版。 很明顯，對于原原理圖和固件完全歸功于它的原創(chuàng)者。這里呈現(xiàn)的是一個(gè)不同的PCB，結(jié)構(gòu)緊湊，單只通孔，便于建筑構(gòu)件片面的。函數(shù)發(fā)生器有兩個(gè)BN
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基于DDS的程控信號(hào)發(fā)生器設(shè)計(jì)
- 摘要：采用了直接數(shù)字頻率合成技術(shù)(DDS)和計(jì)算機(jī)控制技術(shù)，選擇美國Analog Devices公司的高度集成DDS芯片AD9851和AT89S52單片機(jī)作為控制器件，設(shè)計(jì)了一種基于DDS的程控信號(hào)發(fā)生器。用C語言進(jìn)行了軟件應(yīng)用設(shè)計(jì)。實(shí)驗(yàn)結(jié)
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dds-11a型實(shí)驗(yàn)室電導(dǎo)率介紹
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