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chiplet phy designer
chiplet phy designer 文章 進(jìn)入chiplet phy designer技術(shù)社區(qū)
工業(yè)以太網(wǎng)演進(jìn)的PHY解決方案
- 現(xiàn)代工業(yè)環(huán)境充斥著復(fù)雜的自動(dòng)化和制造技術(shù),網(wǎng)絡(luò)連接是使其基本運(yùn)行的關(guān)鍵所在。工業(yè)網(wǎng)絡(luò)通常包括可編程邏輯控制器(PLC)、電機(jī)控制和驅(qū)動(dòng),以及傳感器網(wǎng)絡(luò)和人機(jī)接口(HMI)。以太網(wǎng)技術(shù)將工業(yè)網(wǎng)絡(luò)中的所有這些節(jié)點(diǎn)連接起來(lái),在網(wǎng)絡(luò)上傳遞精確控制和同步時(shí)鐘等信息。高速裝配線機(jī)器人是工廠應(yīng)用以太網(wǎng)的一個(gè)例子,通過(guò)實(shí)時(shí)協(xié)調(diào)節(jié)點(diǎn)移動(dòng),以確保成品被完好無(wú)損的進(jìn)行包裝。
- 關(guān)鍵字: 工業(yè)以太網(wǎng) PHY
泰克為MIPI D-PHY v2.0推出業(yè)內(nèi)第一個(gè)完善的接收機(jī)測(cè)試解決方案
- 全球領(lǐng)先的測(cè)量解決方案提供商–泰克科技公司日前推出業(yè)內(nèi)第一個(gè)接收機(jī)測(cè)試解決方案,100%覆蓋MIPI聯(lián)盟最近發(fā)布的D-PHY v.2.0規(guī)范,并全面支持C-PHY v1.1接收機(jī)測(cè)試規(guī)范。 對(duì)開(kāi)發(fā)自動(dòng)駕駛系統(tǒng)或車(chē)載信息娛樂(lè)系統(tǒng)的MIPI設(shè)計(jì)人員,泰克現(xiàn)在提供了簡(jiǎn)化的物理層接收機(jī)測(cè)試設(shè)置功能及更快的測(cè)試執(zhí)行能力,同時(shí)提供了行業(yè)領(lǐng)先的信號(hào)保真度,并靈活支持深入調(diào)試和余量測(cè)試。這一解決方案擴(kuò)大了泰克全面的MIPI物理層發(fā)射機(jī)和接收機(jī)及協(xié)議測(cè)試方案組合,包括行業(yè)領(lǐng)先的實(shí)時(shí)示波器、任意波形發(fā)生
- 關(guān)鍵字: 泰克 D-PHY
Cyclone V FPGA在高帶寬存儲(chǔ)接口中的應(yīng)用
- 摘要:文中詳細(xì)地分析了Altera公司Cyclone V FPGA器件的硬核存儲(chǔ)控制器底層架構(gòu)和外部接口,并在此基礎(chǔ)上對(duì)Controller和PHY進(jìn)行了功能仿真。仿真結(jié)果表明硬核存儲(chǔ)控制器和PHY配合工作時(shí)的功能與設(shè)計(jì)預(yù)期相符,性能優(yōu)
- 關(guān)鍵字: FPCA 硬核存儲(chǔ)控制器 HMC PHY
面向低時(shí)延工業(yè)以太網(wǎng)的Marvell PHY 產(chǎn)品
- 以太網(wǎng)在企業(yè)級(jí)市場(chǎng)中得到了廣泛應(yīng)用—我們對(duì)于它在辦公環(huán)境中的應(yīng)用都非常熟悉,但是IEEE 802.3 系列標(biāo)準(zhǔn)總在不斷的演進(jìn),工業(yè)網(wǎng)絡(luò)自身也面臨著一些挑戰(zhàn),以太網(wǎng)及其組成部分也在不斷的演進(jìn)中以應(yīng)對(duì)工廠車(chē)間的需求。能提供低時(shí)延、增強(qiáng)靜電放電(ESD)保護(hù)性能的同時(shí),還能夠在更寬的溫度范圍中運(yùn)行的硬件互聯(lián)在工業(yè)網(wǎng)絡(luò)應(yīng)用中是非常重要的。Marvell 的88E1510P/88E1512P/88E1510Q 系列 PHY(物理層器件)產(chǎn)品,從最開(kāi)始就是與工業(yè)自動(dòng)化領(lǐng)域的領(lǐng)導(dǎo)者合作共同進(jìn)行設(shè)計(jì),并已
- 關(guān)鍵字: Marvell PHY
Altium更新高速PCB設(shè)計(jì)旗艦工具 推出Altium Desig
- Altium Designer強(qiáng)化功能提高設(shè)計(jì)生產(chǎn)力,滿(mǎn)足日趨復(fù)雜的電子設(shè)計(jì)需求。智能系統(tǒng)設(shè)計(jì)自動(dòng)化、3D PCB 設(shè)計(jì)解決方案 (Altium Designer®)、ECAD設(shè)計(jì)數(shù)據(jù)管理(Alt
- 關(guān)鍵字: Altium PCB設(shè)計(jì) Altium Designer 15.1
選擇合適的轉(zhuǎn)換器:JESD204B與LVDS對(duì)比
- 1 為不同應(yīng)用提供不同選擇 對(duì)于數(shù)據(jù)轉(zhuǎn)換器的高速串行傳輸,不同的應(yīng)用有不同的選擇。十多年來(lái),數(shù)據(jù)轉(zhuǎn)換器制造商一直選擇LVDS作為主要差分信號(hào)技術(shù)。盡管有些LVDS應(yīng)用可使用更高的數(shù)據(jù)速率,但目前該市場(chǎng)上的轉(zhuǎn)換器廠商可提供的最大LVDS數(shù)據(jù)速率仍然為0.8至1 Gbps。LVDS技術(shù)一直難以滿(mǎn)足轉(zhuǎn)換器的帶寬要求。LVDS受TIA/EIA 644A規(guī)范控制,這是一項(xiàng)LVDS核心制造商的行業(yè)標(biāo)準(zhǔn)。該規(guī)范可作為設(shè)計(jì)人員的最佳實(shí)踐指南,提高不同廠商的LVDS發(fā)送器及接收器兼容性。同樣,沒(méi)有完全遵守LVDS
- 關(guān)鍵字: JESD204B LVDS 轉(zhuǎn)換器 FPGA PHY
力科發(fā)布MIPI M-PHY自動(dòng)化物理層一致性測(cè)試,擴(kuò)展移動(dòng)市場(chǎng)解決方案
- 力科 (Teledyne LeCroy) 今天發(fā)布了符合MIPI M-PHY標(biāo)準(zhǔn)的自動(dòng)化物理層發(fā)射機(jī)一致性測(cè)試方案。這套全新的QPHY-MIPI-MPHY一致性測(cè)試軟件,能夠在短時(shí)間內(nèi)測(cè)量大量的周期,提供M-PHY一致性側(cè)枝中最高等級(jí)的信心度。我們可以對(duì)所有當(dāng)前指定的GEARs的HS-MODE, PWM-MODE和SYS-MODE信號(hào)進(jìn)行測(cè)試。專(zhuān)為M-PHY測(cè)試而設(shè)計(jì)的新款有源終端適配器確保被測(cè)設(shè)備與示波器以一種簡(jiǎn)單的,高性?xún)r(jià)比和高保真度的方式連接。這套全新的QPHY-MIPI-MPHY一致性測(cè)試軟件
- 關(guān)鍵字: 力科 M-PHY
力科發(fā)布MIPI M-PHY自動(dòng)化物理層一致性測(cè)試,擴(kuò)展移動(dòng)市場(chǎng)解決方案
- 力科 (Teledyne LeCroy) 今天發(fā)布了符合MIPI M-PHY標(biāo)準(zhǔn)的自動(dòng)化物理層發(fā)射機(jī)一致性測(cè)試方案。這套全新的QPHY-MIPI-MPHY一致性測(cè)試軟件,能夠在短時(shí)間內(nèi)測(cè)量大量的周期,提供M-PHY一致性側(cè)枝中最高等級(jí)的信心度。我們可以對(duì)所有當(dāng)前指定的GEARs的HS-MODE, PWM-MODE和SYS-MODE信號(hào)進(jìn)行測(cè)試。專(zhuān)為M-PHY測(cè)試而設(shè)計(jì)的新款有源終端適配器確保被測(cè)設(shè)備與示波器以一種簡(jiǎn)單的,高性?xún)r(jià)比和高保真度的方式連接。這套全新的QPHY-MIPI-MPHY一致性測(cè)試軟件
- 關(guān)鍵字: 力科 M-PHY
基于FPGA的報(bào)文數(shù)據(jù)分析模塊的設(shè)計(jì)
- 摘要:網(wǎng)絡(luò)報(bào)文數(shù)據(jù)的記錄和分析在智能化變電站中尤為重要,通過(guò)對(duì)整個(gè)通信過(guò)程的記錄可以為事故分析及運(yùn)行維護(hù)提供依據(jù)。本文提出了一種基于FPGA技術(shù)、結(jié)合相關(guān)通信協(xié)議的報(bào)文數(shù)據(jù)分析系統(tǒng)的設(shè)計(jì)方案,實(shí)現(xiàn)了報(bào)文數(shù)據(jù)分析系統(tǒng)的各功能子模塊,通過(guò)仿真運(yùn)行驗(yàn)證了系統(tǒng)良好的處理能力。 引言 隨著計(jì)算機(jī)技術(shù)、通信技術(shù)及網(wǎng)絡(luò)技術(shù)的迅速發(fā)展,基于這三種核心技術(shù)的自動(dòng)化智能裝置在電網(wǎng)控制中的作用越來(lái)越突出。其中以交換式以太網(wǎng)和光纖光纜實(shí)現(xiàn)的網(wǎng)絡(luò)通信系統(tǒng)已經(jīng)逐漸成為變電站的重要單元。 如何記錄、分析某個(gè)智能單
- 關(guān)鍵字: FPGA 以太網(wǎng) IEC61850 PHY CPU MAC 201411
Synopsys全新DesignWare MIPI D-PHY將面積和功耗縮減50%
- 為加速芯片和電子系統(tǒng)創(chuàng)新而提供軟件、知識(shí)產(chǎn)權(quán)(IP)及服務(wù)的全球性領(lǐng)先供應(yīng)商新思科技公司(Synopsys, Inc.)日前宣布:已將其DesignWare® MIPI® D-PHY™的面積和功耗降低到了競(jìng)爭(zhēng)性方案的50%,同時(shí)將性能提升至每通道2.5 Gbps,為移動(dòng)、消費(fèi)類(lèi)和汽車(chē)應(yīng)用降低了系統(tǒng)級(jí)芯片(SoC)的芯片成本并延長(zhǎng)了電池續(xù)航能力。由于符合MIPI D-PHY v1.2規(guī)范,同時(shí)作為還包括DesignWare MIPI DSI 和 CSI-2 Controlle
- 關(guān)鍵字: Synopsys SoC D-PHY
開(kāi)源式OLED手表
- 很多精巧的開(kāi)源硬件項(xiàng)目都是由在日常工作中以Altium Designer作為研發(fā)工具的電子工程師和PCB設(shè)計(jì)工程師完成的。而正在茁壯成長(zhǎng)的新一代工程師們的表現(xiàn)也十分亮眼。新西蘭坎特伯雷大學(xué)工程系大四學(xué)生Jared Sanson最近完成了一個(gè)令人驚嘆的開(kāi)源項(xiàng)目――開(kāi)源式OLED手表。 Jared之所以萌發(fā)這一想法,是因?yàn)樗诸^有一塊OLED的顯示屏,但是沒(méi)有辦法驅(qū)動(dòng)它。后來(lái)他在利用Altium Designer設(shè)計(jì)一款新型PCB時(shí),
- 關(guān)鍵字: Altium Designer OLED手表 PIC24F
Cadence推出16納米FinFET制程DDR4 PHY IP
- 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ: CDNS)于2014年5月20日宣布,立即推出基于臺(tái)積電16納米FinFET制程的DDR4 PHY IP(知識(shí)產(chǎn)權(quán))。16納米技術(shù)與Cadence創(chuàng)新的架構(gòu)相結(jié)合,可幫助客戶(hù)達(dá)到DDR4標(biāo)準(zhǔn)的最高性能,亦即達(dá)到3200Mbps的級(jí)別,相比之下,目前無(wú)論DDR3還是DDR4技術(shù),最高也只能達(dá)到2133Mbps的性能。通過(guò)該技術(shù),需要高內(nèi)存帶寬的服務(wù)器、網(wǎng)絡(luò)交換、存儲(chǔ)器結(jié)構(gòu)和其他片上系統(tǒng)(SoC)現(xiàn)在可以使用Cadence? DD
- 關(guān)鍵字: Cadence DDR4 PHY IP CRC
Synopsys全新已流片DesignWare USB 3.0和USB 2.0 femtoPHY IP將面積縮小高達(dá)50%
- 為加速芯片和電子系統(tǒng)創(chuàng)新而提供軟件、知識(shí)產(chǎn)權(quán)(IP)及服務(wù)的全球性領(lǐng)先供應(yīng)商新思科技公司(Synopsys, Inc.,納斯達(dá)克股票市場(chǎng)代碼:SNPS)今日宣布:通過(guò)推出全新的DesignWare?USB femtoPHY系列IP,已將USB PHY的實(shí)現(xiàn)面積縮小多達(dá)50%;從而可在28nm和14/16nmFinFET工藝節(jié)點(diǎn)上,將USB PHY設(shè)計(jì)的片芯占用面積和成本降至最低。采用28nm和14nm FinFET硅工藝的DesignWare USB femtoPHY已展示出穩(wěn)固的性能,使設(shè)計(jì)
- 關(guān)鍵字: Synopsys USB PHY SoC
Vitesse率先獲得FIPS安全認(rèn)證
- 為電信網(wǎng)、企業(yè)網(wǎng)和物聯(lián)網(wǎng)(IoT)網(wǎng)絡(luò)提供先進(jìn)芯片解決方案的領(lǐng)先供應(yīng)商Vitesse?Semiconductor公司(納斯達(dá)克股票代碼:VTSS)宣布:其帶有Intellisec??IEEE?802.1AE?MACsec技術(shù)的SynchroPHY?千兆以太網(wǎng)(GE)和10G以太網(wǎng)(10GE)PHY芯片,日前率先獲得了世界首批聯(lián)邦信息處理標(biāo)準(zhǔn)(FIPS)197?256位AES加密認(rèn)證。 FIPS?197是由美國(guó)國(guó)家標(biāo)準(zhǔn)技術(shù)研究所(NIST)發(fā)
- 關(guān)鍵字: Vitesse FIPS PHY AES IoT
chiplet phy designer介紹
您好,目前還沒(méi)有人創(chuàng)建詞條chiplet phy designer!
歡迎您創(chuàng)建該詞條,闡述對(duì)chiplet phy designer的理解,并與今后在此搜索chiplet phy designer的朋友們分享。 創(chuàng)建詞條
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