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將片外調(diào)試的優(yōu)點融入FPGA片上調(diào)試之中
- FPGA片上調(diào)試已出現(xiàn)了很多年，成為傳統(tǒng)復雜FPGA設計調(diào)試方法的一種常用替代方式，將虛擬測試夾具放于FPGA設計任何地方而不是采用昂貴的通用I/O引腳是可編程邏輯器件才有的性能。但片上調(diào)試也有一些不足之處，本文將討論片上調(diào)試的局限，并介紹如何把片上調(diào)試與片外深采樣存儲特性結合起來。
- 關鍵字： FPGA
基于MSP430和Cyclone II的網(wǎng)絡數(shù)據(jù)加密實現(xiàn)
- 隨著信息技術和網(wǎng)絡化進程的發(fā)展，網(wǎng)絡通信安全問題日益突出?，F(xiàn)場可編程門陣列(FPGA)以其自身設計靈活、可靠性高的優(yōu)點廣泛應用于加密領域。
- 關鍵字： MSP430 CycloneII 網(wǎng)絡數(shù)據(jù) FPGA
使用基于FPGA的高速硬件在環(huán)仿真器進行電機控制器測試
- 電機在現(xiàn)代生活中扮演著重要角色。出于對安全、成本及效率的考慮，工程師——尤其是混合電動力汽車(HEV)工程師——往往希望在特定的真實環(huán)境下通過仿真電機模型對電機控制器進行測試。
- 關鍵字： 環(huán)仿真器 電機控制器 FPGA
基于FPGA的數(shù)字波束形成技術的工程實現(xiàn)
- 數(shù)字波束形成技術充分利用陣列天線所獲取的空間信息，通過信號處理技術使波束獲得超分辨率和低副瓣的性能，實現(xiàn)了波束的掃描、目標的跟蹤以及空間干擾信號的零陷，因而數(shù)字波束形成技術在雷達信號處理
- 關鍵字： 數(shù)字波束形成技術 信號處理器 FPGA
理解FPGA中的壓穩(wěn)態(tài)
- FPGA 設計人員可以通過增大tMET ，采用增加同步寄存器時序余量等設計方法來提高系統(tǒng)可靠性，增大亞穩(wěn)態(tài)MTBF。Altera 確定了其 FPGA 的MTBF 參數(shù)，改進器件技術，從而增大了亞穩(wěn)態(tài)MTBF。使用Altera FPGA 的設計人員可以利用Quartus II 軟件功能來報告設計的亞穩(wěn)態(tài)MTBF，優(yōu)化設計布局以增大MTBF。
- 關鍵字： 壓穩(wěn)態(tài) MTBF FPGA
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