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基于FPGA的DES加密算法的高性能實現(xiàn)
- 在分析DES算法原理的基礎(chǔ)上，詳細(xì)闡述一種基于VHDL描述、FPGA實現(xiàn)的DES加密算法系統(tǒng)的設(shè)計和仿真結(jié)果。該系統(tǒng)采用了一種基于子密鑰預(yù)先計算的新型流水線設(shè)計方案，克服了傳統(tǒng)DES流水線實現(xiàn)方式的缺點(diǎn)，使系統(tǒng)的密鑰可動態(tài)刷新．并在硬件資源消耗有所降低的情況下，進(jìn)一步提高系統(tǒng)的處理速度，系統(tǒng)最高時鐘頻率為222．77 MHz．信息加密的速度為14．26 Gb／s，是最快軟件實現(xiàn)方式的112倍。同時系統(tǒng)還具有設(shè)計靈活，可靠性高，可重用性強(qiáng)．升級方便等特點(diǎn)。
- 關(guān)鍵字： FPGA DES 加密算法 性能
基于FPGA技術(shù)的模擬雷達(dá)信號的設(shè)計與實現(xiàn)
- 前言FPGA（現(xiàn)場可編程門陣列）是由掩膜可編程門陣列和PLD（可編程邏輯器件）演變而來的，并將二者的特性結(jié)合...
- 關(guān)鍵字： FPGA 模擬雷達(dá)信號
流水線技術(shù)在基于FPGA的DSP運(yùn)算中的應(yīng)用
- 在數(shù)字信號處理(DSP)領(lǐng)域，需要處理的數(shù)據(jù)量很大，并且實時性要求很高。傳統(tǒng)的DSP設(shè)計方法主要有采用固定功...
- 關(guān)鍵字： 流水線技術(shù) FPGA DSP 運(yùn)算
基于FPGA的正交數(shù)字混頻器中數(shù)控振蕩器的設(shè)計與實
- 要CORDIC(COordination Rotation DIgital Computer)算法實現(xiàn)正交數(shù)字混頻器中的數(shù)控振蕩器的方法。首先推導(dǎo)了算法產(chǎn)生正余弦信號的實現(xiàn)過程,然后給出了在中設(shè)計數(shù)控振蕩器的頂層電路結(jié)構(gòu),并根據(jù)算法特點(diǎn)在設(shè)計中引入
- 關(guān)鍵字： FPGA 正交數(shù)字 混頻器 數(shù)控振蕩器
FPGA平臺漸成系統(tǒng)核心
- 今天，F(xiàn)PGA已經(jīng)被應(yīng)用于系統(tǒng)的核心。無論是用來完成關(guān)鍵功能還是直接作為系統(tǒng)核心，今天的FPGA所提供的性能、功耗和容量都已經(jīng)達(dá)到甚至超過此前ASIC或ASSP的水平。 25年前，賽靈思公司共同創(chuàng)始人之一 Ross Freeman發(fā)明了FPGA(現(xiàn)場可編 程門陣列)，僅憑一項專利，Ross就激發(fā)了一個行業(yè)的創(chuàng)新熱情。 很多電子設(shè)計師認(rèn)為，F(xiàn)GPA將是21世紀(jì)最重要的集成電路技術(shù)之一，而傳統(tǒng)門陣列和結(jié)構(gòu)陣列技術(shù)將退居到特殊的大批量應(yīng)用。在FPGA誕生之初，可編程邏輯主要用于系統(tǒng)外圍，作
- 關(guān)鍵字： 賽靈思 FPGA ASIC ASSP
便攜消費(fèi)市場FPGA正部分取代ASIC
- 傳統(tǒng)型FPGA基本具備高性能、傳輸速度快的特點(diǎn)，因此這些產(chǎn)品都具有DSP(數(shù)字信號處理)和高速傳輸I/O接口。它們主要滿足基站、工控、醫(yī)療等市場對高速產(chǎn)品的需求。SiliconBlue的產(chǎn)品定位與上述傳統(tǒng)型FPGA不同。我們強(qiáng)調(diào)生產(chǎn)針對便攜消費(fèi)電子市場的低功耗產(chǎn)品。 傳統(tǒng)的FPGA企業(yè)在低功耗市場上推出的都是密度非常小的器件，只能滿足非常簡單的邏輯應(yīng)用，而且即使他們在這方面有系列產(chǎn)品，產(chǎn)品線相對來說仍然不很完整。而SiliconBlue看準(zhǔn)這一市場，提供完整的產(chǎn)品線。 市場上一些新興FPG
- 關(guān)鍵字： FPGA DSP 65納米 SRAM
SoC原型驗證領(lǐng)域FPGA應(yīng)用逐年增加
- 近幾年來，F(xiàn)PGA在驗證SoC設(shè)計上的應(yīng)用發(fā)展非常迅速，這是因為隨著半導(dǎo)體設(shè)計、制造工藝越來越先進(jìn)，SoC、ASIC設(shè)計的規(guī)模變得越來越大，只采用傳統(tǒng)軟件仿真的方式，已經(jīng)不能夠充分地驗證功能。另外，大量的前期軟件開發(fā)也需要一個接近SoC、ASIC設(shè)計的硬件原型。而采用FPGA來模擬芯片設(shè)計的原型，已被證明是最有效、最經(jīng)濟(jì)的方式。目前，用于 SoC原型驗證的FPGA銷售額已增加到整個FPGA銷售的7%～9%，相信這一比例還將逐年提高。 SoC原型應(yīng)用對FPGA有一定的需求。比如規(guī)模通常需要比較大，
- 關(guān)鍵字： FPGA SoC ASIC
FPGA格局難改 新興企業(yè)勝算幾何？
- 全球FPGA(現(xiàn)場可編程門陣列)產(chǎn)業(yè)競爭的基調(diào)是雙雄爭霸。據(jù)統(tǒng)計，2008年賽靈思和Altera兩家公司的銷售收入已占可編程器件行業(yè)整體銷售收入的87%。不過，由于該行業(yè)具有較高的收益率，因此不斷有新興企業(yè)加入競爭行列。 新興企業(yè)要在激烈的市場競爭中立足面臨著多重挑戰(zhàn)，資金難題首當(dāng)其沖。FPGA的設(shè)計流程與普通IC芯片設(shè)計流程類似，除了需要由工程師進(jìn)行IC設(shè)計之外還必須獲得EDA(電子設(shè)計自動化)工具軟件。與普通IC設(shè)計所用的昂貴的EDA工具不同，F(xiàn)PGA的開發(fā)工具是由FPGA公司設(shè)計的，并且免
- 關(guān)鍵字： Altera FPGA IC設(shè)計
PLD產(chǎn)業(yè)市場持續(xù)擴(kuò)大加速替代ASIC
- 雖然PLD公司之間的競爭一直非常激烈，但ASIC仍然是我們主要的競爭對手。而競爭的結(jié)果是客戶趨向于使用可編程解決方案。相信PLD產(chǎn)業(yè)會持續(xù)擴(kuò)大市場份額，加速替代ASIC。 在過去幾年中，半導(dǎo)體產(chǎn)業(yè)整體上經(jīng)歷了明顯的衰退。而這一衰退對于可編程邏輯器件(PLD)行業(yè)來講實際上卻是很好的發(fā)展機(jī)會。雖然PLD公司之間的競爭一直非常激烈，但ASIC(專用集成電路)仍然是我們主要的競爭對手。而競爭的結(jié)果是客戶趨向于使用可編程解決方案。 相對于10年前，目前采用前沿技術(shù)實現(xiàn)一個ASIC設(shè)計的成本幾乎翻了
- 關(guān)鍵字： PLD ASIC FPGA 40nm
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