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            主飛行儀表圖形加速顯示系統(tǒng)的FPGA設計
            
                                                            
              
                    	
            • 針對主飛行顯示儀對圖形處理和顯示的苛刻要求，采用基于儀器總線和擴展總線的高速陣列信號處理板的設計模式，提出了一種基于硬件加速的PFD圖形顯示設計方法。該方法實現(xiàn)了圖形分層雙緩存交替切換、圖形填充、圖形合成和多通道DMA像素引擎，提高了PFD圖形生成和顯示的實時性和可靠性。實踐證明，該設計顯著解決了PFD圖形顯示系統(tǒng)中的速度瓶頸。
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            • 關鍵字：
                        圖形處理  圖形合成  FPGA                          
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            用FPGA內部集成的DSP實現(xiàn)圖像處理的實例分析
            
                                                            
              
                    	
            • intevac是商用和軍用市場光學產品的前沿開發(fā)商。本文介紹該公司nightvista嵌入式電子系統(tǒng)的開發(fā)，該產品是高性能超低亮度緊湊型攝像機。該攝像機最初采用了流行的數(shù)字信號處理器、幾個assp和外部存儲器件。系統(tǒng)對性能的需求越來越高，工程師團隊決定試驗一種替代方案——在可編程邏輯中實現(xiàn)可配置軟核處理器。
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            • 關鍵字：
                        圖像處理  NIOS  FPGA                          
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            一種并行存儲器系統(tǒng)的FPGA實現(xiàn)
            
                                                            
              
                    	
            • 圍繞小衛(wèi)星體積小、重量輕和價格低廉的特點，一個多CPU共享內存的系統(tǒng)（CPU仍然采用有相應宇航級器件的8086）將是比較合適的選擇。同時為了提高共享內存的數(shù)據(jù)通信帶寬，使其不成為整個系統(tǒng)的瓶頸，本文提出了一個用ASIC設計一個共享總線開關網絡（簡稱SBSN，下同），組合成Omega網絡的方案，以消除對某一組內存的總線競爭，實現(xiàn)多CPU對共享分組存儲系統(tǒng)的低位交叉并行訪問。
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            • 關鍵字：
                        并行存儲器  多CPU共享內存  FPGA                          
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            一個進位保留加法陣列的HDL代碼生成器
            
                                                            
              
                    	
            •  多加數(shù)的加法器是FPGA的一個比較常見的應用。仿真對比了其三種實現(xiàn)方案的性能和所消耗資源，得出進位保留加法陣列是首選方案。針對進位保留加法陣列實現(xiàn)的復雜性給出了一個加法陣列的HDL代碼生成器，極大地簡化了加法陣列的設計工作。 
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            • 關鍵字：
                        HDL代碼生成器  加法器  FPGA                          
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            FPGA系統(tǒng)調試問題及提高調試效率的方法
            
                                                            
              
                    	
            • 本文就調試FPGA系統(tǒng)時遇到的問題及有助于提高調試效率的方法，針對Altera和Xilinx的FPGA調試提供了最新的方法和工具。
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            • 關鍵字：
                        邏輯分析儀  測試內核  FPGA                          
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            基于FPGA的IDE硬盤數(shù)據(jù)AES加解密研究與實現(xiàn)
            
                                                            
              
                    	
            • 提出了基于FPGA對IDE硬盤數(shù)據(jù)進行AES加解密的方法。對算法進行了改進和優(yōu)化，以降低加解密過程對IDE硬盤數(shù)據(jù)傳輸速度的影響。
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            • 關鍵字：
                        AES加解密  IDE  FPGA                          
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            面積優(yōu)先的分組密碼算法SMS4 IP核設計
            
                                                            
              
                    	
            • 對新分組密碼算法SMS4進行了FPGA實現(xiàn)。所設計的SMS4算法的IP核主要包括具有加解密功能的非流水線式數(shù)據(jù)通路和實時產生子密鑰的密鑰擴展模塊，并且支持電子密碼本(ECB)和分組鏈接(CBC)兩種工作模式。提出了一種不含密鑰初始化的運行模式，使解密吞吐率提高近一倍。
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            • 關鍵字：
                        分組密碼  IP核  FPGA                          
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            基于FPGA的全數(shù)字鎖相環(huán)路的設計
            
                                                            
              
                    	
            • 介紹了應用VHDL技術設計嵌入式全數(shù)字鎖相環(huán)路的方法。詳細敘述了其工作原理和設計思想，并用可編程邏輯器件FPGA予以實現(xiàn)。
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            • 關鍵字：
                        VHDL  數(shù)字鎖相環(huán)  FPGA                          
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            基于FPGA和TMS320DM642的CCD圖像采集和處理系統(tǒng)硬件設計
            
                                                            
              
                    	
            • 為能高速、有效、實時采集CCD視頻圖像，提出了一種實時視頻圖像采集和處理系統(tǒng)設計方案。重點介紹其硬件設計原理、關鍵電路的設計，其主要功能是從CCD攝像頭輸出的模擬視頻信號中提取實時圖像，數(shù)字化后送入處理器作后期圖像處理和分析。
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            • 關鍵字：
                        CCD視頻  DM642  FPGA  圖像采集                          
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            基于FPGA的線陣CCD器件驅動器及其系統(tǒng)控制邏輯時序的設計
            
                                                            
              
                    	
            •  介紹一種基于FPGA設計線陣CCD器件TCDl208AP復雜驅動電路和整個CCD的電子系統(tǒng)控制邏輯時序的方法，并給出時序仿真波形。工程實踐結果表明，該驅動電路結構簡單、功耗小、成本低、抗干擾能力強，適應工程小型化的要求。
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            • 關鍵字：
                        時序綜合分析  CCD  FPGA                          
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            利用FPGA技術實現(xiàn)數(shù)字通信中的交織器和解交織器
            
                                                            
              
                    	
            • 介紹用FPGA實現(xiàn)數(shù)字通信中的交、解交織器的一種比較通用的方案，詳細說明了設計中的一些問題及解決辦法。還介紹了一種實現(xiàn)FPGA中信號延時的方法。
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            • 關鍵字：
                        數(shù)字通信  交織器  FPGA  信號延時                          
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            基于FPGA的小型星載非制冷紅外成像系統(tǒng)設計與實現(xiàn)
            
                                                            
              
                    	
            • 根據(jù)內編隊重力場衛(wèi)星紅外成像工作環(huán)境的溫度要求，選取了非制冷長波紅外焦平面陣列探測器——UL 03 16 2，并在此基礎上進行了系統(tǒng)的軟硬件設計。
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            • 關鍵字：
                        非制冷紅外成像  MircoBlaze  FPGA                          
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            FPGA低功耗設計小貼士
            
                                                            
              
                    	
            • 采用FPGA進行低功耗設計并不是一件容易的事，盡管有許多方法可以降低功耗。FPGA的類型、IP核、系統(tǒng)設計、軟件算法、功耗分析工具及個人設計方法都會對產品功耗產生影響。值得注意的是，如果使用不當，有些方法反而會增加功耗，因此必須根據(jù)實際情況選擇適當?shù)脑O計方法。
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            • 關鍵字：
                        功率估算  結構設計  FPGA                          
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            基于FPGA的高速并行Viterbi譯碼器的設計與實現(xiàn)
            
                                                            
              
                    	
            • 針對319卷積編碼，提出一種Viterbi譯碼器的FPGA實現(xiàn)方案。該方案兼顧了資源消耗和譯碼效率，通過有效的時鐘和存儲介質復用，實現(xiàn)了高速并行的譯碼功能，并利用Verilog語言在Xilinx ISE 6．2中進行了建模仿真和綜合實現(xiàn)。
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            • 關鍵字：
                        卷積編碼  Viterbi譯碼器  FPGA                          
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            FPGA加速三維CT圖像重建
            
                                                            
              
                    	
            • 針對三維圖像重建的經典算法(FDK算法)在FPGA上的加速，提出了并行無等待流水線的實現(xiàn)方法。實驗結果表明，該方法獲得了較高的加速比。
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            • 關鍵字：
                        三維圖像重建  FDK算法  FPGA                          
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