arm+fpga 文章 進入arm+fpga技術(shù)社區(qū)
基于Modelsim FLI接口的FPGA仿真技術(shù)
- 1、Modelsim 及 FLI接口介紹 Modelsim是 Model Technology（Mentor Graphics的子公司）的 HDL 硬件描述語言仿真軟件，可以實現(xiàn) VHDL, Verilog，以及 VHDL-Verilog 混合設(shè)計的仿真。除此之外，Modelsim還能夠與 C 語言一起實現(xiàn)對 HDL 設(shè)計文件的協(xié)同仿真。同時，相對于大多數(shù)的 HDL 仿真軟件來說，Modelsim 在仿真速度上也有明顯優(yōu)勢。這些特點使 Modelsim 越來越受到 EDA設(shè)計者、尤其是 FPGA
- 關(guān)鍵字： FPGA 仿真 Modelsim FLI VHDL
用FPGA實現(xiàn)低成本實時深度感知
- 引言 對于自主機器人導(dǎo)航和其它機器視覺應(yīng)用來說，實時深度感知是很關(guān)鍵的。目前通過立體圖像來計算深度的算法計算量很大，例如差異測繪，要占用CPU大量的時間，或者需要用昂貴的器件進行實時操作。 針對立體攝像的深度感知，F(xiàn)PGA解決方案能使處理器的時間得到緩解，減少或除去器件的成本，例如MPU、DSP、激光器和昂貴的鏡頭。通過提供給機器人其環(huán)境中 的差異測繪，F(xiàn)PGA使機器人中的CPU專注于重要的高層任務(wù)，例如建圖和定位。 差異測繪 加深度感知到機器人的常用技術(shù)是用兩個水平放置的
- 關(guān)鍵字： 機器視覺 FPGA 深度感知 嵌入式 DSP 200806
一種新型高速數(shù)據(jù)采集系統(tǒng)的設(shè)計與實現(xiàn)
- 介紹了一種基于USB2.0接口的高速數(shù)據(jù)采集系統(tǒng)的設(shè)計。該采集系統(tǒng)能夠?qū)⒗走_接收機送來的信號進行高速的采集，然后通過USB接口，將采集到的數(shù)據(jù)送到計算機，經(jīng)由上層軟件對數(shù)據(jù)進行處理分析。
- 關(guān)鍵字： USB2.0 FPGA 高速數(shù)據(jù)采集 雷達接收機 200806
基于SOPC技術(shù)的醫(yī)用呼吸機主控系統(tǒng)設(shè)計
- 摘要： 以Altera公司FPGA芯片為平臺，利用SOPC技術(shù)和Nios II處理器設(shè)計并實現(xiàn)了醫(yī)用呼吸機的主控系統(tǒng)。 關(guān)鍵詞： 呼吸機；SOPC；Nios II軟核處理器；壓力補償 呼吸機是可以代替人的呼吸功能或輔助人的呼吸功能的儀器。它適用于呼吸衰竭、甚至停止呼吸的病人做人工呼吸之用。它能幫助病人糾正缺氧和排出二氧化碳，是挽救某些危重病人生命的重要工具。 現(xiàn)有的呼吸機產(chǎn)品，其主控系統(tǒng)大多基于單片機來實現(xiàn)，對于功能強一些的產(chǎn)品就需要使用高端單片機，這樣使得系
- 關(guān)鍵字： SOPC Nios II FPGA 呼吸機 壓力補償 200806
CADENCE與Common Platform及ARM合作提供45納米RTL-to-GDSII參考流程
- 全球電子設(shè)計創(chuàng)新企業(yè)Cadence設(shè)計系統(tǒng)公司(NASDAQ: CDNS)今天宣布面向Common Platform™技術(shù)的45納米參考流程將于2008年7月面向大眾化推出。Cadence®與Common Platform技術(shù)公司包擴IBM、特許半導(dǎo)體制造公司和三星聯(lián)合開發(fā)RTL-to-GDSII 45納米流程，滿足高級節(jié)點設(shè)計需要。該參考流程基于對應(yīng)Common Power Format（CPF）的Cadence低功耗解決方案，而且還包含來自Cadence的關(guān)鍵可制造性設(shè)計（De
- 關(guān)鍵字： CADENCE Common Platform ARM RTL-to-GDSII 低功耗
FPGA+DSP實時三維圖像信息處理系統(tǒng)
- 三維圖像信息處理一直是圖像視頻處理領(lǐng)域的熱點和難點，目前國內(nèi)外成熟的三維信息處理系統(tǒng)不多，已有的系統(tǒng)主要依賴高性能通用PC完成圖像采集、預(yù)處理、重建、構(gòu)型等囊括底層和高層的處理工作。三維圖像處理數(shù)據(jù)量特別大、運算復(fù)雜，單純依靠通用PC很難達到實時性要求，不能滿足現(xiàn)行高速三維圖像處理應(yīng)用。 本系統(tǒng)中，采用FPGA實現(xiàn)底層的信號預(yù)處理算法，其處理數(shù)據(jù)量很大，處理速度高，但算法結(jié)構(gòu)相對比較簡單，可同時兼顧速度和靈活性。高層處理算法數(shù)據(jù)量較少、算法結(jié)構(gòu)復(fù)雜，可采用運算速度快、尋址方式靈活、通信機制強大的
- 關(guān)鍵字： FPGA DSP 三維圖像信息處理 EVIP PCI
全新片上可編程系統(tǒng)（SOPC）多參監(jiān)護儀專用主控板簡介
- 主控板是多參監(jiān)護儀執(zhí)行信息處理的核心部件，主要解決臨床生理信息的傳輸、存儲、顯示、交換和信息數(shù)據(jù)的組合加工。特別是數(shù)字化醫(yī)院的發(fā)展，HIS、CIS 系統(tǒng)的建立和普遍使用，使得多參監(jiān)護儀不僅是一個生理參數(shù)的顯示和記錄終端，而且正成為醫(yī)療單位信息系統(tǒng)中必不可少的一個重要的臨床、生理信息平臺。它的許多技術(shù)指標直接體現(xiàn)了多參監(jiān)護儀整機的重要技術(shù)性能指標。在多參監(jiān)護儀市場競爭日趨激烈的今天，選擇一款技術(shù)既先進，性能價格比又高的主控板，無疑可以大大提高它的市場競爭力。 一、目前國內(nèi)多參監(jiān)護儀主控板的現(xiàn)狀：
- 關(guān)鍵字： ARM 數(shù)字化醫(yī)院 SOC PCB
利用Virtex-5 FPGA實現(xiàn)最低功耗解決方案
- 過渡至65納米工藝的FPGA具備采用更小尺寸工藝所帶來的優(yōu)勢：低成本、高性能和更強的邏輯能力。盡管這些優(yōu)勢能夠為高級系統(tǒng)設(shè)計帶來激動人心的機會，但65納米工藝節(jié)點本身也帶來了新的挑戰(zhàn)。例如，在為產(chǎn)品選擇FPGA時，功耗的考慮變得越來越重要。很可能下一代設(shè)計會需要在功耗預(yù)算不變(或更小)的情況下，集成更多的特性和實現(xiàn)更高的性能。 本文將分析功耗降低所帶來的益處，還將介紹Virtex-5器件中所采用的多種技術(shù)和結(jié)構(gòu)上的革新，它們能提供功耗最低的解決方案，并且不犧牲性能。 降低功耗的好處
- 關(guān)鍵字： FPGA 低功耗 Virtex-5 靜態(tài)功耗 動態(tài)功耗
飛思卡爾推出世界首款軟ColdFire32位內(nèi)核FPGA
- 2008年6月9日，為了滿足高度定制化半導(dǎo)體解決方案的市場需求，飛思卡爾在Altera Cyclone III系列FPGA上推出32位V1 ColdFire內(nèi)核的首款現(xiàn)場可編程柵格陣列（FPGA）。半導(dǎo)體知識產(chǎn)權(quán)（IP）許可專家IPextreme公司將通過其在線Core Store™市場免費為Cyclone III客戶提供V1內(nèi)核許可。 V1 ColdFire內(nèi)核許可為那些不能通過標準嵌入式處理器和片上系統(tǒng)（SOC）器件解決其設(shè)計問題的工程師提供一款靈活、經(jīng)濟高效的解決方案。
- 關(guān)鍵字： 飛思卡爾 FPGA 內(nèi)核 Cyclone
為什么嵌入式開發(fā)人員要使用FPGA
- 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
- 關(guān)鍵字： FPGA 嵌入式系統(tǒng)
一種基于DSP平臺的快速H.264編碼算法的設(shè)計
- 視頻壓縮編碼標準H.264／AVC是由ISO／IEC和ITU-T組成的聯(lián)合視頻專家組(JVT)制定的，他引進了一系列先進的視頻編碼技術(shù)，如4×4整數(shù)變換、空域內(nèi)的幀內(nèi)預(yù)測，多參考幀與多種大小塊的幀間預(yù)測技術(shù)等，標準一經(jīng)推出，就以其高效的壓縮性能和友好的網(wǎng)絡(luò)特性受到業(yè)界的廣泛推崇。特別是在2004年7月JVT組織做了重要的保真度范圍擴展的補充后，更加擴大了標準的應(yīng)用范圍，但同時巨大的運算量卻成為其廣泛應(yīng)用的瓶頸?？紤]到H.264協(xié)議實現(xiàn)的復(fù)雜度，本文的思路是：一方面提高硬件處理速度和能力，采
- 關(guān)鍵字： DSP 編碼算法 視頻壓縮編碼 編碼器 ARM CPU
Altera為SOPC Builder工具推出32位V1 ColdFire軟核
- 為幫助系統(tǒng)級設(shè)計人員在FPGA軟核處理器上有更多的選擇，Altera公司(NASDAQ: ALTR)今天宣布，F(xiàn)reescale將為SOPC Builder工具推出32位V1 ColdFire軟核。為迅速方便的使用Altera® Cyclone® III FPGA建立系統(tǒng)級設(shè)計，設(shè)計人員現(xiàn)在使用SOPC Builder工具時，可以選擇Freescale®、ARM®或者Altera軟核處理器以及50多種其他的知識產(chǎn)權(quán)(IP)模塊。 SOPC Builder是獨特的A
- 關(guān)鍵字： Altera SOPC Builder 軟核 Freescale FPGA
在采用FPGA設(shè)計DSP系統(tǒng)中仿真的重要性
- 仿真是所有系統(tǒng)成功開發(fā)的基礎(chǔ)。通過在不同條件、參數(shù)值和輸入情況下對系統(tǒng)進行高級行為仿真，工程師可以迅速找到、分離并糾正系統(tǒng)的設(shè)計問題。因為在這一階段，比較容易區(qū)分設(shè)計問題和編程問題。通過在系統(tǒng)級工作，設(shè)計人員可以確定這一階段的問題是來自設(shè)計缺陷，而不是編程問題。此外，在信號處理系統(tǒng)設(shè)計中使用基于模型的方法大大縮短了“錯誤診斷延遲”時間――從設(shè)計中出現(xiàn)錯誤到發(fā)現(xiàn)錯誤并分離錯誤的時間。
- 關(guān)鍵字： 真的 重要性 系統(tǒng) DSP FPGA 設(shè)計 采用
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