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ARM處理器體系結(jié)構(gòu)概述
- ARM處理器體系結(jié)構(gòu)概述,本文主要介紹ARM7系列處理器。呵呵，不是相關(guān)專業(yè)可能有很多人不知道arm是個什么東西吧，我現(xiàn)在簡要介紹一下各種處理器分類，目前我們的處理器陣營中分為CISC和RISC兩大系列，CISC是復雜指令集處理器，這種處理器每條
- 關(guān)鍵字： 概述 體系結(jié)構(gòu) 處理器 ARM
在賽靈思FPGA設計中保留可重復結(jié)果
- 滿足設計的時序要求本身已非易事，而要實現(xiàn)某項設計的整體時序具有完全可重復性有時候卻是不可能的任務。幸運的是，設計人員可以借助有助于實現(xiàn)可重復時序結(jié)果的設計流程概念。影響最大的四個方面分別是 HDL 設計實踐、綜合優(yōu)化、平面布局和實施方案。 就獲得可重復結(jié)果而言，資源利用和頻率要求都很高的設計是最大的挑戰(zhàn)。它們也是可重復結(jié)果流程需求最高的設計。得到可重復結(jié)果的第一步是在 HDL設計階段運用設計合理的實踐。遵循出色的分層邊界實踐有助于保持邏輯整體性，而這在設計變更時有助于保持可重復結(jié)果。一條不錯的規(guī)
- 關(guān)鍵字： Xilinx FPGA
基于賽靈思Virtex-5 FPGA的LTE仿真器實現(xiàn)
- 功能強大的可編程邏輯平臺使得Prisma Engineering公司能夠針對所有蜂窩網(wǎng)絡提供可重配置無線測試設備。長期演進(LTE)是移動寬帶的最3GPP標準，它打破了現(xiàn)有蜂窩網(wǎng)絡的固有模式。LTE與前代UMTS和GSM標準相比，除采用高頻譜效率的射頻技術(shù)外，其架構(gòu)還得到了大幅簡化。LTE系統(tǒng)的無線接入部分Node-B，是連接無線電和整個互聯(lián)網(wǎng)協(xié)議核心網(wǎng)絡之間的邊緣設備。這種架構(gòu)無法監(jiān)測和測試等效于UMTS中間鏈路上的元件。必須通過無線電接口，才能有效地測試LTE網(wǎng)絡元件。 這正是Prisma
- 關(guān)鍵字： Xilinx FPGA Virtex-5
以基于賽靈思 FPGA 的硬件加速技術(shù)打造高速系統(tǒng)
- 設計人員時常需要通過增加計算能力或額外輸入（或兩者）延長現(xiàn)有的嵌入式系統(tǒng)的壽命。而可編程系統(tǒng)平臺在這里大有用武之地。我們曾經(jīng)希望用安全網(wǎng)絡連接功能升級一套網(wǎng)絡可編程系統(tǒng)。安全網(wǎng)絡連接功能需要加密才能運行安全外殼 (SSH)、傳輸層安全 (TLS)、安全套接層(SSL) 或虛擬專用網(wǎng) (VPN) 等協(xié)議。這種安全需求與把各種系統(tǒng)接入因特網(wǎng)的需求同步增長，例如，為了啟用遠程管理與分布式控制系統(tǒng)。 因該領域仍在發(fā)展并且標準尚未固定，因此成本主要取決于一次性工程費用。所以，F(xiàn)PGA 技術(shù)能實現(xiàn)最高價值。
- 關(guān)鍵字： Xilinx FPGA
手把手課堂:Xilinx FPGA設計時序約束指南
- 作為賽靈思用戶論壇的定期訪客，我注意到新用戶往往對時序收斂以及如何使用時序約束來達到時序收斂感到困惑。為幫助 FPGA設計新手實現(xiàn)時序收斂，讓我們來深入了解時序約束以及如何利用時序約束實現(xiàn)FPGA 設計的最優(yōu)結(jié)果。 何為時序約束？ 為保證設計的成功，設計人員必須確保設計能在特定時限內(nèi)完成指定任務。要實現(xiàn)這個目的，我們可將時序約束應用于連線中——從某 FPGA 元件到 FPGA 內(nèi)部或 FPGA 所在 PCB 上后續(xù)元件輸入的一條或多條路徑。 在 FPGA 設計
- 關(guān)鍵字： Xilinx FPGA 設計時序
2011年EEPW高校電子技術(shù)論壇—中南大學
- 《電子產(chǎn)品世界》雜志社一直非常關(guān)注企業(yè)與高校之間的交流，致力成為雙方相互溝通、促進的橋梁。2000年以來在雜志和網(wǎng)站開設了“高校園地”欄目，協(xié)助企業(yè)和高校舉辦教育培訓會、設計競賽等，并于2007年成功的將電子技術(shù)論壇帶進校園。2007年至今已在北京理工大學、桂林電子科技大學、華中科技大學、哈爾濱工業(yè)大學、清華大學、浙江大學、東南大學、電子科技大學、北京航空航天大學成功舉辦“EEPW高校電子技術(shù)論壇”，得到在校師生的積極關(guān)注和廣泛參與，參與學生及教師共38
- 關(guān)鍵字： ARM 嵌入式 大學
LXI總線數(shù)字化儀模塊設計
- 介紹了一種基于LXI總線數(shù)字化儀模塊的總體設計方案。該數(shù)字化儀模塊以FPGA和DSP作為采集控制和信號處理核心單元，兼容兩種標準頻率中頻信號的采集與數(shù)據(jù)處理，采用基于IEEE1588精密時鐘協(xié)議提供的時間基準進行精確定時觸發(fā)。軟件系統(tǒng)在Windows NT平臺上實現(xiàn)，開發(fā)了基于Lab Windows/CVI的虛擬儀器軟面板，保證了模塊運行的穩(wěn)定性和人機界面的友好。本數(shù)字化儀模塊的特點在于該模塊在高性能FPGA的控制下實現(xiàn)兩種中頻信號采集，最高采樣頻率可達130 MHz，可靠性、穩(wěn)定性好，具有較好的實用價值
- 關(guān)鍵字： LXI總線 FPGA DSP IEEE1588 201104
基于NETFPGA的手背靜脈身份認證系統(tǒng)
- 本作品設計并實現(xiàn)了一種基于近紅外手背靜脈檢測生物特征的個人身份認證系統(tǒng)(VAS系統(tǒng))，在Xilinx公司提供的NetFPGA開發(fā)平臺上完成了系統(tǒng)開發(fā)。實現(xiàn)了手背靜脈圖像的采集、處理、存儲和匹配驗證等功能，充分發(fā)揮了FPGA硬件功能，采用軟硬件協(xié)同思想，流水線策略和并行處理的方法，移植和優(yōu)化了軟件算法。同時對NetFPGA平臺進行了改造和擴展;還實現(xiàn)了靈活、友好的交互界面，安全級別高，擴展性強。
- 關(guān)鍵字： 嵌入式系統(tǒng) FPGA 身份認證 生物特征 手背靜脈 201104
聯(lián)芯科技獲得多個ARM IP授權(quán)
- ARM公司近日宣布：聯(lián)芯科技有限公司(簡稱“聯(lián)芯科技”)授權(quán)獲得包括ARM Cortex-A9多核處理器、Mali-400 MP GPU(圖形處理單元)和針對TSMC 40LP工藝技術(shù)的ARM Cortex-A9 PeRFormance Optimization Pack(性能優(yōu)化包)在內(nèi)的一系列ARM IP。聯(lián)芯科技將在自己的基帶芯片上集成基于ARM CPU和GPU的應用處理器，瞄準中國3G標準TD-SCDMA的高端智能手機。
- 關(guān)鍵字： 聯(lián)芯科技 ARM
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