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基于FPGA軟核的高速數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)
- 為解決不同性能指標(biāo)數(shù)據(jù)采集系統(tǒng)開(kāi)發(fā)時(shí)間較長(zhǎng)的問(wèn)題，提出了一種將FPGA軟核技術(shù)應(yīng)用于高速數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)的方法。系統(tǒng)以Xilinx公司的FPGA為例設(shè)計(jì)軟核，使用VHDL語(yǔ)言對(duì)軟核進(jìn)行模塊化設(shè)計(jì)。介紹了數(shù)據(jù)采集系統(tǒng)的硬件電路、USB固件程序、USB驅(qū)動(dòng)程序以及LabVIEW上位機(jī)的設(shè)計(jì)。該數(shù)據(jù)采集系統(tǒng)結(jié)構(gòu)可移植性強(qiáng)，有利于縮短同類(lèi)型系統(tǒng)設(shè)計(jì)研發(fā)周期。
- 關(guān)鍵字： FPGA 軟核 高速數(shù)據(jù) 采集
基于FPGA的高清視頻采集與顯示系統(tǒng)設(shè)計(jì)
- 高清視頻采集與顯示系統(tǒng)設(shè)計(jì)近年來(lái)，高清網(wǎng)絡(luò)攝像機(jī)席卷視頻監(jiān)控市場(chǎng)，傳統(tǒng)的模擬攝像機(jī)也在尋找新的出路提升圖像質(zhì)量，采用非壓縮方案的高清模擬攝像機(jī)成為首選。一般來(lái)說(shuō)，非壓縮方案的硬件平臺(tái)有DSP或ASIC或FPGA。
- 關(guān)鍵字： FPGA 高清視頻 采集 顯示系統(tǒng)
如何在FPGA中實(shí)現(xiàn)圖像格式轉(zhuǎn)換
- 首先由同步視頻輸入MegaCore 功能來(lái)處理SDI 視頻數(shù)據(jù)。該功能將同步視頻格式數(shù)據(jù)（ 例如， BT656 或者DVI） 轉(zhuǎn)換為流控制Avalon 流（Avalon-ST） 視頻協(xié)議，實(shí)現(xiàn)與數(shù)據(jù)通路后面其他視頻處理功能的鏈接?！ 〔捎?/li>
- 關(guān)鍵字： FPGA 圖像格式轉(zhuǎn)換
基于89C55和FPGA的頻率特性測(cè)試儀
- 摘要：為了能夠直接顯示待測(cè)網(wǎng)絡(luò)的幅頻相頻特性，設(shè)計(jì)了一個(gè)以89C55和FPGA構(gòu)成的最小系統(tǒng)為控制核心的頻率特性測(cè)試儀。系統(tǒng)基于DDS(直接數(shù)字頻率合成)原理和多周期同步計(jì)數(shù)相位測(cè)量法，由信號(hào)發(fā)生器，被測(cè)雙T網(wǎng)絡(luò)，真
- 關(guān)鍵字： 89C55 FPGA 頻率特性測(cè)試儀
FPGA為核心的多功能輸液系統(tǒng)的設(shè)計(jì)
- FPGA為核心的多功能輸液系統(tǒng)的設(shè)計(jì),今朝醫(yī)護(hù)人員一般不能全程陪護(hù)，會(huì)給病人和醫(yī)務(wù)人員帶來(lái)良多平安隱患和未便。本文設(shè)計(jì)了一種集輸液節(jié)制、顯示、報(bào)警、語(yǔ)音通信等多種 功能的輸液節(jié)制系統(tǒng)?！ ? 系統(tǒng)總體設(shè)計(jì) 輸液監(jiān)控系統(tǒng)原理如圖1所示，包括FP
- 關(guān)鍵字： FPGA 核心 多功能 輸液系統(tǒng)
在FPGA中實(shí)現(xiàn)圖像格式轉(zhuǎn)換的參考設(shè)計(jì)
- 引言服務(wù)器、交換機(jī)、前端編碼器以及專(zhuān)用演播顯示器等廣播基礎(chǔ)設(shè)備系統(tǒng)支持各種輸入圖像格式，在存儲(chǔ)、...
- 關(guān)鍵字： FPGA 圖像格式轉(zhuǎn)換 ASSP
基于DVI和FPGA的視頻疊加器設(shè)計(jì)
- 摘要：利用FPGA作為主控單元，以數(shù)字視頻接口DVI為視頻接口、TI公司的TFP401和TFP410為視頻信號(hào)的編解碼芯片...
- 關(guān)鍵字： FPGA 最小化傳輸差分信號(hào)
基于FPGA的外部存儲(chǔ)器設(shè)計(jì)
- 摘要：為了提高雷達(dá)海量數(shù)據(jù)的處理速度，采用FPGA設(shè)計(jì)了一種高速外部存儲(chǔ)器，通過(guò)多次實(shí)驗(yàn)，驗(yàn)證了設(shè)計(jì)方法的可行性。高速外部存儲(chǔ)器可以有效地提高數(shù)據(jù)存儲(chǔ)速度，節(jié)約讀／寫(xiě)時(shí)間，從而滿足信號(hào)處理的高速實(shí)時(shí)的要求
- 關(guān)鍵字： FPGA 外部存儲(chǔ)器
基于FPGA控制VGA顯示的多通道數(shù)字示波器的設(shè)計(jì)
- 摘要：為了實(shí)現(xiàn)對(duì)0～1 MHz的信號(hào)進(jìn)行測(cè)量以及顯示的目的，制作了基于SOPC技術(shù)的VGA顯示數(shù)字存儲(chǔ)示波器。采用硬件與軟件相配合的設(shè)計(jì)方法，主要模塊有基于FPGA的最小系統(tǒng)模塊、信號(hào)調(diào)理電路模塊、AD采樣模塊、觸發(fā)電路
- 關(guān)鍵字： FPGA VGA 多通道 數(shù)字示波器
基于FPGA的FIR數(shù)字濾波器的優(yōu)化設(shè)計(jì)
- 摘要：提出采用正則有符號(hào)數(shù)字量(CSD)編碼技術(shù)實(shí)現(xiàn)FIR濾波器。首先分析了FIR數(shù)字濾波器理論及常用設(shè)計(jì)方法的不足，然后介紹了二進(jìn)制數(shù)的CSD編碼技術(shù)及其特點(diǎn)，給出了其于CSD編碼的定點(diǎn)常系數(shù)FIR濾波器設(shè)計(jì)過(guò)程，使用
- 關(guān)鍵字： FPGA FIR 數(shù)字濾波器 優(yōu)化設(shè)計(jì)
基于FPGA的TCP粘合設(shè)計(jì)實(shí)現(xiàn)
- 基于FPGA的TCP粘合設(shè)計(jì)實(shí)現(xiàn),在應(yīng)用級(jí)代理的基礎(chǔ)上，為進(jìn)一步提高數(shù)據(jù)處理的速度，提出了TCP粘合技術(shù)[1]。該技術(shù)在通信雙方建立通信之初對(duì)雙方的握手信號(hào)以及通信原語(yǔ)進(jìn)行分析，獲取必要的信息，決定數(shù)據(jù)的流向，一旦雙方開(kāi)始通信，該代理就不再
- 關(guān)鍵字： 設(shè)計(jì) 實(shí)現(xiàn) 粘合 TCP FPGA 基于
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