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            EEPW首頁(yè) >> 主題列表 >> 預(yù)分選器

            基于FPGA參數(shù)關(guān)聯(lián)比較器的預(yù)分選器設(shè)計(jì)

            • 引言現(xiàn)代電子戰(zhàn)環(huán)境日趨復(fù)雜,信號(hào)日趨密集,新體制雷達(dá)不斷出現(xiàn),雷達(dá)信號(hào)的各個(gè)參數(shù)以各種規(guī)律變化,因...
            • 關(guān)鍵字: FPGA  預(yù)分選器  關(guān)聯(lián)比較器  

            基于FPGA的雷達(dá)脈沖預(yù)分選器設(shè)計(jì)

            • 現(xiàn)代電子戰(zhàn)環(huán)境復(fù)雜,信號(hào)密度大,所以對(duì)信號(hào)的實(shí)時(shí)分選很重要。這里,提出一種基于關(guān)聯(lián)比較器的雷達(dá)信號(hào)分選方法,在實(shí)現(xiàn)多參數(shù)分選的同時(shí),也保證了實(shí)時(shí)性。詳細(xì)闡述了在Virtex 4系列FPGA上實(shí)現(xiàn)基于內(nèi)容可尋存儲(chǔ)器(CAM)的關(guān)聯(lián)比較器的途徑。
            • 關(guān)鍵字: FPGA  雷達(dá)  脈沖  預(yù)分選器    
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            預(yù)分選器介紹

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