- FPGA/CPLD數(shù)字電路原理解析-當產(chǎn)生門控時鐘的組合邏輯超過一級時,證設計項目的可靠性變得很困難。即使樣機或仿真結果沒有顯示出靜態(tài)險象,但實際上仍然可能存在著危險。通常,我們不應該用多級組合邏輯去鐘控PLD設計中的觸發(fā)器。
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智能硬件 MCU FPGA
- FPGA芯片最小系統(tǒng)電路設計攻略 —電路圖天天讀(103)-設計一個基于FLEX10K芯片的最小系統(tǒng),通過對該最小系統(tǒng)的設計讓大家能夠更好的了解FPGA,并對其產(chǎn)生濃厚的興趣,為更多想要了解學習FPGA的工程師做個很好的開頭。
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智能硬件 MCU FPGA
- FPGA開發(fā)配置模式電路設計精華集錦-隨著FPGA 成為系統(tǒng)級解決方案的核心,大型、復雜設備常需要多片大規(guī)模的 FPGA。如果使用 PROM 進行配置,需要很大的 PCB 面積和高昂的成本.
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FPGA 串口通信 智能硬件 MCU
- FPGA航空總線協(xié)議接口電路解析-數(shù)據(jù)總線是飛機航電系統(tǒng)中首先運用的數(shù)字電子設備之一,其典型代表是飛機內(nèi)部時分制指令/響應式多路傳輸數(shù)據(jù)總線MIL-STD-1553B。它利用一條屏蔽的雙絞線進行帶有時鐘信息的數(shù)據(jù)傳輸。
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智能硬件 接口電路 FPGA
- 解讀FPGA芯片SOPC發(fā)射端電路設計-基于FPGA 芯片EP3C16Q240C8N 的片上可編程系統(tǒng),該系統(tǒng)可用于實現(xiàn)IFFT運算和接口模塊,利用可嵌入到此FPGA 芯片的NiosII 軟核處理器來實現(xiàn)數(shù)據(jù)傳輸和控制。
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智能硬件 MCU FPGA
- FPGA數(shù)字變換器控制電路設計攻略 —電路圖天天讀(102)-以FPGA為控制核心,開展數(shù)字量變換器測試系統(tǒng)設計,系統(tǒng)通過USB 實現(xiàn)與計算機的通信,能夠產(chǎn)生計算機字信號及相應移位脈沖信號、勤務信號和128路指令信號,并能接收經(jīng)過數(shù)字量變換器變化后的計算機數(shù)碼和指令數(shù)碼信號,測試系統(tǒng)能夠完成對數(shù)字量變換器各項性能指標的測試。
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數(shù)字信號處理器 FPGA 控制電路
- 解讀FPGA電容在線測試系統(tǒng)電路設計方案-本文研究了一種電容在線測試方法,并以向FPGA內(nèi)植入Nios II軟核作為控制器,以控制信號源的發(fā)生與測試檔位的自動切換。實驗證明了該測試方法的可行性及較高的精準度,達到了設計目的。
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智能硬件 FPGA 測試測量
- FPGA數(shù)碼相框電子電路設計大全 —電路圖天天讀(101)-數(shù)碼相框同時還可以將靜態(tài)圖片提升為動態(tài)的相冊,攜帶方便,儲存時間長遠,滿足于人們的需求,同時也會是一種節(jié)約型,環(huán)保低碳型的構想。
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控制電路 FPGA 數(shù)碼管
- 揭秘FPGA多重配置硬件電路設計方案-當FPGA 完成上電自動加載初始化的比特流后,可以通過觸發(fā)FPGA 內(nèi)部的多重啟動事件使得FPGA 從外部配置存儲器(SPI FLASH)指定的地址自動下載一個新的比特流來重新配置。
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MCU 存儲器 FPGA
- 解讀FPGA設計程控濾波器系統(tǒng)電路-設計了一個程控濾波器,實現(xiàn)了小信號程控放大、程控調(diào)整濾波器截止頻率和幅頻特性測試的功能。
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智能硬件 濾波電路 FPGA
- FPGA數(shù)據(jù)采集電子電路設計攻略 —電路圖天天讀(163)-提出一種基于FPGA技術的多路數(shù)字量采集模塊,利用FPGA的I/O端口數(shù)多且可編程設置的特點,配以VHDL編寫的 FPGA內(nèi)部邏輯,實現(xiàn)采集多路數(shù)字量信號。
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FPGA MCU 智能硬件
- FPGA開發(fā)外設子板模塊電路設計詳解 —電路圖天天讀(161)-FPGA以并行運算為主,以硬件描述語言來實現(xiàn),相比于PC或單片機(無論是馮諾依曼結構還是哈佛結構)的順序操作有很大區(qū)別,也造成了FPGA開發(fā)入門較難。
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FPGA 驅動電路 智能硬件
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