現(xiàn)場(chǎng)可編程門(mén)陣列（fpga）文章進(jìn)入現(xiàn)場(chǎng)可編程門(mén)陣列（fpga）技術(shù)社區(qū)

一種基于FPGA的接口電路設(shè)計(jì)

一種基于FPGA的接口電路設(shè)計(jì), 摘要：在航空電子系統(tǒng)中，經(jīng)常需要對(duì)1553B總線和ARINC429總線進(jìn)行雙向數(shù)據(jù)轉(zhuǎn)換以適應(yīng)不同電子設(shè)備的接口要求。由于兩種總線標(biāo)準(zhǔn)傳輸協(xié)議不同，傳輸速率和數(shù)據(jù)格式有較大差異，常規(guī)系統(tǒng)需要多種專業(yè)數(shù)據(jù)轉(zhuǎn)換芯片以
關(guān)鍵字：電路設(shè)計(jì) 接口 FPGA 基于

高性能數(shù)字接收機(jī)FPGA設(shè)計(jì)

摘要：基于Xilinx FPGA設(shè)計(jì)出一種高性能數(shù)字接收機(jī)。該數(shù)字接收機(jī)由高速、高分辨率A/D和高性能FPGA構(gòu)成。高速A/D實(shí)現(xiàn)中頻數(shù)字化，高性能FPGA實(shí)現(xiàn)數(shù)字下變頻、數(shù)字多相濾波、半帶抽取、匹配濾波和位同步功能，使得中頻載波為153.6MHz的TD-SCDMA信號(hào)，下變頻-抽取-濾波-位同步后得到高質(zhì)量的采樣率為1.28MHz的基帶信號(hào)。
關(guān)鍵字： FPGA 載波 A/D 201305

FPGA雙雄策略變圈地為王發(fā)揮能量

　　在FGPA戰(zhàn)場(chǎng)上，眾所皆知的頭號(hào)兩大對(duì)手就是Altera與Xilinx。一般認(rèn)為這兩對(duì)手會(huì)在同一個(gè)戰(zhàn)場(chǎng)上爭(zhēng)個(gè)你死我活，然而經(jīng)過(guò)多年的鏖戰(zhàn)，兩廠商已經(jīng)從過(guò)去積極的正面廝殺對(duì)決，改而轉(zhuǎn)向較為保守的畫(huà)地為王，以既有優(yōu)勢(shì)為基礎(chǔ)，固守疆域，進(jìn)而轉(zhuǎn)化為更大的研發(fā)能量。　　 ? 　　據(jù)了解，Xilinx在既有的28奈米FPGA市場(chǎng)已經(jīng)打下穩(wěn)定基礎(chǔ)，而目前xilinx也不側(cè)重在更先進(jìn)製程上與對(duì)手爭(zhēng)個(gè)你死我活，反倒是穩(wěn)扎穩(wěn)打固守疆土，選擇將FPGA的可程式化優(yōu)勢(shì)發(fā)揮到極致。Xilinx認(rèn)為，可程式
關(guān)鍵字： Altera FPGA

基于萊迪思FPGA的視頻顯示接口的實(shí)現(xiàn)

視頻顯示器市場(chǎng)分為：大批量應(yīng)用，如臺(tái)式機(jī)、筆記本顯示器和電視機(jī)面板;中等批量應(yīng)用，如小型人機(jī)接口(HMI)面板和大尺寸數(shù)字標(biāo)牌。本文將探討的是大尺寸顯示器面板應(yīng)用(表1)，其中FPGA是一個(gè)備受關(guān)注的選擇，它可以滿
關(guān)鍵字： FPGA 視頻顯示接口

FPGA核心知識(shí)詳解（3）：那些讓FPGA初學(xué)者糾結(jié)的仿真

對(duì)于FPGA初學(xué)者而言，如何正確了解并理解FPGA的仿真是關(guān)鍵。應(yīng)廣大FPGA初學(xué)者和愛(ài)好者要求，電子發(fā)燒友網(wǎng)編輯根 ...
關(guān)鍵字： FPGA 核心知識(shí) 仿真

基于FPGA協(xié)處理器的算法加速的實(shí)現(xiàn)

當(dāng)今的設(shè)計(jì)工程師受到面積、功率和成本的約束，不能采用GHz級(jí)的計(jì)算機(jī)實(shí)現(xiàn)嵌入式設(shè)計(jì)。在嵌入式系統(tǒng)中，通常是由相對(duì)數(shù)量較少的算法決定最大的運(yùn)算需求。使用設(shè)計(jì)自動(dòng)化工具可以將這些算法快速轉(zhuǎn)換到硬件協(xié)處理器中。
關(guān)鍵字： FPGA 協(xié)處理器算法

淺析FPGA設(shè)計(jì)流程及布線資源

1、電路設(shè)計(jì)與輸入　　電路設(shè)計(jì)與輸入是指通過(guò)某些規(guī)范的描述方式，將工程師電路構(gòu)思輸入給EDA工具。常用的 ...
關(guān)鍵字： FPGA 設(shè)計(jì)流程布線資源

FPGA硬件電路的調(diào)試必備原則和技巧

在調(diào)試FPGA電路時(shí)要遵循必須的原則和技巧，才能降低調(diào)試時(shí)間，防止誤操作損壞電路。通常情況下，參考以下步驟執(zhí)行 ...
關(guān)鍵字： FPGA 硬件電路調(diào)試必備

基于FPGA的自動(dòng)門(mén)控制設(shè)計(jì)

引言門(mén)和人類文明是孿生的，它伴隨著人類文明的發(fā)展而躍動(dòng)。21 世紀(jì)的今天，門(mén)更加突出了安全理念，強(qiáng)調(diào)了有效性：有效地防范、通行、疏散，同時(shí)還突出了建筑藝術(shù)的理念，強(qiáng)調(diào)門(mén)與建筑以及周?chē)h(huán)境整體的協(xié)調(diào)、和諧
關(guān)鍵字： FPGA 自動(dòng)門(mén) 控制設(shè)計(jì)

基于FPGA的ARM圖像縮放器的實(shí)現(xiàn)

ARM是目前全球最大的嵌入式芯片技術(shù)的IP提供商，其所擁有的IP已經(jīng)成為眾多芯片設(shè)計(jì)公司采納的一種技術(shù)標(biāo)準(zhǔn)和開(kāi)發(fā)平臺(tái)。所以基于ARM 內(nèi)核的SoC已經(jīng)成為嵌入式處理器的開(kāi)發(fā)重點(diǎn)，可通過(guò)ARM實(shí)現(xiàn)LCD控制器來(lái)完成對(duì)嵌入式
關(guān)鍵字： FPGA ARM 圖像

FPGA平臺(tái)的VGA圖像顯示的設(shè)計(jì)與實(shí)現(xiàn)

摘要：根據(jù)VGA(Video Graphic Array)的原理，采用VHDL硬件描述語(yǔ)言，設(shè)計(jì)了一種基于Zedboard FPGA板卡的圖像顯示方案。實(shí)驗(yàn)結(jié)果表明，在FPGA實(shí)現(xiàn)圖片顯示，達(dá)到了預(yù)期的效果，依據(jù)該原理，可以實(shí)現(xiàn)圖像的采集及在VGA顯示屏上顯示的實(shí)現(xiàn)。
關(guān)鍵字： VGA FPGA 圖片顯示 201304

基于PI控制的全數(shù)字鎖相環(huán)設(shè)計(jì)

針對(duì)以往全數(shù)字鎖相環(huán)研究中所存在電路結(jié)構(gòu)復(fù)雜、設(shè)計(jì)難度較大和系統(tǒng)性能欠佳等問(wèn)題，提出了一種實(shí)現(xiàn)全數(shù)字鎖相環(huán)的新方法。該鎖相環(huán)以數(shù)字比例積分控制的設(shè)計(jì)結(jié)構(gòu)取代了傳統(tǒng)的一些數(shù)字環(huán)路濾波控制方法。應(yīng)用EDA技術(shù)完成系統(tǒng)設(shè)計(jì)，并進(jìn)行計(jì)算機(jī)仿真。仿真結(jié)果表明：在一定的頻率范圍內(nèi)，該鎖相環(huán)鎖定時(shí)間最長(zhǎng)小于15個(gè)輸入信號(hào)周期，相位抖動(dòng)小于輸出信號(hào)周期的5％，且具有電路結(jié)構(gòu)簡(jiǎn)單、環(huán)路性能好和易于集成的特點(diǎn)。
關(guān)鍵字：比列積分控制全數(shù)字鎖相環(huán) 超高速集成電路硬件描述語(yǔ)言現(xiàn)場(chǎng)可編程門(mén)陣列

基于FPGA的頻率特性測(cè)試儀的設(shè)計(jì)

為設(shè)計(jì)一款便攜式頻率特性測(cè)試儀，該系統(tǒng)以大規(guī)?？煽r程邏輯器件為實(shí)現(xiàn)載體，采用了基于FPGA體系結(jié)構(gòu)的集成化設(shè)計(jì)方案，以VHDL為設(shè)計(jì)語(yǔ)言，設(shè)計(jì)了包含掃頻信號(hào)源、測(cè)幅、測(cè)相及顯示等電路，系統(tǒng)經(jīng)峰值檢測(cè)和相位檢測(cè)分別完成了被測(cè)網(wǎng)絡(luò)的幅頻和相頻特性測(cè)量及曲線顯示，經(jīng)調(diào)試功能上能滿足大部分系統(tǒng)要求，對(duì)RC串并聯(lián)電路進(jìn)行測(cè)量誤差為0．4％；該系統(tǒng)具有探作簡(jiǎn)單、成本低廉、性能穩(wěn)定等特點(diǎn)，具有較強(qiáng)的實(shí)用價(jià)值與發(fā)展前景。
關(guān)鍵字：頻率特性現(xiàn)場(chǎng)可編程門(mén)陣列直接數(shù)字頻率合成DDS 正弦信號(hào)

基于FPGA的IRIG-B標(biāo)準(zhǔn)DC code編碼器VHDL設(shè)計(jì)

為了實(shí)現(xiàn)靶場(chǎng)時(shí)統(tǒng)終端輸出IRIG-B標(biāo)準(zhǔn)DC code信號(hào)，采用VHDL語(yǔ)言在FPGA邏輯電路中設(shè)計(jì)了DC code編碼器硬件電路，通過(guò)QuartusⅡ軟件建立工程文件對(duì)VHDL語(yǔ)言DC code編碼器電路進(jìn)行編譯和仿真，獲得了符合IRIG-B標(biāo)準(zhǔn)的DC code信號(hào)。經(jīng)過(guò)實(shí)踐驗(yàn)證，該電路具有實(shí)現(xiàn)方法簡(jiǎn)單、電路穩(wěn)定性好、精度高的特點(diǎn)，實(shí)測(cè)同步精度小于1μs。
關(guān)鍵字： IRIG-B FPGA code VHDL

一種基于FPGA的DDR SDRAM控制器的設(shè)計(jì)

摘要對(duì)DDR SDRAM的基本工作特性以及時(shí)序進(jìn)行了分析與研究，基于FPGA提出了一種通用的DDRSDRAM控制器設(shè)計(jì)方案。在Modelaim上通過(guò)了軟件功能仿真，并在FPGA芯片上完成了硬件驗(yàn)證。結(jié)果表明，該控制器能夠較好地完成DD
關(guān)鍵字：控制器設(shè)計(jì) SDRAM DDR FPGA 基于

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現(xiàn)場(chǎng)可編程門(mén)陣列（fpga）介紹

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