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一種應用于折疊/插值型ADC的高速寬帶采樣保持電路
- 本文提出了一種基于0.18 μm BiCMOS工藝設計的開環(huán)采樣保持電路，采用了增益和失調誤差數字校準算法提升動態(tài)性能，應用于高速折疊/插值型ADC中。電路仿真和測試結果表明，在2GSPS采樣率下，折疊/插值型ADC的DNL≤±0.3LSB、INL≤±0.3LSB，有效位達到7.32位。
- 關鍵字： 開環(huán)采樣保持電路 數字校準 折疊插值 202205
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