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【從零開(kāi)始走進(jìn)FPGA】對(duì)立統(tǒng)一——異步時(shí)鐘同步化

　　一、什么是對(duì)立統(tǒng)一　　什么是CEO，就是首席執(zhí)行官，是在一個(gè)企業(yè)中負(fù)責(zé)日常經(jīng)營(yíng)管理的最高級(jí)管理人員，又稱作行政總裁，或最高執(zhí)行長(zhǎng)或大班。　　那么，在FPGA系統(tǒng)，需不需要一個(gè)最高級(jí)別的執(zhí)行官，來(lái)管理所有進(jìn)程呢?為了系統(tǒng)的有序性，不至于凌亂、崩潰，答案必然是肯定的。　　誰(shuí)都知道，F(xiàn)PGA內(nèi)部時(shí)序邏輯的工作，是通過(guò)時(shí)鐘的配合來(lái)完成任務(wù)的。那么當(dāng)系統(tǒng)中有異步時(shí)鐘的時(shí)候，怎么辦?每一個(gè)系統(tǒng)必須有一個(gè)最高級(jí)別的時(shí)鐘，執(zhí)行力最強(qiáng);同時(shí)它擔(dān)任著管理異步時(shí)鐘的任務(wù)，其它異步時(shí)鐘想讓手下執(zhí)行任務(wù)，必須告訴執(zhí)
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　1 引言　　基于FPGA的數(shù)字系統(tǒng)設(shè)計(jì)中大都推薦采用同步時(shí)序的設(shè)計(jì)，也就是單時(shí)鐘系統(tǒng)。但是實(shí)際的工程中，純粹單時(shí)鐘系統(tǒng)設(shè)計(jì)的情況很少，特別是設(shè)計(jì)模塊與外圍芯片的通信中，跨時(shí)鐘域的情況經(jīng)常不可避免。如果對(duì)跨
關(guān)鍵字： FPGA 異步時(shí)鐘策略

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