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UWB - 智能物聯(lián)的未來之星，你怎么看他？低功耗Wi-Fi解決方案在智能家居的應(yīng)用和發(fā)展結(jié)合超寬帶測距和雷達(dá)功能以實現(xiàn)高級IoT應(yīng)用來這里瞧瞧NXP技術(shù)培訓(xùn)視頻吧>>

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基于FPGA的線陣CCD驅(qū)動時序及模擬信號處理的設(shè)計

為保證線陣CCD在圖像測量中正常、穩(wěn)定工作，必須設(shè)計出適合其工作的時序驅(qū)動電路。在分析TCDl501D線陣CCD驅(qū)動時序關(guān)系的基礎(chǔ)上，通過分析CCD輸出的圖像信號，給出了內(nèi)、外相關(guān)雙采樣的時序控制。最后，利用quanus7．2軟件平臺結(jié)合VHDL語言進(jìn)行開發(fā)，對所需驅(qū)動脈沖進(jìn)行仿真設(shè)計。仿真結(jié)果表明，該驅(qū)動電路簡單、功耗小、成本低、抗干擾能力強，適用于設(shè)備小型化的要求。
關(guān)鍵字： FPGA CCD 線陣驅(qū)動

基于FPGA的全數(shù)字鎖相環(huán)的設(shè)計

簡單介紹了全數(shù)字鎖相環(huán)(ADPLL)的結(jié)構(gòu)和工作原理，提出一種在FPGA的基礎(chǔ)上可增大全數(shù)字鎖相環(huán)同步范圍的設(shè)計方法，并給出了部分verilog HDL設(shè)計程序的代碼和仿真波形。
關(guān)鍵字： FPGA 全數(shù)字鎖相環(huán)

基于FPGA的RS編碼器的設(shè)計與實現(xiàn)

RS碼是線性分組碼中一種典型的糾錯碼，既能糾正隨機(jī)錯誤，也能糾正突發(fā)錯誤，在現(xiàn)代通信領(lǐng)域越來越受到重視。文中介紹基于FPGA使用Verilog―HDL語言的RS(15，9)編碼器的設(shè)計方法，并在QuartusII 5．O軟件環(huán)境下進(jìn)行了功能仿真，仿真結(jié)果與理論分析相一致，該設(shè)計方法對實現(xiàn)任意長度的RS編碼有重要參考價值。
關(guān)鍵字： FPGA RS編碼器

基于FPGA的圖像采集系統(tǒng)設(shè)計與實現(xiàn)

1、引言視頻圖像采集是視頻信號處理系統(tǒng)的前端部分，正在向高速、高分辨率、高集成化、高可靠性方向發(fā)展。圖像采集系統(tǒng)在當(dāng)今工業(yè)、軍事、醫(yī)學(xué)各個領(lǐng)域都有著極其廣泛的應(yīng)用，如使用在遠(yuǎn)程監(jiān)控、安防、遠(yuǎn)程抄
關(guān)鍵字：設(shè)計實現(xiàn) 系統(tǒng) 采集 FPGA 圖像基于

用內(nèi)部邏輯分析儀調(diào)試FPGA

推動FPGA調(diào)試技術(shù)改變的原因　　進(jìn)行硬件設(shè)計的功能調(diào)試時，F(xiàn)PGA的再編程能力是關(guān)鍵的優(yōu)點。CPLD和FPGA早期使用時，如果發(fā)現(xiàn)設(shè)計不能正常工作，工程師就使用“調(diào)試鉤”的方法。先將要觀察的FPGA內(nèi)部信號引到引腳，然
關(guān)鍵字： FPGA 邏輯分析儀調(diào)試

擴(kuò)散爐溫度自動控制系統(tǒng)中的FPGA設(shè)計

擴(kuò)散爐溫度自動監(jiān)控系統(tǒng)是對雙管擴(kuò)散爐溫控部分進(jìn)行改造，以提高爐溫精度，從而提高生產(chǎn)線的成品率，降低系統(tǒng)能耗。通過對Actel公司的Fusion系列器件FPGA編程實現(xiàn)系統(tǒng)的硬件控制。用C語言對Actel FPGA內(nèi)置的8051軟核編程實現(xiàn)系統(tǒng)的軟件控制。整個監(jiān)控系統(tǒng)完成數(shù)據(jù)采集、控制算法和ZigBee無線傳輸?shù)裙δ?。測試表明，采用Fusion FPGA設(shè)計．可以同時完成多路溫度控制，整個系統(tǒng)的控制精度也有進(jìn)一步的提高。
關(guān)鍵字： FPGA 設(shè)計控制系統(tǒng) 自動溫度擴(kuò)散轉(zhuǎn)換器

基于單片機(jī)、EDA技術(shù)的波形發(fā)生器的設(shè)計

　該波形發(fā)生器以單片機(jī)(MCS8031)為中心控制單元，由鍵盤輸入模塊、數(shù)碼管顯示模塊、D/A波形發(fā)生模塊、幅值調(diào)整模塊組成。采用DDFS技術(shù)，先將要求的波形數(shù)據(jù)存儲于EEPROM中，這樣可以保證掉電以后波形數(shù)據(jù)不丟失?！?/li>
關(guān)鍵字：發(fā)生器設(shè)計波形技術(shù) 單片機(jī) EDA 基于單片機(jī) EDA技 DDFS 波形發(fā)生 FPGA VHDL

FPGA的可重構(gòu)測控系統(tǒng)應(yīng)用設(shè)計的研究

1可重構(gòu)測控系統(tǒng)的提出測控系統(tǒng)一般是指基于計算機(jī)實現(xiàn)數(shù)據(jù)采集和控制的系統(tǒng)。測控系統(tǒng)在工業(yè)現(xiàn)場控制、家...
關(guān)鍵字： FPGA 測控系統(tǒng) 應(yīng)用設(shè)計

千兆位無源光網(wǎng)絡(luò)(07-100)

　　在2005年，F(xiàn)SAN(全業(yè)務(wù)接入網(wǎng))組商定了千兆位無源光網(wǎng)絡(luò)(GPON)規(guī)范(見圖1)。此規(guī)范建立了語音、數(shù)據(jù)和視頻具有成本效益的遞交過程，這包括遞交到終端用戶的服務(wù)質(zhì)量。‘first mile’接入技術(shù)采用光纖連接(光纖到用戶系統(tǒng)連接)可增加寬帶內(nèi)容選擇。GPON很可能超過以太網(wǎng)無源光網(wǎng)絡(luò)成為未來光網(wǎng)絡(luò)的選擇。
關(guān)鍵字： FSAN GPON FPGA

SERDES的FPGA實現(xiàn)(07-100)

　　芯片功能的增加和數(shù)據(jù)吞吐量的要求，促使芯片行業(yè)從較低數(shù)據(jù)率的并行連接，轉(zhuǎn)向較高速度的串行連接。SERDES(Serializer-Dese rializer，)是經(jīng)高速差分對，而不是經(jīng)較低速度的并行總線傳輸串行化的數(shù)據(jù)。一個實例是用單個PCI-Express通道，替代傳統(tǒng)的32位、64MHz PCI總線(可達(dá)到2.112Gb/s)，僅用4條線(運行在2.5GHz)，可達(dá)到4Gb/s總數(shù)據(jù)率。簡言之，SERDES協(xié)議允許用較少的引腳數(shù)傳輸較高的數(shù)據(jù)率。
關(guān)鍵字： SERDES FPGA

適合無線應(yīng)用的FPGA(07-100)

　　大量出現(xiàn)的無線應(yīng)用具有嚴(yán)格的功耗設(shè)計要求和低價格。除功耗和低價設(shè)計任務(wù)外，還有高數(shù)據(jù)率要求和符合行業(yè)標(biāo)準(zhǔn)。系統(tǒng)設(shè)計師也需要保證最后產(chǎn)品的高性能和靈活性。
關(guān)鍵字： IF FPGA OFDMA WiMAX

無線基站中的FPGA和DSP組合(07-100)

　　FPGA和DSP之間的“智能配分”可使無線系統(tǒng)設(shè)計師獲得最佳性能組合和成本——效能。應(yīng)用DSP和FPGA組合可使成本降低。對于無線基站，組合有DSP可編程邏輯的系統(tǒng)配分，可促使更大的產(chǎn)品設(shè)計和市場成功率。
關(guān)鍵字： FPGA DSP

基于模糊控制的遲早門同步器及其FPGA實現(xiàn)

在數(shù)字通信系統(tǒng)中,必須以符號速率對解調(diào)器的輸出進(jìn)行周期性地采樣.為此,接收器需要一個采樣時鐘信號,這個時鐘信號的頻率和符號速率相等,相位則必須保證采樣時刻是最佳的.在接收器中獲得這個采樣時鐘的過程被稱為符號
關(guān)鍵字： FPGA 模糊控制同步器

如何發(fā)現(xiàn)并解決FPGA設(shè)計中的時序問題

耗費數(shù)月精力做出的設(shè)計卻無法滿足時序要求，這確實非常令人傷心。然而，試圖正確地對設(shè)計進(jìn)行約束以保證滿足時序要求的過程幾乎同樣令人費神。找到并確定時序約束本身通常也是非常令人頭痛的問題。時序問題的惱人之
關(guān)鍵字： FPGA 發(fā)現(xiàn) 時序

PCB版圖設(shè)計DD基于高速FPGA的PCB設(shè)計技術(shù)

如果高速PCB設(shè)計能夠像連接原理圖節(jié)點那樣簡單，以及像在計算機(jī)顯示器上所看到的那樣優(yōu)美的話，那將是一件多么美好的事情。然而，除非設(shè)計師初入PCB設(shè)計，或者是極度的幸運，實際的PCB設(shè)計通常不像他們所從事的電路設(shè)
關(guān)鍵字： PCB FPGA 版圖設(shè)計設(shè)計技術(shù)

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利用FPGA資源和最小模擬電路發(fā)電進(jìn)行開關(guān)電源設(shè)計的方法
基于FPGA的機(jī)載顯示系統(tǒng)架構(gòu)設(shè)計與優(yōu)化
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