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            SHARC處理器的起源和演進(jìn)

            ——
            作者:Paul Wheeler GP-DSP部日本區(qū)域總監(jiān) 時(shí)間:2009-09-25 來源:電子產(chǎn)品世界 收藏

              

            本文引用地址:http://www.biyoush.com/article/98491.htm

              也許讓人不敢相信,具有這種功能的在15年前就推向市場(chǎng)了,但讓許多人更加驚奇的是,這種目前還在繼續(xù)為用戶所用!這是架構(gòu)性能的良好擴(kuò)展性以及公司對(duì)質(zhì)量和用戶滿意做出承諾的最好證明。

              第二代將處理性能提升到了新的層次,它將內(nèi)核架構(gòu)擴(kuò)展為單指令多數(shù)據(jù)(SIMD)系統(tǒng),并將內(nèi)核時(shí)鐘頻率提高到100MHz。ADSP-2116x系列處理器保持了與ADSP-2106x SISD處理器的源代碼的完全兼容性,而且經(jīng)過少量代碼修改就能讓用戶發(fā)揮新增加的并行運(yùn)算單元(寄存器文件+乘法器+ALU+桶式移位器)的作用,與上一代相比可以將周期性能指標(biāo)提高一倍。

              為了在不降低周期性能的條件下方便到這個(gè)新增加的運(yùn)算單元的數(shù)據(jù)傳送,內(nèi)部的PM和DM數(shù)據(jù)總線寬度都增加到了64位,同時(shí)在ADSP-21161上集成了48位寬100MHz SDRAM控制器來增加I/O數(shù)據(jù)傳送帶寬,從而能夠?qū)崿F(xiàn)高達(dá)600MBps帶寬的數(shù)據(jù)傳送能力。

              就像上一代SISD SHARC一樣,第二代SHARC保留了支持簇總線系統(tǒng)架構(gòu)的多處理器無膠合連接,以及通過鏈路端口的點(diǎn)到點(diǎn)連接,使性能升級(jí)路線圖更加簡(jiǎn)單清晰。

              就像上一代SISD SHARC一樣,第二代SHARC系列器件被醫(yī)療、工業(yè)和軍事應(yīng)用所廣泛采用,而且由于額外集成了支持時(shí)分復(fù)用(TDM)和I2S格式的串行端口(SPORT),專業(yè)音響和高端消費(fèi)/汽車音響設(shè)備很快地利用到了該處理器的浮點(diǎn)運(yùn)算提供的大動(dòng)態(tài)范圍優(yōu)勢(shì)。

             

              第三代SHARC處理器開始跳出多處理器應(yīng)用空間,主動(dòng)迎接新的挑戰(zhàn)。由于在音頻應(yīng)用中具有明顯的浮點(diǎn)處理優(yōu)勢(shì),SHARC技術(shù)開發(fā)的重點(diǎn)開始轉(zhuǎn)向以最低系統(tǒng)成本努力增加片上處理功能。



            關(guān)鍵詞: ADI SHARC 處理器

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