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            EEPW首頁 > EDA/PCB > 業(yè)界動(dòng)態(tài) > 聯(lián)電否認(rèn)65nm技術(shù)出現(xiàn)良率問題 稱產(chǎn)能緊繃所致

            聯(lián)電否認(rèn)65nm技術(shù)出現(xiàn)良率問題 稱產(chǎn)能緊繃所致

            作者: 時(shí)間:2009-07-09 來源:sem 收藏

              (UMC)近日否認(rèn)了此前媒體對其65nm工藝出現(xiàn)良率問題的報(bào)道,并表示在滿足客戶需求方面的個(gè)別問題是由于客戶急單導(dǎo)致產(chǎn)能緊繃所造成的。

            本文引用地址:http://www.biyoush.com/article/96081.htm

              近日,臺(tái)灣媒體引述消息稱Xilinx遭遇代工廠65nm技術(shù)的良率問題。

              兩位受訪分析師對的解釋提出質(zhì)疑,指出65nm是成熟的工藝技術(shù),而且Xilinx Virtex-5已生產(chǎn)數(shù)月。

              UMC則稱其65nm技術(shù)良率一直在改善,并保持穩(wěn)定。

              FBR Capital Markets分析師指出,65nm技術(shù)的問題可能和第一季度該生產(chǎn)線關(guān)閉有關(guān),一般來說,先進(jìn)生產(chǎn)線良率要超過90%需6周時(shí)間。預(yù)計(jì)聯(lián)電65nm技術(shù)良率將在7月底超過95%。

              無獨(dú)有偶,代工龍頭臺(tái)積電近期也爆出40nm技術(shù)出現(xiàn)良率問題。



            關(guān)鍵詞: 聯(lián)電 65納米

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