超低功耗、高集成的模擬前端芯片ＭＡＸ５８６５是針對便攜式通信設(shè)備例如手機、ＰＤＡ、ＷＬＡＮ以及３Ｇ無線終端而設(shè)計的，芯片內(nèi)部集成了雙路８位接收ＡＤＣ和雙路１０位發(fā)送ＤＡＣ，可在４０Ｍｓｐｓ轉(zhuǎn)換速率下提供超低功耗與更高的動態(tài)性能。芯片中的ＡＤＣ模擬輸入放大器為全差分結(jié)構(gòu)，可以接受１ＶＰ－Ｐ滿量程信號；而ＤＡＣ模擬輸出則是全差分信號，在１．４Ｖ共模電壓下的滿量程輸出范圍為４００ｍＶ。利用兼容于ＳＰＩＴＭ和ＭＩＣＲＯＷＩＲＥＴＭ的３線串行接口可對工作模式進行控制，并可進行電源管理，同時可以選擇關(guān)斷、空閑、待機、發(fā)送、接收及收發(fā)模式。通過３線串口將器件配置為發(fā)送、接收或收發(fā)模式，可使ＭＡＸ５８６５工作在ＦＤＤ或ＴＤＤ系統(tǒng)。在ＴＤＤ模式下，接收與發(fā)送ＤＡＣ可以共用數(shù)字總線，并可將數(shù)字Ｉ／Ｏ的數(shù)目減少到一組１０位并行多路復用總線；而在ＦＤＤ模式下，ＭＡＸ５８６５的數(shù)字Ｉ／Ｏ可以被配置為１８位并行多路復用總線，以滿足雙８位ＡＤＣ與雙１０位ＤＡＣ的需要。

１ ＭＡＸ５８６５的工作原理

　　圖１所示為ＭＡＸ５８６５內(nèi)部結(jié)構(gòu)原理框圖，其中，ＡＤＣ采用七級、全差分、流水線結(jié)構(gòu)，可以在低功耗下進行高速轉(zhuǎn)換。每半個時鐘周期對輸入信號進行一次采樣。包括輸出鎖存延時在內(nèi)，通道Ｉ的總延遲時間為５個時鐘周期，而通道Ｑ則為５．５個時鐘周期，圖２給出了ＡＤＣ時鐘、模擬輸入以及相應(yīng)輸出數(shù)據(jù)之間的時序關(guān)系。ＡＤＣ的滿量程模擬輸入范圍為ＶＲＥＦ，共模輸入范圍為ＶＤＤ／２