1 SDRAM介紹

　　本文采用的SDRAM為T(mén)MS626812A，它內(nèi)部分為兩條，每條1M字節(jié)，數(shù)據(jù)寬度為8位，故存儲(chǔ)總?cè)萘繛?M字節(jié)。

所有輸入和輸出操作都是在時(shí)鐘CLK上升沿的作用下進(jìn)行的，刷新時(shí)鐘交替刷新內(nèi)部的兩條RAM。TMS626812A主要有六條控制命令，它們是：條激活/行地址入口、列地址入口/寫(xiě)操作、列地址入口/讀操作、條無(wú)效、自動(dòng)刷新、自行刷新。SDRAM與TMS320C54ｘ接口中用到的命令主要有： MRS、 DEAC、 ACTＶ、WRT－P、READ－P和REFR。這里，設(shè)計(jì)目的就是產(chǎn)生控制信號(hào)來(lái)滿足這些命令的時(shí)序要求。關(guān)于TMS626812A的具體說(shuō)明可以查看其數(shù)據(jù)手冊(cè)。

2 SDRAM與TMS320C54ｘ之間的通用接口

　　DSP I/F代表TMS320C54ｘ端接口單元，SDRAM CNTL 代表SDRAM 端接口控制單元。SDRAM被設(shè)置成一次性讀寫(xiě)128個(gè)字節(jié)，而DSP一次只讀寫(xiě)一個(gè)字節(jié)，因而建立了兩個(gè)緩沖區(qū)B0、B1來(lái)緩存和中轉(zhuǎn)數(shù)據(jù)。B0、B1大小都為128字節(jié)，而且映射到DSP中的同一地址空間。

盡管B0、B1對(duì)應(yīng)于同一地址空間，但對(duì)兩個(gè)緩沖區(qū)不能在同一時(shí)刻進(jìn)行合法訪問(wèn)。實(shí)際上，當(dāng)B0被DSP訪問(wèn)時(shí)，B1就被SDRAM訪問(wèn)，反之也成立。若DSP向B1寫(xiě)數(shù)據(jù)，SDRAM就從B0讀數(shù)據(jù)；而當(dāng)SDRAM的數(shù)據(jù)寫(xiě)到B0中時(shí)，DSP就從B1讀數(shù)據(jù)。兩者同時(shí)從同一緩沖區(qū)讀或?qū)懚紝⒓ぐl(fā)錯(cuò)誤。上邊所述的數(shù)據(jù)轉(zhuǎn)移方式有兩種好處：一是加速了TMS320C54ｘ的訪問(wèn)速度，二是解決了二者之間的時(shí)鐘不同步問(wèn)題。

3 FPGA中的硬件設(shè)計(jì)

TMS320C54ｘ為外部存儲(chǔ)器的擴(kuò)展提供了下列信號(hào)CLK、CS、A0～A15、D0～D15、RW、MSTRB、ISTRB、IS而SDRAM接收下列信號(hào)CLK、CKE、CS、DＱM、W、RAS、CAS、A0～A11。由于兩端控制信號(hào)不同，需要在DSP與SDRAM之間加上控制邏輯，以便將從DSP過(guò)來(lái)的信號(hào)解釋成SDRAM能夠接收的信號(hào)。圖3是用FPGA設(shè)計(jì)的頂層硬件接口圖。

圖中主要有三個(gè)模塊：DSP－IO、DMA＿BUF和SD－CMD。其中DSP－IO是DSP端的接口，用來(lái)解碼TMS320C54ｘ發(fā)送的SDRAM地址和命令。DMA＿BUF代表緩沖區(qū)B0、B1。SD＿CMD模塊用來(lái)產(chǎn)生SDRAM訪問(wèn)所需的各種信號(hào)。

DSP＿IO模塊又包括IO＿DMA、DSP＿BUF和DSP＿READ。IO＿DMA產(chǎn)生SDRAM的命令信號(hào)即圖3中的DSP＿RDＹ、DSP＿SD＿RW、DSP＿SD＿BANK＿SW、DSP＿SD＿ADDR20．．0、DSP＿SD＿ADDR＿RESET、DSP＿SD＿START。DSP＿BUF產(chǎn)生訪問(wèn)B0、B1的地址、數(shù)據(jù)和控制信號(hào)，圖3中指DSP＿SD＿BUFCLKI、DSP＿SD＿BUFCLKO、DSP＿SD＿BUFWE、DSP＿SD＿BUFADDR6．．0、DSP＿SD＿BUFIN7．．0。DSP－READ子模塊用來(lái)控制DSP的讀寫(xiě)方向。 DMA＿BUF分為B0、B1兩個(gè)緩沖區(qū)，用來(lái)進(jìn)行數(shù)據(jù)傳送每個(gè)緩沖區(qū)的輸入輸出信號(hào)包括CLKI、CLKO、WE、ADDR6－0、DATA＿IN7－0、DATA＿OUT7－0。BANK＿SW是一個(gè)開(kāi)關(guān)信號(hào)用于DSP和SDRAM對(duì)B0、B1的切換訪問(wèn)。

SD＿CMD模塊包括刷新、讀、寫(xiě)功能。當(dāng)DSP芯片發(fā)出SDRAM讀命令時(shí)，128字節(jié)的數(shù)據(jù)從SDRAM中讀出來(lái)并被存儲(chǔ)到B0或B1中，當(dāng)DSP發(fā)出寫(xiě)命令之時(shí)，128字節(jié)的數(shù)據(jù)傳到B0或B1之中并被最終寫(xiě)到SDRAM中。

4 軟件設(shè)計(jì)

TMS626812A SDRAM有兩兆字節(jié)的存儲(chǔ)容量。所以DSP用兩個(gè)I/O地址向FPGA傳送訪問(wèn)SDRAM的高低地址。此文中該兩個(gè)I/O地址對(duì)應(yīng)于圖4中的03ｈDMA＿ADDＨ和04ｈDMA＿ADDL。另外，還有一個(gè)I/O地址圖4中的05ｈ用來(lái)向FPGA傳送命令產(chǎn)生SDRAM訪問(wèn)的信號(hào)。

DSP向SDRAM寫(xiě)數(shù)據(jù)時(shí)的操作步驟如下：

1數(shù)據(jù)先被寫(xiě)到B0或B1。

2SDRAM的訪問(wèn)地址經(jīng)由DSP的I/O地址DMA＿ADDＨ和DMA＿ADDL發(fā)送到FPGA中。

3DSP向FPGA發(fā)出一個(gè)命令(I/O地址為DMA＿CTL)產(chǎn)生控制信號(hào)，使SDRAM從B0或B1中讀取數(shù)值。

DSP從SDRAM讀數(shù)據(jù)的操作步驟如下：

1DSP傳送訪問(wèn)SDRAM的地址。

2DSP經(jīng)由FPGA傳送一個(gè)命令，使得數(shù)據(jù)從SDRAM中讀到FPGA中。

3DSP從B0或B1中讀得數(shù)據(jù)。

具體設(shè)計(jì)時(shí)，應(yīng)參考相關(guān)資料進(jìn)行補(bǔ)充。不同的DSP與不同類(lèi)型的SDRAM接口時(shí)，會(huì)有細(xì)微的區(qū)別，電路設(shè)計(jì)完畢后要進(jìn)行認(rèn)真而多方面的測(cè)試。