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            EEPW首頁 > 嵌入式系統(tǒng) > 設計應用 > 基于DSP和CPLD技術的多路ADC系統(tǒng)的設計與實現(圖)

            基于DSP和CPLD技術的多路ADC系統(tǒng)的設計與實現(圖)

            ——
            作者:西安電子科技大學通信工程學院 林成保 劉彥明 時間:2007-02-06 來源: 收藏
            使用x9241實現高分辨率的軟件代碼

            為了方便理解實現控制的細節(jié),我們提供了c語言源代碼(代碼由xicor公司提供,我們做了一定的修改)。用戶只需要自己再編寫適用于不同單片機的i2c硬件接口函數(函數名稱同程序中介紹一致),在應用程序中加入我們提供的源代碼,簡單的調用程序中介紹的5個函數,就可以方便地實現dcp的高分辨率控制。

            關于x9241實現高分辨率的軟件源代碼,工程師可到
            摘 要:
            介紹了基于dsp和cpld技術,高精度多通道的adc系統(tǒng)的設計與實現方案,利用簡單的硬件電路和軟件編程,采用dsp和cpld相結合的方法,動態(tài)地設置采樣通道,控制模數轉換器max1162的數據采樣及傳輸。
            關鍵詞:dsp;cpld;模數轉換 引言
            ---隨著現代電子技術的應用和發(fā)展,數字信號處理的內容日益復雜,而adc是實現從模擬到數字轉換的一個必然過程。針對這種情況,利用數字信號處理器和可編程邏輯器件提出了多路adc系統(tǒng)的設計方法,實現了對動態(tài)多路模擬輸入信號的采樣傳輸以及處理,簡化了電路設計,可編程邏輯器件使得系統(tǒng)的通用性和可移植性得到良好的擴展。系統(tǒng)框圖如圖1所示。

            系統(tǒng)硬件設計
            本設計所采用的adc器件是maxim公司的生產的低功耗16位模數轉換器(adc)max1162。max1162采用逐次逼近型adc結構,具有自動關斷、1.1μs快速喚醒和兼容于spi/qspi/microwire的高速接口,采用+5v單模擬電源,并且具有獨立的數字電源引腳,允許芯片直接和+2.7~+5.25v的數字邏輯接口。ref引腳接外部參考電壓,用于設定模擬輸入電壓范圍,與模擬地之間連接一個4.7μf的電解電容;avdd引腳是+5v電源供應輸入端,與模擬地之間接一個0.1μf的電容;agnd是模擬地;cs是片選輸入,低有效。當為高時,系統(tǒng)處于斷電模式,由高變低時,激活系統(tǒng)到正常運行模式,同時初始化一次轉換。本系統(tǒng)選擇作為ad的使能信號;sclk是串行時鐘輸入,驅動模數轉換進程;dout是串行數據輸出,數據狀態(tài)在sclk的下降沿改變;dgnd是數字地;dvdd是數字電壓供應,與數字地之間接一個0.1μf的電容;ain是模擬信號輸入端。
            該adc系統(tǒng)的中央控制單元采用ti(德州儀器)公司的浮點數字信號處理器tms320vc33-150,tms320vc33的地址總線為24位,程序尋址范圍可達16m,數據總線為32位,內部具有34k


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