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            DS-SS接收機(jī)全數(shù)字AGC的FPGA實(shí)現(xiàn)

            作者: 時(shí)間:2008-12-25 來源:網(wǎng)絡(luò) 收藏

              因此中頻輸出信號幅度與正常信號幅度的比值為:

            DS-SS接收機(jī)全數(shù)字AGC的FPGA實(shí)現(xiàn)

              由(5)式可以看出,中頻輸出連續(xù)信號幅度相對于正常信號幅度的比值與MAG端輸出信號的占空比有關(guān),因此控制模塊的關(guān)鍵是設(shè)計(jì)一個(gè)電路來檢測輸出信號的占空比。

              利用一個(gè)計(jì)數(shù)器,采用射頻前采樣時(shí)鐘16.368MHz作為計(jì)數(shù)時(shí)鐘,在MAG高電平時(shí)計(jì)數(shù)。如果取計(jì)數(shù)時(shí)間為kms,則信號幅度處于射頻前端動(dòng)態(tài)范圍之內(nèi)時(shí),正常的計(jì)數(shù)值為(k×10 -3×16.368×10 6)/3,記為n0。設(shè)接收信號幅度變大時(shí),計(jì)數(shù)器的新計(jì)數(shù)值為n,則可推算出新的占空比為

              wnew=n/3n0 (6)

              由(5)和(6)式可知,已知新計(jì)數(shù)值和正常計(jì)數(shù)值就可計(jì)算出占空比,從而可計(jì)算出新的輸入信號幅度與正常信號幅度的比值或?qū)?yīng)分貝值。中頻連續(xù)信號輸出幅度相對于正常幅度的放大dB值正是控制模塊要輸出給數(shù)控衰減器的數(shù)值,因此衰減值dB轉(zhuǎn)換表就是基于(5)和(6)式構(gòu)建的。要注意數(shù)控衰減器的衰減量并不是連續(xù)可調(diào)的。AT90-0106數(shù)字衰減器的衰減分辨率為1dB,最高衰減器為50dB.因此整個(gè)轉(zhuǎn)換表也是以1dB為最小單位,將計(jì)數(shù)值(反映占空比)映射到衰減dB值。



            關(guān)鍵詞: AGC FPGA

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