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            用于PDIC的跨阻放大器的優(yōu)化設(shè)計

            作者: 時間:2013-11-06 來源:網(wǎng)絡(luò) 收藏
            提出了一種用于。電路由三級相同的推挽級聯(lián)而成,每級均采用一動態(tài)電阻對負(fù)載進(jìn)行補(bǔ)償,以提高的相位裕度。反饋電阻由一柵極受控的PMOS 管替代,避免了大尺寸多晶硅電阻引入的附加相移,增加了電路的穩(wěn)定性。采用XFAB 0. 6μm CMOS 工藝提供的PD K,在Cadence Spect re 環(huán)境下進(jìn)行電路設(shè)計、仿真驗證。仿真結(jié)果表明,電路的增益、帶寬及穩(wěn)定性均得到滿意結(jié)果。
            用于PDIC的跨阻放大器的優(yōu)化設(shè)計

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