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            EEPW首頁 > 嵌入式系統(tǒng) > 設(shè)計(jì)應(yīng)用 > 基于至簡設(shè)計(jì)法實(shí)現(xiàn)的PWM調(diào)制verilog

            基于至簡設(shè)計(jì)法實(shí)現(xiàn)的PWM調(diào)制verilog

            作者: 時(shí)間:2017-03-31 來源:網(wǎng)絡(luò) 收藏

              一、 功能描述

            本文引用地址:http://www.biyoush.com/article/201703/346091.htm

              脈沖寬度調(diào)制(pulse width modelation)簡稱,利用微處理器的數(shù)字輸出來對(duì)模擬電路進(jìn)行控制的一種非常有效的技術(shù),廣泛應(yīng)用在從測量、通信到功率控制與變換的許多領(lǐng)域中脈沖寬度調(diào)制是利用微處理器的數(shù)字輸出來對(duì)模擬電路進(jìn)行控制的一種非常有效的技術(shù),廣泛應(yīng)用在從測量、通信到功率控制與變換的許多領(lǐng)域中。

              在本章的應(yīng)用中可以認(rèn)為就是一種方波。如圖所示:

                

              波形圖

              上圖是一個(gè)周期為10ms,高電平為6ms,低電平時(shí)間為4ms的PWM,其占空比(高電平時(shí)間占整個(gè)周期的比例)為60%。

              本模塊產(chǎn)生8個(gè)不同的PWM脈沖,控制8個(gè)LED燈點(diǎn)亮不同時(shí)間,從而達(dá)到流水燈的效果。每個(gè)脈沖周期為10s,占空比從10%~80%。

              1. 上電后,led0點(diǎn)亮1s,熄滅9s;再點(diǎn)亮1s,熄滅9s,……,依此不斷循環(huán)。

              2. led1~led7與led0類似,分別點(diǎn)亮2s~8s,其他時(shí)候都是熄滅的。

              二、 平臺(tái)效果圖

                

              三、 實(shí)現(xiàn)過程

              本次案例信號(hào)列表:

              調(diào)制出了8個(gè)PWM脈沖分別對(duì)應(yīng)8個(gè)LED燈使其分別點(diǎn)亮1-8s,熄滅9-2s。



            關(guān)鍵詞: PWM verilog

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