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            STM32 APB1總線時鐘配置問題

            作者: 時間:2016-12-03 來源:網(wǎng)絡(luò) 收藏
            調(diào)試載波通信系統(tǒng)的時候遇到這樣一個問題:兩臺設(shè)備分別為A何B,他們都使用了定時器2~4來進(jìn)行通訊,A設(shè)備的PCLK1配置為HCLK,而B設(shè)備的PCLK1配置為1/2HCLK,通訊過程發(fā)現(xiàn)A,B兩個設(shè)備偶爾能通訊偶爾不能通訊,表現(xiàn)出通訊部穩(wěn)定。理論上應(yīng)該完全不能通訊才是,深入研究STM32F101C8T6的數(shù)據(jù)手冊發(fā)現(xiàn)問題所在,截圖如下:
            圖1 STM32功能框圖

            圖2 STM32 時鐘系統(tǒng)

            從圖1可以看到APB1總線掛接了TIM2~4,UART2~2...WWD等設(shè)備。然后從圖2中可以看到只有外設(shè)直接使用了APB1的時鐘作為實(shí)際時鐘,而TIM2~4根據(jù)APB1的時鐘進(jìn)行了調(diào)整。因此當(dāng)設(shè)備B的PCLK1配置為1/2HCLK時實(shí)際上就是將APB1配置為了1/2HCLK,此時因為APB1的分頻系數(shù)不為1,因此TIM2~4使用的時鐘自動2倍頻,實(shí)際頻率就是HCLK了。由于先2分頻再2倍頻理論上是和HCLK一致,但電路結(jié)構(gòu)等因素將導(dǎo)致得到的結(jié)果和直接賦予HCLK不完全一致,導(dǎo)致通訊不穩(wěn)定。最終通過調(diào)整A設(shè)備的PCLK1也為1/2HCLK,可以穩(wěn)定通信。



            關(guān)鍵詞: STM32APB1總線時鐘配

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