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            用于金融雙界面芯片的高精度低功耗穩(wěn)壓電路

            作者:馬永旺 何洋 杜鵬程 李振國(guó) 胡毅 唐曉柯 時(shí)間:2016-11-30 來源:電子產(chǎn)品世界 收藏
            編者按:金融雙界面應(yīng)用中,LDO(Low-dropout Regulator,低壓差線性穩(wěn)壓器)為片內(nèi)數(shù)字電路及主要模擬電路提供電源,高精度LDO可以保證數(shù)字電路及主要模擬電路工作狀態(tài)及功耗穩(wěn)定。為了提高金融雙界面應(yīng)用中LDO輸出電壓的精度,提出了一種LDO參考電壓上電切換電路。在高壓電源下設(shè)計(jì)一個(gè)不精準(zhǔn)的BG(Bandgap帶隙基準(zhǔn))僅用于啟動(dòng)過程,設(shè)計(jì)一個(gè)高精度BG在LDO的輸出電壓下工作。上電時(shí),LDO首先使用高壓電源域下BG的參考電壓,保證整個(gè)啟動(dòng)過程順利完成,同時(shí)關(guān)斷POWER管,使低壓工作下的電路不受

            作者/ 馬永旺1,2 何洋1,2 杜鵬程1,2 李振國(guó)1,2 胡毅1,2 唐曉柯1,2 1.北京智芯微電子科技有限公司 國(guó)家電網(wǎng)公司重點(diǎn)實(shí)驗(yàn)室 電力芯片設(shè)計(jì)分析實(shí)驗(yàn)室(北京 100192) 2.北京智芯微電子科技有限公司 北京市電力高可靠性集成電路設(shè)計(jì)工程技術(shù)研究中心(北京100192)

            本文引用地址:http://www.biyoush.com/article/201611/340865.htm

            摘要:金融雙界面應(yīng)用中,LDO(Low-dropout Regulator,低壓差線性穩(wěn)壓器)為片內(nèi)數(shù)字電路及主要模擬電路提供電源,高精度LDO可以保證數(shù)字電路及主要模擬電路工作狀態(tài)及功耗穩(wěn)定。為了提高金融雙界面應(yīng)用中LDO輸出電壓的精度,提出了一種LDO參考電壓。在高壓電源下設(shè)計(jì)一個(gè)不精準(zhǔn)的BG(Bandgap帶隙基準(zhǔn))僅用于啟動(dòng)過程,設(shè)計(jì)一個(gè)在LDO的輸出電壓下工作。上電時(shí),LDO首先使用高壓電源域下BG的參考電壓,保證整個(gè)啟動(dòng)過程順利完成,同時(shí)關(guān)斷POWER管,使低壓工作下的電路不受的影響,當(dāng)LDO及完成啟動(dòng)過程之后,將LDO的參考電壓切換至。測(cè)試結(jié)果顯示,LDO輸出電壓的隨機(jī)失調(diào)有效減小,由傳統(tǒng)結(jié)構(gòu)的±7%左右下降到±3.69%,并且能夠減小芯片面積。

            引言

              在金融雙界面芯片的應(yīng)用中,由于外部的接觸電壓變化范圍很廣(1.62V~5.5V),所以需要使用低壓差線性穩(wěn)壓器(LDO),用于將接觸電壓進(jìn)行穩(wěn)壓,以提供芯片內(nèi)部的數(shù)字電路及低壓模擬電路使用,LDO輸出電壓的精度直接受到基準(zhǔn)源產(chǎn)生的參考電壓精度影響。在傳統(tǒng)實(shí)現(xiàn)方式(如圖1所示)中,BG直接做在接觸電壓下,因?yàn)榻佑|電壓的變化范圍比較廣,所以BG需要使用高耐壓晶體管(高壓管)進(jìn)行設(shè)計(jì),高壓管雖然耐壓高,但是缺點(diǎn)也是很明顯的,溝道長(zhǎng)度較大,隨機(jī)失配大,實(shí)現(xiàn)同樣的精度時(shí),高壓管需要更大的面積及功耗。同時(shí),使用高壓管設(shè)計(jì)的BG產(chǎn)生的參考電壓具有很大的隨機(jī)失調(diào),所以也造成了最終LDO產(chǎn)生電源的誤差范圍很大。為了提高電源的精度,減小使用面積,希望能夠?qū)G做在LDO的輸出電壓下。但是,BG為L(zhǎng)DO提供參考電壓,而LDO又為BG提供電源,這樣存在一個(gè)死循環(huán)。

              本文提出的能夠解決這一問題。在LDO內(nèi)部有一個(gè)粗糙的基準(zhǔn)源,能夠在上電初始階段,為L(zhǎng)DO提供一個(gè)粗糙的基準(zhǔn),使得LDO產(chǎn)生電壓,以提供給高精度BG使用,當(dāng)高精度BG啟動(dòng)之后,會(huì)觸發(fā)切換過程,將LDO所使用的參考電壓,由粗糙的基準(zhǔn)源切換至高精度的基準(zhǔn)源。

            1 電路原理

              由于在金融雙界面應(yīng)用中,LDO的輸入電壓變化范圍很廣(1.62V~5.5V),而且有可能上電速度非常快(最快可達(dá)到100ns);所以,如果上電就開啟LDO的功率管,會(huì)導(dǎo)致高壓直接傳遞到LDO的輸出,而使得LDO后面所接的低壓MOS管擊穿,導(dǎo)致電路失效。

            1.1 現(xiàn)有技術(shù)分析

              現(xiàn)有技術(shù)如圖1所示,BG的電源由接觸電壓直接提供,這樣BG會(huì)使用高壓管進(jìn)行設(shè)計(jì),因此,VREF的隨機(jī)失調(diào)會(huì)非常大,根據(jù)經(jīng)驗(yàn),大概會(huì)有±7%以上的隨機(jī)失調(diào)。很顯然,±7%的誤差使得LDO輸出電源VOUT非常不準(zhǔn)確。為了減小面積并提升精度,提出了參考電壓上電切換的解決方法。

            1.2 分析

              如圖2所示,將低壓BG做在LDO的輸出電壓VOUT下,這樣就可以使用低壓MOS管獲得更小的面積以及更小的隨機(jī)失調(diào)。

              為解決上電時(shí)LDO沒有輸入?yún)⒖茧妷旱膯栴},做了一個(gè)啟動(dòng)用的低精度BG,用于提供上電過程中LDO的參考電壓。

              當(dāng)VCC上電時(shí),啟動(dòng)BG開始工作,LDO的POWER管初始被關(guān)閉,當(dāng)啟動(dòng)BG產(chǎn)生的參考電壓及參考電流提供給LDO之后,LDO開始啟動(dòng);當(dāng)VOUT電壓升高到一定電壓之后,會(huì)使得低壓BG啟動(dòng),產(chǎn)生VREFBG參考電壓;當(dāng)LDO以及低壓BG均完成啟動(dòng)過程,會(huì)觸發(fā)SW1和SW2開關(guān)進(jìn)行切換,將LDO使用的參考電壓由VREFCS切換成為VREFBG,從而獲得高精度的VOUT電壓。

            2 晶體管級(jí)電路設(shè)計(jì)

              上電切換電路主要由兩部分電路構(gòu)成,分別為切換開關(guān)電路以及切換信號(hào)產(chǎn)生電路。

              切換開關(guān)電路如圖3所示。在上電切換之前,切換信號(hào)CTRL為低,將SW1導(dǎo)通,SW2斷開,LDO使用啟動(dòng)BG產(chǎn)生的不精準(zhǔn)的VREFCS參考電壓。當(dāng)LDO以及低壓BG完成啟動(dòng)過程之后,切換信號(hào)CTRL變?yōu)楦唠娖剑瑢W2導(dǎo)通,而將SW1斷開,LDO使用高精度的VREFBG電壓。

              切換信號(hào)CTRL的產(chǎn)生電路如圖4所示。M1、M2、 M4、M5和M6構(gòu)成電流鏡,將輸入的參考電流IBCS進(jìn)行復(fù)制。M3將PMOS管進(jìn)行二極管連接,A點(diǎn)電壓VA與電源VOUT之間相差Vgsp;VA控制M7的柵極,當(dāng)VA高于M7的閾值電壓時(shí),M7開啟;M8的柵極由VREFBG控制,當(dāng)VREFBG高于M8的閾值電壓時(shí),M8管開啟。

              工作過程如下:

              上電后,當(dāng)LDO啟動(dòng),VOUT電壓比較低時(shí),此時(shí)低壓BG尚未啟動(dòng),VREFBG電壓為低,M7和M8管關(guān)斷,B點(diǎn)電壓由M6管充電,從而VB為高,CTRL為低。當(dāng) VOUT繼續(xù)上升到高于Vgs3+Vgs7時(shí),M7管開啟;VOUT給低壓BG供電,當(dāng)?shù)蛪築G啟動(dòng),VREFBG升高,從而開啟M8管;所以,當(dāng)同時(shí)滿足兩個(gè)條件:(1)VOUT高于Vgs3+Vgs7;(2)VREFBG高于Vgs8。M7和M8同時(shí)開啟,將B點(diǎn)拉低,從而導(dǎo)致CTRL的翻轉(zhuǎn),由低電平轉(zhuǎn)換為高電平。

            3 測(cè)試結(jié)果

              電路在和艦 110nm CMOS工藝實(shí)現(xiàn),啟動(dòng)BG和LDO總面積為364μmx334μm,靜態(tài)電流為30μA;

              圖5是常溫以及高低溫情況下,100ns快速上電的測(cè)試結(jié)果,其中l(wèi)1為電源VCC,l2為L(zhǎng)DO輸出的VOUT電壓。

              在VCC快速上電時(shí)(100ns時(shí)間內(nèi),由0V上升到5V),VOUT電壓并沒有過沖,而是緩慢上升,當(dāng)VOUT達(dá)到一定高度,且低壓BG完成啟動(dòng)之后,進(jìn)行了參考電壓的切換過程(圈中所示的時(shí)間點(diǎn)),此時(shí),LDO的參考電壓由低壓BG產(chǎn)生的VREFBG提供,具有較高的精度。

              由常溫及高低溫測(cè)試結(jié)果可知,該電路在抑制了快速上電過程中的過沖現(xiàn)象的同時(shí),利用切換電路,產(chǎn)生了高精度的LDO輸出電壓。

              對(duì)111顆芯片進(jìn)行電壓測(cè)試,并進(jìn)行了統(tǒng)計(jì)分析,得出了LDO輸出電壓隨機(jī)失調(diào)的結(jié)果,如圖6所示。

              將統(tǒng)計(jì)結(jié)果列表如表1所示。

              可以看到,由于該電路使用低壓BG為L(zhǎng)DO提供參考電壓,所以VOUT電壓的隨機(jī)失調(diào)比較小,由傳統(tǒng)結(jié)構(gòu)的±7%左右下降到±3.69%,并且能夠減小芯片面積。

            4 結(jié)論

              本文介紹了一種LDO參考電壓上電切換電路,分析了現(xiàn)有技術(shù)的缺陷以及解決方案,并詳細(xì)分析了晶體管級(jí)的電路實(shí)現(xiàn),最終給出了測(cè)試結(jié)果。測(cè)試結(jié)果表明,本文所提出的參考電壓切換方案可以在快速上電時(shí)避免過沖的情況下,使LDO產(chǎn)生較高精度的輸出電壓,可以滿足金融雙界面應(yīng)用的需求,并已成功應(yīng)用在兩顆金融雙界面芯片中。

            參考文獻(xiàn):

              [1]吳穎杰,周巍,于忠臣.高性能片內(nèi)集成CMOS線性穩(wěn)壓器設(shè)計(jì)[J].電子元器件應(yīng)用,2009(10):67-70.

              [2]許長(zhǎng)喜.低壓低功耗CMOS帶隙電壓基準(zhǔn)及啟動(dòng)電路設(shè)計(jì)[J].半導(dǎo)體學(xué)報(bào), 2005, 26(10):2022-2027.

              [3]PM Gray,RG Meyer.Analysis and design of analog integrated circuits. Fourth edition. John Wiley&sons, Inc, 2001.

              [4]劉簾曦,楊銀堂,朱樟明.基于MOSFET失配分析的低壓高精度CMOS帶隙基準(zhǔn)源[J].西安電子科技大學(xué)學(xué)報(bào):自然科學(xué)版, 2005, 32(3):348-352.

              [5] J Torres, M El-Nozahi, A Amer.Low Drop-Out Voltage Regulators: Capacitor-less Architecture Comparison[J].Circuits & Systems Magazine IEEE, 2014,14(2):6-26.

              [6] Ka Nang Leung, Philip K. T. Mok.A Capacitor-Free CMOS Low-Dropout Regulator With Damping-Factor-Control Frequency Compensation[J].IEEE Journal of Solid-State Circuits,2003,38(10):1691-1702.

              [7] Ka Nang Leung, Philip K. T. Mok.A CMOS voltage reference based on weightedV for CMOS low-dropout linear regulators[J].IEEE Journal of Solid-State Circuits, 2003, 38(1):146-150

              [8]劉陽,李強(qiáng),余昭杰,等.基于0.35μm CMOS的高性能LDO穩(wěn)壓器設(shè)計(jì)[J].吉林大學(xué)學(xué)報(bào):信息科學(xué)版,2012,30(5):470-474.

              [9] Qadeer Ahmad Khan, Sanjay Kumar Wadhwa, Kulbhushan Misri.Low power startup circuits for voltage and current reference with zero steady state current[J].International Symposium on Low Power Electronics & Design,2003:25--27.


            本文來源于中國(guó)科技期刊《電子產(chǎn)品世界》2016年第11期第74頁,歡迎您寫論文時(shí)引用,并注明出處。



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