為了能夠?qū)崿F(xiàn)4個(gè)通道數(shù)據(jù)傳輸?shù)幕ゲ桓蓴_，可以在程序代碼設(shè)計(jì)中使用狀態(tài)機(jī)進(jìn)行控制，部分程序代碼如圖4所示，相對(duì)應(yīng)的數(shù)據(jù)傳輸操作狀態(tài)轉(zhuǎn)移如圖5所示。同時(shí)只有正確接收到3個(gè)數(shù)據(jù)(脈沖周期、脈沖寬度、脈沖個(gè)數(shù))時(shí)，脈沖才能正常的傳輸，所以需要用到兩個(gè)寄存器，第1個(gè)寄存器作為緩沖器用來接收數(shù)據(jù)，當(dāng)緩沖器接收完3個(gè)數(shù)據(jù)時(shí)，將其3個(gè)數(shù)據(jù)同時(shí)發(fā)送至第2個(gè)寄存器，以控制輸出的脈沖波形。每接收到一個(gè)數(shù)據(jù)對(duì)其地址加1，以反過來讀取下一個(gè)地址的數(shù)據(jù)。

3 系統(tǒng)驗(yàn)證結(jié)果與分析

在系統(tǒng)驗(yàn)證的過程中，一旦系統(tǒng)接收到發(fā)送脈沖波形的命令后，就將數(shù)據(jù)文件解析成的脈沖波形通過DDR2發(fā)送，運(yùn)用Xilinx自帶的Chipscope對(duì)發(fā)送出的脈沖波形進(jìn)行監(jiān)測(cè)，結(jié)果如圖6所示。

從圖6中可以看出4個(gè)通道的前3個(gè)脈沖個(gè)數(shù)分別為5，6，7，和圖2參數(shù)文件中數(shù)據(jù)的一致。通過SMA接口將波形連接到示波器上進(jìn)行觀測(cè)，示波器上對(duì)應(yīng)的1，2，3，4分別為第一、二、三、四通道的波形圖，觀測(cè)到的波形如圖7所示，和Chipscope上抓取的數(shù)據(jù)保持一致。為了進(jìn)一步的驗(yàn)證結(jié)果的正確性與否，我們以通道一為例，對(duì)其進(jìn)行解釋，通過示波器引出波形，進(jìn)一步驗(yàn)證脈沖波形的周期和脈寬。以參數(shù)文件的00000090h：07D0h=2000d為例計(jì)算周期，2 000/100 M=20 μs，如圖8所示。以000000A0h：C8h=200d為例計(jì)算脈寬，200/100 M=2μs如圖9所示。

觀測(cè)圖形可看出通道1的周期為圖中箭頭部分的距離，為5μs×4=20μs，結(jié)果正確。

觀測(cè)圖形可看出通道1的脈寬為圖中箭頭部分的距離，為2μs，結(jié)果正確。

4 結(jié)論

文中沒計(jì)并完成了一種基于Xilinx V5的DDR2的數(shù)據(jù)解析功能的實(shí)現(xiàn)，了解了CPCI總線與FPGA之間的通信協(xié)議過程，同時(shí)根據(jù)外部數(shù)據(jù)文件實(shí)現(xiàn)了對(duì)輸出的脈沖波形進(jìn)行控制，檢測(cè)到的信號(hào)波形也準(zhǔn)確無誤，有效的控制了發(fā)射時(shí)間，在雷達(dá)應(yīng)用領(lǐng)域中具有一定的參考價(jià)值。