基于硬件協(xié)議棧的以太網(wǎng)遠程數(shù)據(jù)傳輸系統(tǒng)
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W5100內(nèi)部共有16 KB發(fā)送／接收緩沖區(qū)，發(fā)送和接收各占8 KB，默認每個端口的發(fā)送和接收均為2 KB，即RMSR=TMSR=0x55，在實際使用過程中，用戶可以根據(jù)實際情況調(diào)整發(fā)送／接收緩沖區(qū)大小。如圖2所示，通過修改每個端口對應的S1和S0寄存器可以修改相應的端口緩沖區(qū)大小。本文引用地址：http://www.biyoush.com/article/192755.htm
端口寄存器是分別針對4個獨立Socket的寄存器，以Sn_xx的形式表示，其中n取值為0、1、2、3。端口模式寄存器Sn_MR定義了該端口工作在TCP模式或者是UDP模式，不同模式下端口寄存器的表現(xiàn)形式不一，本文對此不作過多的闡述。
2 系統(tǒng)方案設計
本文核心處理器采用的是STM32F103VET6，它是一款基于Cortex—M3內(nèi)核的ARM處理器芯片，內(nèi)部集成了512K Flash程序存儲空間和64K的SRAM數(shù)據(jù)存儲空間。STM32F103VET6最高工作頻率72 MHz，含有資源外設接口，包括2個12位數(shù)／模轉(zhuǎn)換器、7個定時器、CAN總線接口、SPI通信接口、3路USART串行通信接口等資源。圖3展示了基于STM32F103VET6的W5100通信系統(tǒng)結(jié)構(gòu)圖，包括電源電路、時鐘電路、復位電路、
JTAG調(diào)試電路和W5100以太網(wǎng)通信電路。
2．1 硬件電路設計
本系統(tǒng)中STM32F103VET6處理器采用SPI串行接口方式與W5100進行通信，硬件電路連接如圖4所示。13F-60FGYDPNW2濾波器帶有網(wǎng)絡變壓器的RJ45接口元件。W5100的通信、控制引腳分別與STM32F103-VET6相連接，其中INT引腳連接PC4(外部中斷4)，該引腳低電平有效。當W5100產(chǎn)生連接、斷開、發(fā)送數(shù)據(jù)完成、接收到數(shù)據(jù)或者通信超時等情況時，該引腳將會產(chǎn)生一個從高電平到低電平的跳變，觸發(fā)一次中斷。W5100的RST_BG引腳需要通過一個12．3 kΩ的電阻接地，由于沒有標稱12．3 kΩ的電阻，因此采用12 kΩ電阻+300 Ω精密電阻的方式連接。
W5100工作頻率較高，為了保證通信的穩(wěn)定性、可靠性，在設計PCB電路板的時候有幾點需要注意：
①RJ45接口元件與W5100之間的距離要足夠的??；
②終端匹配模塊要盡量地靠近網(wǎng)絡變壓器；
③晶振布局要遠離網(wǎng)絡變壓器和TX、RX導線，避免對高速信號造成干擾；
④去耦電容距W5100的位置越近越好，導線相對越寬越好。
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