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            DVB-C解交織器的FPGA實(shí)現(xiàn)

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            作者:相海英 林濤 時(shí)間:2007-01-15 來源:電子設(shè)計(jì)應(yīng)用 收藏
            卷積交織和解交織原理簡介

            系統(tǒng)當(dāng)中,實(shí)際信道中的突發(fā)錯(cuò)誤往往是由脈沖干擾、多徑衰落引起的,在統(tǒng)計(jì)上是相關(guān)的,所以一旦出現(xiàn)不能糾正的錯(cuò)誤時(shí),這種錯(cuò)誤將連續(xù)存在。因此在系統(tǒng)里,采用了卷積交織來解決這種問題。它以一定規(guī)律擾亂源符號(hào)數(shù)據(jù)的時(shí)間順序,使其相關(guān)性減弱,然后將其送入信道,解交織器按相反規(guī)律恢復(fù)出源符號(hào)數(shù)據(jù)。

            的卷積交織和解交織原理為:交織由I=12(I為交織深度)個(gè)分支構(gòu)成。每個(gè)分支的延時(shí)逐漸遞增,遞增的單元數(shù)M=n/I=204/12=17(M為交織基數(shù))。這里的數(shù)據(jù)單位為字節(jié)。0支路無延時(shí),1支路延時(shí)17個(gè)符號(hào)周期,11支路則延時(shí)l7



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