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            EEPW首頁(yè) > 模擬技術(shù) > 設(shè)計(jì)應(yīng)用 > 基于TLV1562的四通道高速實(shí)時(shí)數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)

            基于TLV1562的四通道高速實(shí)時(shí)數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)

            作者: 時(shí)間:2009-12-30 來(lái)源:網(wǎng)絡(luò) 收藏

            1 引言

            本文引用地址:http://www.biyoush.com/article/188432.htm

            在雷達(dá)雜波對(duì)消器設(shè)計(jì)時(shí),傳統(tǒng)的方法是采用中頻對(duì)消,即雜波的抑制在中頻上實(shí)現(xiàn)。早期的中頻對(duì)消器常采用SAW(聲表面波)和CCD(電荷耦合器件)等模擬延時(shí)線。由于數(shù)字信號(hào)處理所具有的突出優(yōu)點(diǎn),尤其是數(shù)字集成電路的發(fā)展以及可編程邏輯器件功能的日益強(qiáng)大,使得數(shù)字式矢量對(duì)消器成為當(dāng)前及今后的主要工作模式 。 而對(duì)雷達(dá)信號(hào)的采集與處理成為最為關(guān)鍵的環(huán)節(jié),在設(shè)計(jì)中筆者選擇了精度為10位的高速低功耗可重配置,在較低成本下實(shí)現(xiàn)了多通道數(shù)據(jù)采集處理 。

            2 系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)

            2.1系統(tǒng)總體設(shè)計(jì)

            系統(tǒng)設(shè)計(jì)框圖如圖1所示,以為核心的前端采集系統(tǒng)是整個(gè)系統(tǒng)的一部分。整個(gè)系統(tǒng)由信號(hào)調(diào)理、信號(hào)采樣、高速信號(hào)處理(數(shù)字對(duì)消)以及波形回放等組成。信號(hào)調(diào)理電路是對(duì)經(jīng)相干檢波送來(lái)的信號(hào)進(jìn)行壓縮調(diào)整以滿足的采樣電平;信號(hào)采樣是完成模擬信號(hào)的數(shù)字化(由TLV1562完成);高速數(shù)字信號(hào)處理是在CPLD內(nèi)完成數(shù)字式對(duì)消算法;由AD7533構(gòu)成的波形回放部分是將對(duì)消處理過信號(hào)送到顯示屏顯示[3.4.5]

            圖1 雷達(dá)對(duì)消器系統(tǒng)總框圖

            2.2信號(hào)調(diào)理電路與A/D參考基準(zhǔn)源的設(shè)計(jì)

            由于對(duì)于規(guī)定的電源電壓AVDD,TLV1562的模擬輸入信號(hào)的范圍為0.8~(AVDD-1.9伏),所以必須要對(duì)相干檢波出來(lái)的模擬信號(hào)進(jìn)行處理,使其滿足要求。設(shè)計(jì)中,采用了如圖2所示的調(diào)理電路,R4用來(lái)調(diào)整輸入信號(hào)SIG4的幅度范圍,Vr-是由TL431調(diào)整出來(lái)的一個(gè)基準(zhǔn)電壓,用來(lái)控制信號(hào)的直流電壓[3]。

            圖2 信號(hào)調(diào)理電路


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