基于VHDL的99小時(shí)定時(shí)器設(shè)計(jì)及實(shí)現(xiàn)

作者：時(shí)間：2010-06-13 來(lái)源：網(wǎng)絡(luò)

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當(dāng)START為高電平時(shí)，該定時(shí)器將進(jìn)入倒計(jì)時(shí)階段。當(dāng)CLK脈沖上升沿到來(lái)時(shí)，計(jì)數(shù)以秒的速度減1，直到計(jì)時(shí)結(jié)束，使ALM位為高電平為止。CLR為復(fù)位端，可用來(lái)清零，通常采用異步復(fù)位方式。SETW用于選位，高電平有效。SET用于對(duì)選定的位進(jìn)行置數(shù)，也是高電平有效。ALM輸出端將在定時(shí)結(jié)束時(shí)產(chǎn)生高電平。Q0～Q5為四位BCD碼輸出端口，主要用于顯示。

3.2 顯示模塊

通過(guò)XUAN模塊可完成BCD碼的轉(zhuǎn)化，再經(jīng)DISP模塊譯碼．然后輸出給七段數(shù)碼管。

(1)XUAN模塊

XUAN可產(chǎn)生四位BCD碼輸入，并從sel端輸出。該模塊的管腳圖如圖5所示。其源程序代碼如下：

(2)DISP模塊

DISP模塊主要用于譯碼，可定義七段數(shù)碼管顯示的數(shù)字。其源程序如下：

4 系統(tǒng)仿真及結(jié)果

圖6所示是對(duì)AAA控制／定時(shí)模塊的仿真結(jié)果。由此結(jié)果可見(jiàn)，當(dāng)setw置“1”時(shí)，statea位選從0到5循環(huán)，分別代表六個(gè)數(shù)碼管的位置。當(dāng)start置“1”時(shí)，q5-q0進(jìn)行借位減法。q5、q4表示小時(shí)，最高可到99小時(shí)；q3、q2表示分鐘，最高59分鐘；q1、q0表示秒，最高為59秒。

5結(jié)束語(yǔ)

本設(shè)計(jì)從總體要求出發(fā)，采用模塊化設(shè)計(jì)方法，實(shí)現(xiàn)了長(zhǎng)達(dá)99小時(shí)的定時(shí)設(shè)計(jì)。同時(shí)采用QuartusⅡ4.0仿真環(huán)境進(jìn)行了仿真。結(jié)果證明，本系統(tǒng)可以實(shí)現(xiàn)理想的定時(shí)操作而且設(shè)計(jì)體現(xiàn)了人性化，具有較強(qiáng)的實(shí)際應(yīng)用價(jià)值。