圖 2 請(qǐng)注意，一旦該模式被激活 1/f 噪聲(基帶附近)便被轉(zhuǎn)換為奈奎斯特，并且兩種情況下均可看到 0-1MHz 的 SNR根據(jù)奈奎斯特 (32.5MHz) 測(cè)得 65MSPS 下 ADS5282 的 SNR 為 70.4dBFS。如果假設(shè)噪聲底限較奈奎斯特扁平，那么 0-1MHz 頻帶中的噪聲功率則為 85.5dBFS，這主要是由于 15.1dB 的處理增益：10log10 (32.5M/1M)。利用能夠過濾高達(dá) 1MHz 的信號(hào)和噪聲的理想濾波器，85.5dBFS 就為數(shù)字濾波器輸出的預(yù)期 SNR。但是，1MHz 頻帶中測(cè)得的 SNR 為 81.9dBFS，因?yàn)榛鶐洗嬖?1/f 噪聲。一旦噪聲抑制模式被激活，該頻帶中測(cè)得的 SNR 便提高到 86.1dBFS。1MHz 帶寬中測(cè)量值(86.1dBFS)超出預(yù)期值(70.4+15.1=85.5dBFS)的這一事實(shí)具有誤導(dǎo)性，因?yàn)樗怯梢粋€(gè)標(biāo)準(zhǔn)奈奎斯特 SNR(70.4dBFS)計(jì)算得到的，而該奈奎斯特SNR 包括了高階諧波(第九階以上)，其被當(dāng)作了噪聲。這表明，真正的奈奎斯特 SNR(所有諧波除外)實(shí)際上高于 0.6dB，或?yàn)?71dBFS。該 ADC 還在每條通道內(nèi)提供了兩倍抽取功能，以消除移頻 1/f 噪聲(仍然出現(xiàn)在 Fclk/2 附近)，通過處理增益改善帶內(nèi)SNR，并且降低高速串行 LVDS 數(shù)據(jù)速率。所用數(shù)字濾波器保持少量的抽頭，以達(dá)到節(jié)能的目的。這樣，使用抽取濾波器時(shí)處理增益為 ~2dB。通過使用抽取功能來降低 LVDS 速率后，可考慮使用更低成本的 FPGA 選項(xiàng)，同時(shí)在 ADC 和 FPGA 之間擁有更為輕松的時(shí)間預(yù)算。總結(jié)

　　滿足蜂窩網(wǎng)絡(luò)規(guī)范要求的 BTS 并不是一項(xiàng)全新的成果。大多數(shù)新型 BTS 設(shè)計(jì)的主要目標(biāo)都是想通過降低 BTS 構(gòu)建成本或減少 BTS 構(gòu)建數(shù)量來降低運(yùn)營(yíng)商的成本。其中，射頻成本只是構(gòu)建蜂窩基站總成本的一部分，因此如果它們可減少構(gòu)建基站的數(shù)量，那么就應(yīng)該對(duì)射頻接收機(jī)設(shè)計(jì)進(jìn)行改進(jìn)。通過構(gòu)建更為靈敏的射頻設(shè)備，覆蓋相同區(qū)域所需的基站數(shù)量更少。運(yùn)用具有高度集成的 ZIF 接收機(jī)和一個(gè)八通道 ADC 的分集接收機(jī)使可實(shí)現(xiàn)一個(gè)更少空間占用、更低成本和更少組件數(shù)量的高性能系統(tǒng)。