遙測(cè)艙信號(hào)源的設(shè)計(jì)與實(shí)現(xiàn)
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3 設(shè)計(jì)與實(shí)現(xiàn)
3．1 串行圖像數(shù)據(jù)
整幀傳輸時(shí)間為10 ms(包括幀頭和所有有效數(shù)據(jù)位)；在每幀數(shù)據(jù)開始發(fā)送時(shí)，先發(fā)送兩個(gè)幀頭校驗(yàn)字FAF3EB90，其中每個(gè)字寬度不大于200 ns(校驗(yàn)字每幀發(fā)送一次，所以每組校驗(yàn)字之間間距為10 ms)，然后再發(fā)送16 384(128行，128列)個(gè)字的原始圖像數(shù)據(jù)，每個(gè)數(shù)據(jù)字寬度同樣不大于200 ns，字的內(nèi)容為0000～4000循環(huán)發(fā)送；原始圖像數(shù)據(jù)發(fā)送完畢后，還需發(fā)送256個(gè)字的數(shù)字量，前兩個(gè)字為校驗(yàn)字050C146 F，202個(gè)字為有效數(shù)字量信息，字的內(nèi)容為0100～0000循環(huán)發(fā)送，其余信息字填零。
信號(hào)時(shí)序圖見圖2。本文引用地址：http://www.biyoush.com/article/179283.htm
YLVDSD：發(fā)送16位數(shù)據(jù)，傳送系統(tǒng)給圖像采集設(shè)備的所有數(shù)據(jù)，每個(gè)數(shù)據(jù)位寬度與時(shí)鐘的半個(gè)周期等寬；
YLVDSS：發(fā)送同步信號(hào)，每字同步，與首數(shù)據(jù)最高位同時(shí)發(fā)出，寬度為半個(gè)時(shí)鐘；
YLVDSC：時(shí)鐘信號(hào)，始終保持。
所有的數(shù)據(jù)以行時(shí)間為基準(zhǔn)，即每62．5μs發(fā)送一組128個(gè)數(shù)據(jù)(以同步信號(hào)為基準(zhǔn)計(jì)數(shù))。共發(fā)送130行，其中正程128行發(fā)送圖像數(shù)據(jù)，逆程兩行發(fā)送信息字。
采用VHDL語(yǔ)言編寫程序，使FPGA輸出固定時(shí)序的LVTTL電平的3路信號(hào)，經(jīng)過(guò)一片LVDS接口芯片后，轉(zhuǎn)為L(zhǎng)VDS信號(hào)。
LVDS接口芯片采用National Semiconductor公司的DS90C031，它是四路LVDS線驅(qū)動(dòng)器，單電源5 V供電。
3．2 并行數(shù)據(jù)
并行數(shù)據(jù)是以信息幀的形式沿字節(jié)多路轉(zhuǎn)換通道發(fā)送。信息更新周期為10 ms，每個(gè)更新周期傳送128個(gè)信息字。這些信息字分成2個(gè)子幀，每幀64個(gè)字，每5 ms發(fā)送一子幀。信息字為24位，包括8位地址、16位數(shù)據(jù)，這樣，并行數(shù)據(jù)的數(shù)字遙測(cè)信息速率為307．2 Kb／s。
并行數(shù)據(jù)的數(shù)字遙測(cè)信息字的結(jié)構(gòu)如圖3所示。
評(píng)論