基于Multisim的VHDL建模與仿真
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1．2 基于Multisire的VHDL建模
(1)Multisim中的VHDL語言編輯
由于Multisim軟件不能直接使用VHDL模塊，需要同時安裝Multisim 2001軟件。
①用Multisim中的VHDL-SIMULATION模塊完成VHDL語言的編輯，命名為“traffic．a(chǎn)cc”。
②編譯鏈接編輯好的VHDL語言，除了檢查VHDL語言錯誤外，編譯鏈接會產(chǎn)生一個“*．vx”文件，只有這個文件才能在制作元件封裝時調(diào)用，見圖2。本文引用地址：http://www.biyoush.com/article/176079.htm
(2)Multisim中元件制作封裝
Multisim使用模塊化的仿真方法，VHDL語言不能直接在Multisim軟件中仿真。在Multisim中使用COMPONENT WIZARD命令進(jìn)行交通燈的元件封裝制作。
①點擊TOOL中的COMPONENT WIZARD命令，輸入元件名字和元件類型，還可以輸入作者名字。
②輸入元件引腳數(shù)和元件引腳參數(shù)設(shè)計。包括引腳名稱，該名稱必須和VHDL語言中的名字相同；引腳類型，輸入或輸出等類型；元件外形的制作。
③仿真模型選擇。輸入模型名字，添加生成的VHDL語言文件“*．vx”。
④制作封裝好的交通燈元件如圖3所示。
2 基于Multisim的VHDL仿真
設(shè)計中的CLK信號采用Multisim元件庫提供的時鐘元件。交通信號燈采用Multisim元件庫提供的traffic_light元件。
電路如圖4所示。
由于交通燈控制元件U7的輸出高電平有效，而元件庫提供的traffic_light元件是低電平有效，在電路中設(shè)計子電路模塊XI實現(xiàn)高低電平的轉(zhuǎn)換。
從圖4和圖5的仿真可知，基于Multisim的VHDL電路能夠?qū)崿F(xiàn)設(shè)計的要求，并且利用這種方法電路設(shè)計模塊化，既可以有傳統(tǒng)的波形仿真也可以有直觀的實物驗證效果。對于復(fù)雜的電路可以將其劃分為小的子模塊在Multisim中進(jìn)行VHDL設(shè)計，然后將子模塊進(jìn)行連接達(dá)到電路設(shè)計的要求。
3 結(jié)語
本文通過將Multisim與VHDL相結(jié)合，實現(xiàn)了簡易交通燈控制系統(tǒng)的電路設(shè)計，通過仿真驗證了這種方法的有效性。這種方法還可以解決EDA教學(xué)過程中沒有FPGA開發(fā)板或者實驗設(shè)備缺乏的情況下如何利用虛擬仿真軟件仿真。
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