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            EEPW首頁(yè) > 消費(fèi)電子 > 設(shè)計(jì)應(yīng)用 > 視頻信號(hào)數(shù)字化光纖傳輸實(shí)驗(yàn)裝置的研制

            視頻信號(hào)數(shù)字化光纖傳輸實(shí)驗(yàn)裝置的研制

            作者: 時(shí)間:2012-02-09 來(lái)源:網(wǎng)絡(luò) 收藏

            2.3.2 同步分離部分
            全電視中除了圖像外,還包含復(fù)合同步:由行、場(chǎng)和色副載波等組成;這些同步信號(hào)與圖象、聲音信號(hào)按照一定規(guī)格的國(guó)際制式編制標(biāo)準(zhǔn)構(gòu)成,使得整個(gè)信號(hào)完整協(xié)調(diào)統(tǒng)一。所以在進(jìn)行處理信號(hào)時(shí),要對(duì)其中的同步信號(hào)實(shí)施技術(shù)分離,以便相應(yīng)控制處理,具體電路采用LM1881集成芯片實(shí)現(xiàn)。該芯片可從全電視信號(hào)中提取與分離出:行和場(chǎng)、后延同步、奇偶場(chǎng)的圖像信息。圖像的復(fù)合信號(hào)直接由系統(tǒng)的相關(guān)設(shè)備提供,芯片的BACK PORCH管腳在視頻信號(hào)消隱期間產(chǎn)生后延脈沖,該腳接到A/D轉(zhuǎn)換器AD9280的CLAMP端口即19腳,使A/D轉(zhuǎn)換器在信號(hào)的消隱期間處于鉗位工作模式,可將消隱電平鉗位在0電平的位置,從而使得采集處理信號(hào)時(shí)能夠正確得把握各個(gè)信號(hào)間的時(shí)序關(guān)系和邏輯關(guān)系,完成同步信號(hào)分離的功能。

            本文引用地址:http://www.biyoush.com/article/165897.htm

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            分離電路采用美國(guó)國(guó)家半導(dǎo)體器件公司出品的集成LM1881來(lái)實(shí)現(xiàn),電路如圖3所示。
            2.3.3 A/D轉(zhuǎn)換部分
            模數(shù)轉(zhuǎn)換電路同樣采用美國(guó)模擬器件公司出品的集成AD9280來(lái)實(shí)現(xiàn),其工作時(shí)鐘頻率設(shè)定為32MHZ,由FPGA提供。信號(hào)由AIN管腳輸入,D0~D7輸出轉(zhuǎn)換后的8位二進(jìn)制數(shù)據(jù)。STBY和THREE-STATE腳接地,以保證芯片正常工作。CLAPMIN接地,把消隱電平鉗位為0電平,其電路如圖4所示。

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            2.4 信號(hào)發(fā)送部分
            由FPGA處理后的數(shù)據(jù)要通過(guò)發(fā)送,不需先將并行數(shù)據(jù)轉(zhuǎn)換為串行數(shù)據(jù),再將串行數(shù)據(jù)轉(zhuǎn)換為光信號(hào)。

            2.4.1 并/串轉(zhuǎn)換
            電路采用串化器DS92LV1023集成芯片實(shí)現(xiàn),電路如圖5所示,其對(duì)應(yīng)接收端由解串器DS92LV1224集成芯片完成。DS92LV1023可以將10位并行數(shù)據(jù)轉(zhuǎn)換為串行差分?jǐn)?shù)據(jù)流,該差分?jǐn)?shù)據(jù)流可以由DS92LV1224還原為10位的并行數(shù)據(jù)。這一組芯片內(nèi)部有鎖相環(huán),可以為數(shù)據(jù)輸出自己匹配時(shí)鐘。串化器LV1023參考時(shí)鐘選為32MHz,數(shù)據(jù)在該時(shí)鐘頻率下輸入,其芯片內(nèi)部匹配產(chǎn)生數(shù)據(jù)輸出時(shí)鐘,每一個(gè)10位并行數(shù)據(jù)轉(zhuǎn)換為12位串行數(shù)據(jù),其中多出一個(gè)起始位和一個(gè)終止位,所以有效頻率為320 M。解串器的參考時(shí)鐘定為16MHz,以滿(mǎn)足數(shù)據(jù)需求。

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            由于視頻信號(hào)是實(shí)時(shí)不斷的,所產(chǎn)生的數(shù)據(jù)流連續(xù)進(jìn)行,所以電路不能設(shè)置進(jìn)入高阻態(tài)或省電模式,因此LV1023的DEN和PWRDN都置高電位。
            串行數(shù)據(jù)的準(zhǔn)確需妥串化器和解串器同步,該組芯片有2種同步方式:
            1)快速同步 串化器LV1023發(fā)送一組同步信號(hào),由連續(xù)是6個(gè)“1”和6個(gè)“0”組成,發(fā)送同步信號(hào)是由SYNC1和SYNC2控制的,當(dāng)SYNC1或SYNC2置高電平持續(xù)時(shí)間超過(guò)6個(gè)時(shí)鐘周期時(shí),則開(kāi)始連續(xù)發(fā)送同步信號(hào),當(dāng)解串器LV1224接收到同步信號(hào)后便開(kāi)始試圖鎖定時(shí)鐘信號(hào),鎖定完成之前LOCK保持高電平,鎖定完成后LOCK跳變?yōu)榈碗娖健?/span>



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