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            邏輯分析儀SignalTaPⅡ在系統(tǒng)級調(diào)試中的應(yīng)用

            作者: 時間:2011-03-22 來源:網(wǎng)絡(luò) 收藏


            3 實例分析
            本文以一個多波形信號發(fā)生器為例,具體說明使用SignalTap II進(jìn)行實時測試的具體過程。該設(shè)計基于Altera公司Cyclone II系列的EP2C8Q208C8。在Quartus II中完成的設(shè)計如圖2所示。

            本文引用地址:http://www.biyoush.com/article/150936.htm

            b.jpg


            設(shè)計的多波形信號發(fā)生器可以產(chǎn)生正弦波、三角波和方波,可以通過開關(guān)選擇輸出的波形。采用自頂向下的設(shè)計思想,底層采用VHDL語言編程和LPM_ROM模塊實現(xiàn),頂層采用原理圖設(shè)計。圖2中,rst為復(fù)位信號,sel[1..0]為波形選擇信號,clk為主時鐘,q[7..0]為輸出信號。當(dāng)sel=“00”時,輸出正弦波;當(dāng)sel=“01”時,輸出三角波;當(dāng)sel=“10”時,輸出方波。由分頻模塊、正弦波模塊(地址發(fā)生器模塊和LPM_ROM模塊)、三角波模塊、方波模塊和波形選擇模塊組成。
            的RTL電路圖如圖3所示,雙擊圖形中有關(guān)模塊,或選擇左側(cè)各項,可逐層了解各層次的電路結(jié)構(gòu)。

            c.jpg


            根據(jù)上述SignalTap II的工作流程,首先建立一個stp文件(stpl.stp),接著進(jìn)行參數(shù)設(shè)置,如圖4所示。調(diào)入待測信號q[7..0];采樣時鐘選為主頻時鐘信號CLK(50MHz)經(jīng)過分頻后的信號CLK1(100 kHz);在Buffer acquisition mode框中的Circulate欄設(shè)定采樣深度中起始觸發(fā)的位置,選擇前點觸發(fā)(Pre trigger position);采樣深度設(shè)為1KB;觸發(fā)級別選擇1;觸發(fā)信號選擇rst,在Pattern欄選擇上升沿觸發(fā)方式。然后連接實驗開板,進(jìn)行編譯下載。最后單擊SignalTap II面板上的Autorun Analysis按鈕,啟動SignalTap II進(jìn)行采樣和分析。



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