擴(kuò)展了32個(gè)XCLKOUT周期，等待狀態(tài)為853 ns，滿足液晶模塊的時(shí)序要求；但在實(shí)際應(yīng)用中，由于液晶模塊的顯示速度過(guò)快，顯示效果不是很好。這里，由于采用了CPLD芯片，可以修改VHDL程序，將循環(huán)次數(shù)由32次增加到146次，從而可以很方便地將等待狀態(tài)延長(zhǎng)為4 μS左右，實(shí)際效果也滿足了要求。

5 DSP對(duì)液晶模塊連續(xù)的讀寫訪問
當(dāng)F2812對(duì)液晶顯示模塊進(jìn)行連續(xù)的讀、寫操作時(shí)，兩個(gè)連續(xù)的讀、寫周期(激活階段)之間的時(shí)間間隔為上一個(gè)操作的跟蹤階段和這一個(gè)操作的建立階段，最大為12個(gè)XTIMCLK周期(156 ns)，不能延時(shí)。而由液晶的時(shí)序圖可知，對(duì)液晶的連續(xù)兩次操作的時(shí)間間隔，即使能信號(hào)E為低電平的時(shí)問，最小為700 ns?？梢姡瑑烧咧g時(shí)序不能匹配。于是，在連續(xù)兩個(gè)命令之間加人了延時(shí)語(yǔ)句。雖然這種方法較之硬件實(shí)現(xiàn)效率要低，但完全可以滿足系統(tǒng)的設(shè)計(jì)要求。

6 結(jié)論
F2812的外部接口設(shè)計(jì)較之已有的DSP更加獨(dú)立、靈活。本文給出的它與外部慢速設(shè)備時(shí)序匹配的方法，簡(jiǎn)單清楚、訪問直接、控制編程容易，有助于深入了解F2812芯片的時(shí)序特點(diǎn)，進(jìn)一步方便了該芯片的推廣使用。