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            一種基本信號產(chǎn)生器的設(shè)計(jì)與實(shí)現(xiàn)

            作者: 時(shí)間:2011-07-27 來源:網(wǎng)絡(luò) 收藏
            為了使該器系統(tǒng)更加簡化,沒有擴(kuò)展Flash存儲器以及SRAM存儲器,而采用EPCS1和FPGA內(nèi)的RAM來代替。EP1C6Q240C8的RAM容量為92 160 bit,在配置時(shí)分配空間的大小因程序的大小而定,做到資源的充分合理應(yīng)用。根據(jù)以上分析需要加入的組件有:NiosII CPU Core(CPU核)、片上存儲器以及PIO。配置完成后將會(huì)生成如圖5所示定制的CPU配置表。點(diǎn)擊Generate生成模塊,其模塊如圖6所示。

            本文引用地址:http://www.biyoush.com/article/150427.htm


              2.3 Nios II軟件程序

              在系統(tǒng)軟件階段,采用的開發(fā)工具是Nios IIIDE,它是Nios II系列嵌入式處理器的軟件開發(fā)工具。所有軟件開發(fā)任務(wù)都可以在Nios II IDE下完成,包括編輯、編譯、調(diào)試和下載。

              本程序的主要過程是:系統(tǒng)接收鍵盤掃描模塊發(fā)來的5位掃描碼,判斷鍵盤是否按下以及按下的鍵,根據(jù)按鍵的不同進(jìn)入不同的子程序以LCD顯示、頻率控制字的寫入、數(shù)據(jù)的生成以及將其寫入雙口RAM。

             主程序流程如圖7所示。

              3 軟硬件測試

              (1)在RAM中加入方波、三角波以及正弦波數(shù)據(jù),并設(shè)定頻率控制字為0x003fffff。采用Quartus II8.1的嵌入式邏輯分析儀。Signal-TapII Logic Analyzer觀看雙口RAM輸出q[7..0],截圖如圖8所示。

              (2)通過AS下載接口將硬件編程文件下載到EPCS1中,采用NiosⅡIDE通過JTAG接口運(yùn)行軟件程序。通過鍵盤設(shè)置正弦波、方波以及三角波及其頻率值輸出,并且在1602液晶上顯示相應(yīng)的提示信息,如圖11所示。


              4 結(jié)束語

              采用人機(jī)界面交互方式進(jìn)行選擇、頻率設(shè)置等,Nios II CPU通過判斷鍵盤輸入在LCD上給出相應(yīng)的顯示,提示用戶選擇相應(yīng)的按鍵,輸入完畢后,CPU將的信號數(shù)據(jù)和頻率控制字傳送給雙口RAM和頻率控制字鎖存器,最后在DAC輸出端輸出相應(yīng)模擬信號。


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